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基于Comsol Multiphysics平台,通过使用有限元仿真对三维集成电路的硅通孔(TSV)模型进行了热仿真分析。分别探究了TSV金属层填充材料及TSV的形状、结构、布局和插入密度对三维(3D)集成电路TSV热特性的影响。结果表明:TSV金属层填充材料的热导率越高,其热特性就越好,并且采用新型碳纳米材料进行填充比采用传统金属材料更能提高3D集成电路的热可靠性;矩形形状的TSV比传统圆形形状的TSV更有利于3D集成电路散热;矩形同轴以及矩形双环TSV相比其他结构TSV,更能提高TSV的热特性;TSV布局越均匀,其热特性越好;随着TSV插入密度的增加,其热特性越好,当插入密度达6%时,增加TSV的数目对TSV热特性的影响将大幅减小。 相似文献
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基于硅通孔(TSV)技术,可以实现微米级三维无源电感的片上集成,可应用于微波/射频电路及系统的微型化、一体化三维集成。考虑到三维集成电路及系统中复杂、高密度的电磁环境,在TSV电感的设计和使用中,必须对其电路性能及各项参数指标进行精确评估及建模。采用解析方法对电感进行等效电路构建和寄生参数建模,并通过流片测试对模型进行了验证。结果表明,模型的S参数结果与三维仿真结果吻合良好,证实了等效电路构建的精确性。采用所建立的等效电路模型可以提高TSV电感的设计精度和仿真效率,解决微波电路设计及三维电磁场仿真过程中硬件配置要求高、仿真速度慢等问题。 相似文献
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对硅通孔(Through Silicon Via, TSV)进行绑定后测试可以有效地提升三维集成电路的性能和良率。现有的测试方法虽然对于开路和桥接故障的测试能力较高,但是对于泄漏故障的测试效果较差,并且所需的总测试时间较长。对此,提出了一种基于分压电路的TSV绑定后测试方法。该方法设计了一种分压电路,进行泄漏故障测试时可以形成一条无分支的电流路径,有效提高了对泄漏故障的测试能力。此外,该方法测试开路故障和泄漏故障时的电流路径不会相互干扰,可以同时测试相邻TSV的开路故障和泄漏故障。实验结果表明,该方法可以测试10 kΩ以下的弱泄漏故障,并且在工艺偏差下依然能够保持较高的测试能力。相比同类测试方法,该方法所需面积开销更小,所需总测试时间更少。 相似文献
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光机热仿真分析是预测光学系统光学性能及结构优化的有效手段,本文提出了一种基于有限元仿真分析软件COMSOL Multiphysics,耦合固体传热学、固体力学以及几何光学的多物理场耦合建模方法,实现了离轴四反光学系统的光机热一体化仿真,避免了传统的光机热仿真分析在不同软件间信息传递和转换的过程,提高了仿真的集成性。本文针对离轴四反光学系统构建其多物理场耦合仿真分析模型,分析了光学系统在不同温度条件下的结构变形和光学镜面变形,并通过光线追迹和点列图判断光学性能变化,为后续开展光学系统的优化提供了一种有效手段。 相似文献
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电池组温度对锂离子电池的工作性能和使用寿命等特性影响很大。为研究电池放电倍率以及冷却液流速对电池热管理系统温度分布的影响,本文以18650锂离子电池为研究对象,采用有限元方法仿真分析了在不同放电倍率、不同流动速度下的BTMS温度分布情况,分析造成温度和温差过高的原因。研究结果表明:当冷却液流动速度相同时,放电倍率越大,电池单体温度越高;当冷却液速度在0~0.05 m/s范围内时,增大冷却液流速,电池组最高温度降低越显著;当流速大于0.05 m/s后,冷却液流速越大,电池单体间温差越小,但冷却效果也在逐渐变差。 相似文献
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为避免传统的探针检测对硅通孔(TSV)造成损伤的风险,提出了一种非损伤的TSV测试方法.用TSV作为负载,通过环形振荡器测量振荡周期.TSV缺陷造成电阻电容参数的变化,导致振荡周期的变化.通过测量这些变化可以检测TSV故障,同时对TSV故障的不同位置引起的周期变化进行了研究与分析,利用最小二乘法拟合出通过周期来判断故障位置的曲线,同时提出预测模型推断故障电阻范围.测试结构是基于45 nm PTM COMS工艺的HSPICE进行设计与模拟,模拟结果表明,与同类方法相比,此方法在测试分辨故障的基础上对TSV不同位置的故障进行分析和判断,并能推断故障电阻范围. 相似文献
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Microvias of 50 μm diameter in a Si chip were filled with Zn or Sn-Zn to form through-silicon vias by means of an electroplating/reflow process
or a dipping method. In the case of the electroplating/reflow process, Zn was electroplated on a Cu seed layer in via holes,
and a reflow was then performed to fill the via holes with the electroplated Zn. In the case of the dipping method, Zn via-filling
and Sn-Zn via-filling were performed by dipping a via hole specimen into a molten bath of Zn or Sn-Zn. A filling pressure
greater than 3 MPa during the via-filling is essential for ensuring that the via holes are completely filled with Zn or Sn-Zn
and for preventing voids from being trapped in the vias. The melting temperature and electrical conductivity of the Sn-Zn
alloys increases almost linearly with the content of Zn, implying that the thermal and electrical properties of the Sn-Zn
vias can be easily controlled by varying the composition of the Sn-Zn vias. A chip-stack specimen was fabricated by flip-chip
bonding of three chips with Zn vias. 相似文献
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提出了一种基于硅通孔(TSV)和激光刻蚀辅助互连的改进型CMOS图像传感器(CIS)圆片级封装方法.对CIS芯片电极背部引出的关键工艺,如锥形TSV形成、TSV绝缘隔离、重布线(RDL)等进行了研究.采用低温电感耦合等离子体增强型化学气相淀积(ICPECVD)的方法实现TSV内绝缘隔离;采用激光刻蚀开口和RDL方法实现CIS电极的背部引出;通过采用铝电极电镀镍层的方法解决了激光刻蚀工艺中聚合物溢出影响互连的问题,提高了互连可靠性.对锥形TSV刻蚀参数进行了优化.最终在4英寸(1英寸=2.54 cm)硅/玻璃键合圆片上实现了含有276个电极的CIS圆片级封装.电性能测试结果表明,CIS圆片级封装具有良好的互连导电性,两个相邻电极间平均电阻值约为7.6Ω. 相似文献
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本文说明了求解微波电路和场问题的三维等参元法并将它应用到计算谐振腔、慢波电路和波导不连续的参量上。给出了一些典型实例,并将这些结果和实验值和其他计算技术求得的结果进行比较。 相似文献
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To reduce interconnect delay and power consumption while improving chip performance, a three‐dimensional integrated circuit (3D IC) has been developed with die‐stacking and through‐silicon via (TSV) techniques. The power supply problem is one of the essential challenges in 3D IC design because IR‐drop caused by insufficient supply voltage in a 3D chip reduces the chip performance. In particular, power bumps and TSVs are placed to minimize IR‐drop in a 3D power delivery network. In this paper, we propose a design methodology for 3D power delivery networks to minimize the number of power bumps and TSVs with optimum mesh structure and distribute voltage variation more uniformly by shifting the locations of power bumps and TSVs while satisfying IR‐drop constraint. Simulation results show that our method can reduce the voltage variation by 29.7% on average while reducing the number of power bumps and TSVs by 76.2% and 15.4%, respectively. 相似文献
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针对硅通孔(Through Silicon Via;TSV)高度、直径和绝缘层厚度三个结构参数建立了25种不同水平组合的HFSS仿真模型,获取了这25种TSV的回波损耗和插入损耗并进行了方差分析。结果表明:随信号频率升高,TSV最大表面电场强度和插入损耗减小而回波损耗增大;在置信度为99%时,TSV高度是影响回波损耗和插入损耗的显著性因素;TSV直径和绝缘层厚度对回波损耗和插入损耗影响均不显著;TSV高度对回波损耗和插入损耗影响最大,其次是TSV直径,最后是绝缘层厚度。 相似文献
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Transformer is an important passive device, which is widely used in radio frequency (RF) Integrated circuit (IC). In this paper, three-dimensional transformers with turn ratios of 1:1, 1:2, and 1:3 and with primary and secondary windings nested by TSV technology is proposed. To evaluate the characteristics, the proposed transformers are simulated by HFSS software. The simulation results show that their coupling coefficients are 0.966, 0.966, 0.967, and their area are 3.6 × 10−3, 6.0 × 10−3, 9.6 × 10−3mm2. Compared with the other literature, the proposed transformers have good coupling and small area. 相似文献