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本文主要研究了低密度校验码(LDPC码)的编译码方法及其硬件实现。在讨论几种主要的LDPC码的编译码方法的基础上,对LDPC译码错误产生原因进行了分析,提出了一种改进的置信传播译码算法——最小和算法,该算法在几乎没有增加运算复杂度的情况下,明显地提高了译码性能。同时,本文基于几何思想的LDPC码为例,提出了并串结合的FPGA实现方法,给出了仿真结果。 相似文献
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简要介绍了准循环低密度奇偶校验(LDPC)码的重要性,对CCSDS 标准定义的LDPC 码进行了深入研究。针对LDPC 码的校验矩阵具有稀疏准循环特性,对归一化最小和译码算法进行了研究,给出了部分并行译码器的结构。通过数值仿真验证了译码算法在高斯白噪声条件下的译码性能。利用现场可编程逻辑器件(FPGA)对CCSDS 标准中定义的(5120,4096)码进行了实现。 相似文献
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低密度奇偶校验(Low Density Parity Check,LDPC)码的译码算法在FPGA实现时常采用整数量化操作,产生误差引起译码性能降低.引入归一化最小和(Normalized Minimum Sum,NMS)译码算法,在校验点信息数据量化的基础上乘以一个取值区间为(0,1)的改进因子减小误差.通过研究改进因子的合理取值,提出了一种随迭代次数取不同改进因子改善量化结果的新量化方法.研究对象为空间数据咨询委员会(The Consultative Committee for Space Data Systems,CCSDS)标准中近地空间应用的(8176,7154)LDPC码,在MATLAB上设计编译码算法程序并完成仿真.仿真结果表明改进量化方法完成译码所需的迭代次数更少,提高了译码性能.通过分析不同信噪比下迭代次数的变化,发现在较高噪声干扰下优势更明显. 相似文献
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IEEE802.16e标准定义的准循环低密度奇偶校验(LDPC)码是一种线性分组码。针对LDPC码校验矩阵的稀疏准循环特性,对基于部分并行结构的归一化最小和(NMS)译码算法进行了研究,给出了译码信息量化和信息交换的方法。通过数值仿真验证了译码算法在高斯信道中的译码性能,并利用现场可编程门阵列(FPGA)对该译码算法进行了实现。 相似文献
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本文在对LDPC码译码复杂度分析的基础上,对现有译码算法进行了基于计算机仿真的比较。对最小和译码算法提出了一种改进方法:量化的最小和算法,并进行了计算机仿真实验,实验结果表明,本方法在保持算法计算复杂度的前提下,误码率性能有了显著提高。 相似文献
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LDPC码的几种译码算法比较 总被引:4,自引:0,他引:4
信道编码的译码算法是决定编码性能和应用前景的1个重要因素,LDPC码成功的1个重要原因是它在译码算法上的优势。介绍了LDPC码常用的译码算法LogBP算法,然后由LogBP算法推导出它的近似算法———最小和译码算法,之后结合密度进化理论得到改进型的最小和译码算法。通过仿真比较了3种译码算法在AWGN信道上的误码性能和复杂度,表明改进型的最小和译码算法误码性能最好、复杂度适中,最适合硬件实现。 相似文献
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介绍了基于置信传播算法的LDPC码和积译码算法,分析其密度进行化特性,对不同消息空间中的量化译码问题进行研究,对采用不同量化方案时LDPC码在AWGN信道下的译码性能进行了仿真。仿真结果表明相对连续译码,中间变量6bit均匀量化会带来约0.4dB左右的损失,而10bit非均匀量化性能明显得到改善。合适的高阶量化译码可以获得接近连续译码的性能。 相似文献