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研究一种基于DSP(TMS6678)和FPGA(XC6VLX240)的通用雷达信号处理板的设计。利用FPGA(XC6VLX240)支持并行处理和IP核的特点,可快速实现多通道雷达信号的下变频(DDC)和数字脉冲压缩(DPC)等前期算法处理;利用8核DSP(TMS6678)支持浮点处理和多种高速接口类型的优势,可快速实现多目标检测(MTD)等后期算法处理及高速数据传输。最终利用SRIO交换机(TSI578)实现通用雷达信号处理板之间的高速数据通讯。 相似文献
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基于CPCI总线,使用FPGA实现了雷达信号处理板的设计与实现。实现数字下变频,大时宽带宽积数字脉冲压缩以及FFT等通用雷达信号处理功能。最后给出了数字下变频和大时宽带宽积数字脉冲压缩在某雷达系统中的测试结果,测试结果满足系统要求。 相似文献
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基于TS-101的通用信号处理板在雷达信号处理系统中有着广泛的应用,在雷达信号处理过程中,板间通信是数据传输中的重点和难点。本文介绍FPDP总线的通信协议和基于TS-101处理器的通用信号处理板的板间FPDP总线通信方式的设计与实现。该设计已经成功地使用在信号处理机中。最后还讨论了通用信号处理板的板间通信中应该注意的问题。 相似文献
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基于TS-101的通用信号处理板在雷达信号处理系统中有着广泛的应用,在雷达信号处理过程中,板间通信是数据传输中的重点和难点。本文介绍FPDP总线的通信协议和基于TS-101处理器的通用信号处理板的板间FPDP总线通信方式的设计与实现。该设计已经成功地使用在信号处理机中。最后还讨论了通用信号处理板的板间通信中应该注意的问题。 相似文献
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阐述了雷达数字信号处理通用模块的组成和基本原理,融入“三化”和系统级集成电路的设计思想,充分运用FPGA的系统设计和功能验证,给出了具体的工程实现实例。 相似文献
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建立一种雷达信号处理机双DSP+FPGA系统架构,对风廓线雷达信号处理机的功能和软硬件设计作了详细讨论。通过对系统的研制实践表明:基于一体化设计思想,采用模块化的硬件系统设计和功能化的应用软件设计是快速开发现代信息处理设备的有效方法。 相似文献
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分析了雷达视频信号模拟器的体系结构、功能,重点介绍了一种雷达视频信号模拟器的设计与实现。该模拟器采用工业控制计算机插装高性能的信号处理板和实时信号输出板的结构,应用外围设备连接(PCI)总线和现场可编程门阵列(FPGA)等技术,具有极大的灵活性和通用性。 相似文献
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研究了基于信号处理单元(SPU)平台的雷达信号处理技术,结合某雷达系统需求,采用高性能双数字信号处理器(DSP)和现场可编程门阵列(FPGA)的SPU硬件处理平台实现雷达信号处理,使用串行设计技术提高雷达信号处理的实时性、通用性、可靠性,同时减少信号处理的硬件设备量。实验结果验证了基于单块SPU雷达信号处理的可行性。 相似文献
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高度集成了8片ADSP-TS201的高性能信号通用处理器,主要用于完成标准CPCI总线平台下雷达信号处理任务,具备高速数据传输,海量数据处理,和主机交互等性能,其超强的实时性、处理能力和兼容性能很好的满足现在各种新体制雷达信号处理系统的要求。 相似文献
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Amritakar Mandal Rajesh Mishra M. R. Nagar 《Radioelectronics and Communications Systems》2016,59(4):151-162
Software defined radar (SDR) has been the latest trend in developing enhanced radar signal processing techniques for state-of-the-art radar systems. SDR provides tremendous flexibility in reconfigurable design and rapid prototyping capabilities on FPGA platform. To cater real-time processing for high-speed radar, COordinate Rotation Digital Computer (CORDIC) unit has been utilized as a core processing element in a complex digital phase locked loop (DPLL) for digital demodulation of received signal. Since the real-time systems are required to handle extremely high sampling rates, the pipelined architecture of CORDIC processing element has been chosen for its inherent high system throughput. The architecture is optimized in terms of bit-length for better convergence and loop performance of the first order complex DPLL during demodulation. TheBOXCARfilter has been used as a low pass filter in the output stage of the detector for better information recovery from narrow samples with little energy signal without incurring hardware overhead. Extensive MATLAB simulations have been added to show the effectiveness of the design for the application of radar phase detection. 相似文献
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为提升机载雷达信号处理机多通道、并行、大运算量的实时处理能力,基于DSP+FPGA结构采用模块化设计构建的新一代雷达信号处理机,符合“通用化、系列化、标准化”的要求,并且根据软件雷达的思想,通过改变算法和软件.使其适应不同的工作环境和任务需要。高性能DSPTS201和大容量FPGA为核心实现的新型通用机栽雷达信号处理机的通用平台。主要实现数字脉压、FFT,CFAR,SAR/ISAR等算法。 相似文献