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介绍一种用FPGA实现的中频数字化接收机数字下变频器,重点介绍了数字下变频器原理、能够降低运算工作量的多相滤波处理结构和分布式算法,给出了设计应用的实例。 相似文献
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本文结合多相滤波和一定条件下的电路等效关系,把抽取过程移到了混频和滤波之前,从而可以高效地接收宽带雷达信号.本文首先分析了多相抽取滤波的基本原理,然后给出了一定条件下的高效数字下变频器DDC等效结构,最后给出了设计实例和相应的计算机仿真结果.结果表明,本文所给出的高效宽带数字化雷达接收机设计技术是可行的. 相似文献
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为了解决宽带数字接收机中高速采样器数据速率与现有DSP器件处理能力之间的失配问题,提出了一种基于多相滤波的宽带正交数字下变频器的解决方案。利用FPGA具有并行高速计算的能力,适合多相滤波技术,并行多路正交数字下变频。结合FPGA处理的特点优化了设计,节省了FPGA消耗的资源。经过理论分析和工程实践,验证了该方案设计的合理性和正确性,以及实现的可行性和有效性。 相似文献
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软件数字下变频技术研究 总被引:1,自引:0,他引:1
本文讨论了软件无线电接收机中数字下变频处理的高效算法和结构,其目的是在DSP中用软件完成数字下变频处理,这样可省去专用数字下变频器(DDC)硬件集成电路,并增强中频处理的灵活性,适应性,文中指出将混频、抽取、滤波结合在一起完成将大大减少运算量,并分析了将CIC滤波器与内插的二阶多项式滤波器组合进行有效抽取滤波的设计方案,仿真结果表明该方案有效可行。 相似文献
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Gao Zhicheng Xiao Xianci 《电子科学学刊(英文版)》2001,18(1):38-45
The wide-band digital receiving systems require digital downconversion(DDC) with high data rate and short tuning time in order to intercept the narrow-band signals within broad tuning bandwidth. But these requirements can not be met by the commercial DDC. In this paper an efficient implementation architecture is presented. It combines the flexibility of DFT tuning with the efficiency of the polyphase filter bank decomposition. By first decimating the data prior to filtering and mixing, this architecture gives a better solution to the mismatch between the lower hardware speed and high data rate. The computer simulations show the feasibility of this processing architecture. 相似文献
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基于流水线CORDIC算法的数字下变频实现 总被引:2,自引:0,他引:2
数字下变频的FPGA实现通常都是基于查表的方法,为了达到高精度要求,常常需要耗费大量的ROM资源去建立庞大的查找表。文中提出了一种基于流水线CORDIC算法的数字下变频实现方案,可有效地节省FPGA的硬件资源,提高运算速度。文章最后给出了该方案的精度分析和实验的仿真结果。 相似文献
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宽带雷达接收机数字下变频技术研究 总被引:2,自引:0,他引:2
数字下变频(Digital Down Conversion,DDC)是宽带雷达中频接收机的关键技术之一,传统DDC实现方法在现有FPGA上无法满足带宽和滤波器精度对硬件资源的要求.针对这一问题,提出了一种数字下变频结构优化方法,给出了分布算法实现FIR滤波器的结构,研制出了一种最优化免混频数字下变频器,并已经成功应用于某宽带雷达系统. 相似文献
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Patrick Schaumont Serge Vernalde Marc Engels Ivo Bolsens 《The Journal of VLSI Signal Processing》1998,18(2):187-197
State-of-the-art data communication systems make extensive use of digital hardware. Besides baseband modulation functions, also the frequency tuning functions are now being shifted from analog to digital implementation. Integration, cost and ease of programming are the primary motivations for doing this. This paper presents an alternative to the traditional digital frequency conversion architectures. The proposed architecture achieves low power as well as high speed operation, and achieves this dual goal by reducing programmability. A multi-rate filtering approach is used, which is applicable for both upconversion and downconversion of quadrature modulated data. 相似文献
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微型SAR的数字下变频设计 总被引:1,自引:0,他引:1
在微型SAR实时成像样机的设计中,对雷达回波在中频进行采样,然后采用数字下变频技术实现正交解调,可以减少系统的复杂性,提高雷达的数字化程度和性能。该文针对微型SAR方案中数字下变频设计中的难点,即采样频率高达2 Gsps,带宽900 MHz,实时处理的难度很大,根据具体设计参数优化了数字下变频的实现结构,重点比较了并行FIR滤波器和快行FIR滤波器的差别,然后在FPGA中编程实现了数字下变频模块,给出资源占用情况、运行速度和量化噪声影响,最后给出在微型SAR技术项目中的实际应用结果,理想的成像结果表明了该设计的正确性。 相似文献