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针对视频图像采集系统中需要实时显示的数据存储效率问题,提出了一种基于FPGA的SDRAM乒乓读写操作设计。在研究SDRAM的基本原理和影响性能的主要参数的基础上,利用Verilog语言实现了SDRAM的初始化及自刷新。对SDRAM数据存储设计了一种乒乓读写操作控制方案,支持Bank切换存储,充分利用读写时差,提高了数据吞吐量。且对该控制方案中的多时钟域下的数据流交换设计了FIFO控制方案。用Modelsim仿真工具对Bank切换、SDRAM初始化、自刷新及乒乓读写进行了时序仿真。仿真波形表明该设计方案能很好的实现Bank切换及SDRAM的乒乓读写操作。 相似文献
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提出一种基于DSP+FPGA+2块RAM+高速A/D的乒乓式存取高性能数据采集通道,设计FPGA控制两片SRAM轮流存储和读取数据的高速数据通道的控制电路,构建实时高速、大容量的数据采集和信息处理系统,有效地实现DSP处理数据过程中不间断采集数据.论述了乒乓式存取和系统电路的工作原理,FPGA内部各功能模块的设计,DSP控制FPGA工作模式通过仿真得到总时序控制图,数据采集率达到6 MSPS,达到了自动、高速、大容量、实时采集的目的. 相似文献
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为了满足拖曳线列阵声呐系统数据传输实时性高、数据量大的要求, 设计了一种基于PCI总线的数据录取系统。硬件方面, 系统采用PCI9054高效率DMA传输技术与外扩大容量FIFO相结合的方案, 实现了高速、连续的声呐数据传输; 软件方面, 系统结合基于双层乒乓结构的内存映射文件和多线程技术实现了数据的实时存储、处理及显示。模拟及现场实验结果表明, 该录取系统能稳定、可靠地实现声呐数据的实时存储、波形回显等功能, 能满足大规模声呐系统数据录取的要求。 相似文献
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针对传统FLASH存储过程中存在的数据不连续、传输速度慢的问题,设计了一种双FIFO乒乓操作读写和四流水线FLASH写入结合的存储方法,提高了数据存储速率。通过对芯片操作时间的精确分析,提高了资源利用率。系统用FPGA作为主控芯片,通过例化IP核创建了两个FIFO,用作数据的乒乓读写,并用两块NAND FLASH芯片的四个片选构成四流水线操作。通过Modelsim仿真工作过程、FPGA生成伪随机码的数据写-读实验和读出数据的相关性检测试验验证了该流水操作的可行性、存储速率和存储连续性。结合红外相机实物采集并存储数据,然后通过上位机读取,得到了正确、连续的红外图像。通过扩展缓存和FLASH片数,可以在保证连续性的同时提高存储的速率,即该系统具有存储速率高、适应性强的特点。 相似文献
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为了长时间采集钢铁连铸大包下渣检测系统的振动信号,提出了一种高速、连续的数据采集方案;该方案以CPLD为核心逻辑控制模块,采用双FIFO乒乓结构实现数据的高速连续采集,通过PCI总线将数据传输到上位机;经测试,所提出的采集方案可实现对0~5V模拟电压信号,最高10MHz、12位AD转换精度的长时间连续采集,且所采集的信号各谐波所占比重的误差小于0.1%。 相似文献
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介绍了一种新颖的L波段低相噪、捷变频频率合成器.该方案所设计的频率合成器是一种可预置频率的合成器.在方案中,运用2个锁相环, 选择其中一个作为工作环,另外一个作为预置环(即:一个环工作,同时另一环预置下一工作频点, 锁相环锁定时间不影响跳频时间,可以减小环路带宽来提高纯度,得到高纯度频点).这种乒乓工作原理实现了高纯度、捷变频的跳频源.其输出频率为960~1 160 MHz,步进10 MHz,相位噪声、跳频时间和杂散抑制.文中给出了详细的设计过程、样品研制及测试结果. 相似文献
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