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91.
92.
何召兰 《信息技术》2003,27(6):10-12
介绍了电子设计自动化EDA (ElectricalDesignAutomation)技术的基本特点 ,以红外遥控为例 ,提出了一种PLD (可编程逻辑器件 )解码电路 ,并用ispLSI10 6 0实现 ,该电路原理简单、设计方便、工作可靠 ,可用于以键盘扫描为输入方式的智能仪器中。  相似文献   
93.
94.
可编程光学二值双轨逻辑门   总被引:1,自引:0,他引:1  
张子北  刘立人 《中国激光》1992,19(12):911-914
基于双轨逻辑,本文提出一种可级联的并行二值逻辑门。所有十六种二值逻辑运算可以采用偏振半波相延编程来实现。也提出了用电光晶体实现实时编程的方法。本文中给出了实验结果。  相似文献   
95.
叶雷 《电讯工程》2003,(2):18-22
本文通过对CPLD器件实际研究,仔细分析并给出了一些应用中消除竞争信号的方法,并使用了例子用以详细说明.文中所使用的程序均使用VHDL语言直接描述并编译通过,硬件编程对象为ALTERA公司的EPM7128SLl84—10,软件开发平台为MAX PLUS Ⅱ 10.0(基于WINDOWS 98)。  相似文献   
96.
97.
讨论同步时序电路初始化问题,提出了一种基于电路存储元件逻辑定级和可控性分析的同步时序电路逻辑初始化方法。同时也给出了针对ISCAS89电路的一些实验结果。  相似文献   
98.
VHDL逻辑综合及FPGA实现   总被引:2,自引:1,他引:1  
米良  常青 《微电子学》1996,26(5):292-296
运用VHDL语言描述了一个12×12位的高速补码阵列乘法器。重点是运用VHDL逻辑综合优化该乘法器,并进行了乘法器的XilinxFPGA实现、功能仿真和时序仿真。经选用XC4005PC-84-4芯片进行验证,证明了其正确性  相似文献   
99.
100.
早先对FPGA的延迟优化工作主要集中在减少关键路径中各元胞块的级数,但缺少用以控制元胞块增另的有效方法。在FPGA的情况下,所使用的元胞块数量也会在很大程度上影响布线后的最终延迟,因为大多数延迟是由存在的可编程互连所引起的布线延迟。中讨论了两类FPGA即基于查阅表的FPGA和基于多路开关复用器的FPGA的延迟优化,提出了可用于逻辑优化阶段的一种新的延迟优化方法,可以解决元胞块级数的减少与元胞块数  相似文献   
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