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1.
基于VHDL的CCD驱动时序设计 总被引:4,自引:0,他引:4
本文介绍了使用一种标准的硬件描述语言VHDL编写CCD驱动电路的新方法,给出了时序仿真波形,并验证了其可行性。 相似文献
2.
文章介绍了SOC设计流程,智能I/O处理器组成,在开发该处理器对VHDL源代码的优化问题。 相似文献
3.
4.
VHDL设计中信号与变量问题的探讨 总被引:1,自引:0,他引:1
本文从应用的角度举例说明了VHDL设计中信号与变量的区别,以及正确的使用方法,并介绍了为信号或变量赋予初始值的技巧。 相似文献
5.
6.
基于VHDL实现单精度浮点数的加/减法运算 总被引:1,自引:0,他引:1
研究了单精度浮点数加/减法的结构及其设计方法,并在Aldec公司的Active—HDL软件环境下,采用VHDL语言进行设计,并进行了仿真验证,计算精度可以达到10^-7。 相似文献
7.
8.
9.
李晓慧 《组合机床与自动化加工技术》2002,(10):51-52,55
在分析PLC优缺点的基础上,提出一种利用在线可编程逻辑控制代替PLC的新技术。此外,给出了用在线可编程器件CPLD/FPGA组成的、VHDL语言实现的工件取放设备控制电路设计和程序。 相似文献
10.
为了满足基带传输系统中传输码型无直流分量、低频分量少、便于提取定时时钟和具有一定的检错能力等要求,选择HDB3码并结合FPGA集成度高、速度快的特点,用ALTERA公司的Cyclone系列FPGA芯片EP2C8T144C6实现了HDB3编解码电路的设计.该设计提高了整个通信系统的集成度,克服了分立硬件电路带来的抗干扰差和不易调整等缺陷.实验结果表明:系统的传输误码率低于10 6.该设计可应用到实际的通信系统传输中. 相似文献