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1.
采用超高真空电子束蒸发法制备了新型高 K栅介质-非晶 ZrO2薄膜. X射线光电子能谱 (XPS) 中 Zr3d5/2 和 Zr3d3/2 对应的结合能分别为 182.1eV和 184.3eV, Zr元素的主要存在形式为 Zr4+,说明薄膜由完全氧化的 ZrO2组成 ,并且纵向分布均一.扩展电阻法( SRP)显示 ZrO2薄膜的 电阻率在 108Ω@ cm以上,通过高分辨率透射电镜( HR- XTEM)可以观察 ZrO2/Si界面陡直,没有 界面反应产物 ,证明 600℃快速退火后 ZrO2薄膜是非晶结构.原子力显微镜( AFM)表征了薄膜的 表面粗糙度,所有样品表面都很平整,其中 600℃快速退火样品 (RTA)的 RMS为 0.480nm.  相似文献   
2.
新型高k栅介质材料研究进展   总被引:5,自引:0,他引:5  
随着半导体技术的不断发展,MOSFET(metal-oxide-semiconductor field effect transistor)的特征尺寸不断缩小,栅介质等效氧化物厚度已小至nm数量级。这时电子的直接隧穿效应将非常显著,将严重影响器件的稳定性和可靠性。因此需要寻找新型高k介质材料,能够在保持和增大栅极电容的同时,使介质层仍保持足够的物理厚度来限制隧穿效应的影响。本文综述了研究高k栅介质材料的意义;MOS栅介质的要求;主要新型高k栅介质材料的最新研究动态;展望了高k介质材料今后发展的主要趋势和需要解决的问题。  相似文献   
3.
中科院上海微系统与信息技术研究所经过多年努力,发现了自主SiSbTe体系相变材料,验证了SiSbTe具有低于传统Ge2Sb2Te5的功耗、更高的数据保持力和更快的相变速度。  相似文献   
4.
针对硅衬底的化学机械抛光,采用自制的大粒径硅溶胶抛光液进行抛光实验,研究了抛光液中主要组分对抛光速率和表面平整度的影响,以提高抛光速率和抛光质量,采用测厚仪、AFM、台阶仪对抛光速率和表面进行了测试和表征.通过优化实验获得了高速率、高平整的抛光表面.去除速率(MRR)达697nm/min,表面粗糙度(RMS)降低至0.4516nm,在提高抛光速率的同时对硅片实现了超精密抛光.  相似文献   
5.
采用低成本、高效率的压印技术实现了高密度相变存储器(PCRAM)存储阵列的制备,开发出Si2Sb2Te5(SST)新材料的4Gbit/inch2存储阵列,存储单元面积为0.04μm2;利用SEM观测压印获得的光刻胶图形阵列以及刻蚀后的SST存储阵列,其单元外形均具有高度的一致性,且单元特征尺寸的3倍标准差均小于6nm;利用AFM研究了SST存储单元的I-V特性,阈值电压为1.56V,高、低电阻态阻值变化超过两个数量级。实验结果表明了SST新材料及压印技术在PCRAM芯片中的应用价值。  相似文献   
6.
综述了绝缘层上的硅(SOI)材料在高压器件中的应用,分析了SOI高压器件的不同结构,并对现在最常用的RESURF LDMOS高压器件结构,以及不同器件参数对击穿电压的影响进行了分析和讨论.  相似文献   
7.
针对超大规模集成电路多层互连结构中介质CMP抛光速率低,急需的大粒径硅溶胶研磨料,本文采用改进的粒径生长控制工艺制备介质CMP用大粒径硅溶胶,并采用TEM、激光粒度分析仪和Zeta电位测试仪等先进手段对其粒径大小、粒径分布和稳定性进行了表征。以低分散度硅溶胶纳米研磨料配制抛光浆料进行了二氧化硅介质的CMP研究,结果表明,平均粒径103.4nm的硅溶胶浆料的去除速率达630nm/min,有效解决了二氧化硅介质CMP低速率的难题。  相似文献   
8.
在相变存储器器件设计中,为预测不同器件结构的性能优化器件结构设计,建立相应的数值模型进行数值模拟是一项非常重要的工作。在我们的工作中,提出了一个包含泊松方程,电流连续性方程,热传导方程以及相变动力学模型的耦合系统,进行相变存储器数值模拟,与常用的相变存储器数值模拟相比,使用了泊松方程以及电学连续性方程代替拉普拉斯方程来对相变存储器的电学特性进行建模,由于组成相变存储器的相变材料,本质上是一种半导体,因此,利用上述基于半导体理论的数值模型,能更精确的反应相变存储器的电学特性。结果表明,该模拟方法能够进行相变存储器的模拟,并与测试数据吻合较好。最后,利用上述数值模拟,对不同电极尺寸的相变存储单元的性能进行预测,从而得到影响相变存储单元性能的关键设计参数以及相应的设计策略。  相似文献   
9.
本文针对相变存储器编程驱动电路,提出了一种超低输出电压纹波的开关电容型电荷泵。该电荷泵可根据输入电压的不同,自适应工作在2X/1.5X升压模式之间,以获得更高的电源转换效率。相比于传统开关电容型电荷泵,在充电阶段泵电容被充电至预先设定的电压值Vo-VDD(Vo为预期的输出电压);放电阶段,泵电容串联在输入电压VDD与输出端,通过此方法将电荷泵输出端电压稳定在Vo,并有效的降低了由于电荷分享所造成的输出纹波。在中芯国际40nm标准CMOS工艺模型下,对电路进行了仿真验证,结果表明在输入电压为1.6-2.1V,输出2.5V电压,最大负载电流为10mA,输出电压纹波低于4mV,电源效率最高可达91%。  相似文献   
10.
针对大规模相变存储器所具有的寄生电容大、可能出现读破坏现象等特性,提出了一种读电压模式的相变存储器读出电路及其快速读出方法。基于SMIC 40nm CMOS工艺的仿真结果表明,在2.5V电源电压下,该方法可以在90ns的读出周期内正确读出位线寄生电容为30pF的存储单元数据,同时,该读出周期随位线寄生电容的减小而减小。另外,该方法可以和传统的Burst等快速读出方式并存,非常适用于带数据预读机制的高端存储器技术。  相似文献   
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