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1.
中国重汽HOWO轻卡2020年产销量屡创新高,各生产线承受了巨大的生产压力。冲压自动化生产线没有成为瓶颈工序,要归功于生产节拍优化。生产节拍是衡量生产线产能的重要指标,节拍优化后的生产效率大幅提高,在相同的时间内可以生产更多的冲压件,从而降低冲压件的生产成本。  相似文献   
2.
针对IEEE1588时钟同步过程中存在时钟频率漂移问题,提出了一种基于滑模控制的新型时钟同步算法。首先根据主从时钟偏差与漂移的递推关系,建立系统状态空间模型;然后运用滑模控制缩小时钟偏差与时钟漂移;最后结合滑动平均滤波对实验过程中的频率抖动和随机误差进行优化。结果表明,基于滑模控制的时钟同步算法可有效抑制时钟漂移引起的时钟偏差线性增长,将时钟偏差控制在1μs以下,从而实现亚微秒级网络对时。相比传统IEEE1588协议同步方法,所提方法提供了更高的同步精度。  相似文献   
3.
杨旻  李光 《包装工程》2021,42(9):221-229
目的为了解决柑橘在实际包装过程中因于人工手动装袋、装箱等导致的效率低下问题,设计一条全自动柑橘包装生产线。方法基于“不知火”柑橘的特殊体型特征,使用传送带分级装置对其进行分级;通过倾斜皮带解决柑橘排列姿态的整理问题;经给袋式包装机装袋后,采用扭结式扎口装置对其进行封口;利用并联机器人对其进行装箱。通过计算生产节拍,合理规划每个工序的循环时间,并通过Flexsim软件对该生产线进行仿真分析与平衡优化。结果该生产线整体效率由89%提升到93%,能够正常运行且满足生产力的需求。结论该柑橘包装生产线实现了柑橘的分级、整料、装袋、装箱等工序,降低了工作强度,提高了生产效率,实现了包装过程的自动化。  相似文献   
4.
沈燕  李毅  马程  李重阳  万波  胡文兴 《水力发电》2021,(2):97-100,109
新能源项目设备高度自动化并具有分布控制特点,集中管理又需要将分布分散的多个控制系统用统一的时钟进行同步,以达到在事件顺序中相对准确记录动作的先后及时点的目的,一套性能优异的北斗卫星和GPS双冗余时钟源同步时钟系统对实现智能水电厂具有重大意义。从设计、优化和现场安装调试、投入使用等阶段,对深圳抽水蓄能电站同步时钟系统建设进行了论述。  相似文献   
5.
雷达高度计的主要功能是测量全球平均海平面高度(SSH:Sea Surface Height),它通过准确测量收发脉冲之间的时间间隔来实现精准的星地距离测量,时间测量的准确度取决于高度计时钟的准确性。卫星在轨运行期间,雷达高度计时钟频率会产生缓慢漂移,时钟频率漂移会影响星地距离的测量准确度,造成对海面高程的测量偏差。在基于重建型有源定标器对HY-2A卫星高度计时钟偏差在轨测试方法的基础上,提出了从星地斜距函数曲线时间偏移量中提取高度计时钟偏差的估计方法,应用于HY-2B卫星雷达高度计在轨定标测试中,测量了雷达高度计时钟频率漂移量,精度优于0.001 Hz。结果表明:HY-2B高度计原子钟性能稳定,时钟频率偏差造成的测距偏差为毫米量级,平均测距漂移率为2.95×10-7 m/d。  相似文献   
6.
在超高速数字锁相系统中,虽然可以采用时间交替并行模数转换(Analog-to-digital converter, ADC)结构解决采样速率和采样精度的矛盾,但系统极易受各通道采样时钟抖动的影响。在分析采样时钟抖动与采样有效位数及动态范围关系的基础上,设计了一种基于时钟树机制的并联ADC交替采样结构的超高速数字锁相放大系统。实验结果表明,在相同的测试条件下,该系统比国外主流厂商的商用锁相放大器信噪比提高了约17.5 dB。  相似文献   
7.
提出一种无线传感网络同步的方法,结合发送者-接收者同步(SRS)和接收者-接收者同步(RRS)两种方法,使得位于特定区域的传感器节点通过监听一对超级传感器节点交换时钟消息,借助最小二乘法精确估计出时钟偏差以及频率偏差进行补偿,实现节点间同步。该时钟同步方案的设计与其他已提出的同步方案相比,显著降低了整个网络的能量消耗而不引起任何同步精度的损失。  相似文献   
8.
郭玮  王小波  于冬 《微电子学》2018,48(4):448-451, 457
基于65 nm CMOS工艺,提出了一种能将差分时钟信号驱动到传输线上并且能将全摆幅差分时钟信号转换为低摆幅差分时钟信号的驱动电路。该时钟驱动电路改善了传统驱动电路无法补偿传输线的高频衰减且结构复杂的问题。采用Spectre软件对电路进行了仿真验证。仿真结果表明,所有工艺角下,温度在-40 ℃~125 ℃、电压在1.08~1.32 V范围变化时,该时钟驱动电路可将1 GHz工作频率的时钟信号转换为占空比为50%的低摆幅信号,该低摆幅信号在接收端可恢复为所需的轨到轨差分信号。该时钟驱动电路具有较好的高频传输特性。  相似文献   
9.
10.
为了高效地利用Verilog HDL语言中always行为建模语句设计集成电路,采用比较和举例论证的方法,总结出always语句中事件控制敏感信号对设计仿真的影响。always语句中敏感信号分为时钟边沿信号和电平信号,对于敏感信号为时钟边沿信号,仿真结果直观简单;但是对于敏感信号为电平信号,敏感信号必须是所有的输入和判断语句的信号,否则仿真结果不确定。  相似文献   
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