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FPGA最小延时工艺映射理论及算法 总被引:4,自引:0,他引:4
本文以动态规划和网络流理论为基础,提出一种新的求解基于LUT结构的FPGA工艺映射算法,并证明了它能获得最小延时目标电路,算法计算复杂度低. 相似文献
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逻辑电路的分解影响FPGA工艺映射后目标电路的延迟时间,采用何种分解方式也与映射结果密切相关。为快速有效地缩短电路延时,本文从工艺映射的基础理论出发,提出映射驱动的逻辑分解方法。 相似文献
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本文以电容线性延时模型为基础,通过分析逻辑电路在综合及布图阶段的延时计算方式,提出了一种在工艺映射与布局合算法中动态估计电路延时的方法,并给出实验结果。 相似文献
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