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1.
对于动态传输路径,给出了每个结点至少两个缓冲的信息转接网死锁避免问题,所提出的死锁避免算法从缓冲利用的角度看是优化的。同时给出了死锁无关的证明及其条件,这对于并行计算处理问题是有益的。 相似文献
2.
传统的正激变换器需要去磁绕组,从而增加了变压器设计的复杂程度,也增加了调试的调度。去掉去磁绕组的正激变换器也能够正常工作,并具有较好的稳定性,对占空比也没有限制,能满足宽输入电压范围的应用。本文介绍了无去磁绕组单端正激变换器的结构,分析了电路中的工作状态,讨论了电路中的参数影响,并经实验测试,结果显示了这种结构的优点及具有的较好性能。 相似文献
3.
4.
5.
采用数值模拟技术详细地研究了不同掠高的某蒸汽轮机末级叶片前掠正交设计对叶栅总体参数的影响。计算结果表明,在进行正交性设计时,掠高应选在25%相对叶高左右。 相似文献
6.
从实验上探讨了掩蔽和被掩蔽声源在水平面方向分离时的向前掩蔽效应,并与单扬声器重发方式作比较.得到了这2种情况下3种频率的被掩蔽纯音信号(250Hz,1170Hz,4000Hz)的掩蔽闻值随掩蔽窄带噪声5种声压级(30dB,40dB,50dB,60dB,70dB)变化的曲线。实验结果表明:声源空间分离时,除了个别情况外,掩蔽阈值都比单扬声器重发时有较大幅度的降低。文中进一步指出掩蔽阈值的降低是较优耳效应和双耳效应等的综合作用造成的。因此掩蔽声和被掩蔽声在空间上的分离会削弱向前时域掩蔽的作用,这一结论可为将来改进音频压缩算法提供理论基础。 相似文献
7.
基于ICE1CSO2设计了一种PFC+PWM电路。采用前级为PFC电路,后级为双管正激拓扑电路的方式。通过仿真分析电路的基本原理,以500 W电路为例对PWM部分主变压器进行了详细的设计,并通过实际电路验证此电路具有功率因数高、稳定、高效等优点。 相似文献
8.
In this paper, we study scheduling schemes for two‐user two‐way wireless relaying systems. Two transmission modes are considered: point‐to‐point direct transmission and two‐way amplify‐and‐forward relaying. An optimal scheduling scheme that opportunistically selects the best transmission mode for each user is proposed to minimize the sum bit error rate (BER). The performance lower bound of the optimal scheduling scheme is analyzed, and closed‐form expression of the lower‐bound BER is derived. However, for optimal scheduling, the scheduler requires the knowledge of channel state information (CSI) of all links. To reduce the feedback information of CSI, we also propose a suboptimal scheduling scheme that selects the transmission mode using only the CSI of two direct links. Simulation results show that there are 4 dB to 8 dB gains for the proposed optimal and suboptimal schemes over the fixed direct transmission and fixed two‐way relayed transmission scheme. The performance gap between the optimal and suboptimal scheduling schemes is small, which implies a good trade‐off between implementation complexity and system performance. 相似文献
9.
探讨在短波数字通信网络中的自适应差错控制系统,对第二代ALE(2^ndALE)和第三代ALE(3^rdALE)系统中的差错控制系统进行计算机仿真,并分析它们在相同通信条件下性能的优劣。 相似文献
10.
设计了一个可重用、可升级的基四流水线结构Viterbi译码器.设计中采用了基四流水、前向追踪、同址写回和分块管理技术,并利用处理单元(PE: Process Element)互联技术,对译码器的结构进行了抽象和参数化处理,使卷积码生成多项式、PE个数和回溯深度等可根据实际需要重新配置.在TSMC 0.18 μm CMOS 工艺下, 成功地实现了带删除的64状态(4,1,6) Viterbi 译码器,电路规模仅3万门,译码速率可达12.5 Mbps,功耗为15 mW;在ST 0.13 μm CMOS工艺下,也获得了同样的性能,功耗仅为4.7 mW.该Viterbi译码器已被应用于DAB接收机芯片中. 相似文献