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1.
在扩频通信中,PN码的同步一直是研究的重点和难点.同步包括两部分:捕获和跟踪.捕获是实现同步的第一步,为了适应不同的环境,人们研究出了许多捕获的方法,其中,滑动相关捕获法是一种最简单、最实用的方法.针对该方法捕获时间较长的不足,提出了增加一个相位搜索控制器的方法来改进PN码捕获电路.在完全不影响其优点的情况下,缩短了捕获时间,使其捕获时间变为了原来的3/4,在工程中有重要的应用价值.  相似文献   
2.
Non-contact atomic force microscopy(nc-AFM) atomic-scale imaging process of monocrystalline silicon surface using capped single-wall carbon nanotube tip is simulated by molecular dynamic method. The simulation results show that the nc-AFM imaging force mainly comes from the C-Si and C-C chemical covalent bonding forces, especially the former, the nonbonding Van der Waals force change is small during the range of stable imaging height. When the tip-surface distance is smaller than the stable imaging height, several neighboring carbon atoms at the tip apex are attracted, and some of them jump onto the sample surface. Finally the tip apex configuration is destroyed with the tip indenting further.  相似文献   
3.
讨论衬底偏置MOS管的工作原理,对其低压特性进行了分析和仿真.并基于CMOS衬底偏置技术,设计了两级CMOS运算放大器.在0.6μm CMOS工艺条件下,电路的各项性能指标采用Smart Spice进行模拟验证.模拟结果表明在在1.0V的低电源电压下,失调电压为457.4μV,开环差模电压增益约为68dB,单位增益带宽为2.3MHz,相位裕量为67.4°,且其功耗仅有35μW,仿真结果显示了衬底偏置技术用于超低压模拟电路设计的优势.  相似文献   
4.
CMOS光接收机主放大器设计   总被引:1,自引:0,他引:1  
利用CMOS工艺设计一种用于SDH STM 4速率级(622 Mb/s)光纤用户网的光接收机放大电路。此电路由输入/输出缓冲、主放大单元、偏置补偿电路4部分组成。通过直接耦合技术提高增益,降低功耗;利用有源电感负载提高系统带宽。采用商用SmartSpice电路仿真软件和CSMC HJ 0.6μm工艺参数对该电路进行仿真。结果表明,该电路在5 V工作电压下中频增益为81 dB,3 dB带宽为470 MHz。  相似文献   
5.
采用CSMC-HJ 0.6 μm CMOS工艺设计,可用于光纤通信系统中工作速率为622 Mb/s的1∶4分接器.分析和设计了分接器的系统结构和单元电路,采用SmartSpice进行了仿真.整个电路采用5 V单电源供电,功耗为1.1 W.测试工作速率和各项技术指标达到相应标准.  相似文献   
6.
"信号与系统"课程教学改革的尝试与思考   总被引:10,自引:2,他引:8  
随着高校招生规模的扩大和新校区的建立,大班授课和新区教学所产生的问题日渐突出,尤其是师生交流问题.本文介绍了信号与系统课程教学的改革活动,包括增加少量学时的小班课、加强习题课讲授和实践环节的教学等.文中还阐述了对相关问题的思考.  相似文献   
7.
在软土地基上建造建筑物,须综合考虑工程地质条件、建筑物的功能要求、结构类型以及施工条件,并确定科学安全、经济适用的地基处理、建筑没计、结构设计以及施工方案,以避免因地基变形特别是不均匀沉降导致建筑物的破坏。 1 工程地质及地基处理方面  相似文献   
8.
窦建华  潘敏  郭铭铭 《现代电子技术》2007,30(1):182-183,186
电路仿真软件的发展提高了电路设计的能力,缩短了设计周期。SmartSpice是Silvaco公司开发的一款多用途的电路仿真软件,他可以在Unix和Windows两种操作系统下工作,还具有多种输入形式和输出形式。介绍了SmartSpice的主要特点及其强大的功能,并以实际电路为例,用SmartSpice进行分析,来说明他在电路分析中的应用。  相似文献   
9.
采用0.18μm CMOS工艺设计了一款6.25 GHz锁相环倍频器,该倍频器适用于12.5 Gbit/s半速率复接的串行器/解串器(SerDes)发射系统。该锁相环倍频器不仅为SerDes发射系统提供6.25 GHz的时钟,也为系统提供1.25 GHz占空比1∶4的时钟。设计中鉴频鉴相器采用真单相时钟(TSPC)触发器,电荷泵采用电流舵结构,压控振荡器采用三级双延时环路结构,20分频器中的高速五分频采用源极耦合场效应晶体管逻辑(SCFL)触发器、低速四分频采用TSPC触发器。电路芯片面积为0.492 mm×0.668 mm。测试结果显示,锁相环的锁定范围为4.78~6.6 GHz,在1.8 V电源电压下核心电路的功耗为67.5 mW。当锁相环工作在6.25 GHz时,10 MHz频偏处相位噪声为-98.5 dBc/Hz,峰峰抖动为15 ps,均方根(RMS)抖动为3.5 ps。  相似文献   
10.
吕泉  周林  窦建华 《长江建设》2012,(7):220-221
近年来,随着我国经济的发展,各类公路工程也不断的涌现。其中桥梁工程占了越来越大的比例,在公路工程中有着越来越高的地位,这就对桥梁工程的安全性和耐久性提出了更高的要求,桥梁设计是决定桥梁工程安全性和耐久性的关键因素,对桥梁设计的研究具有重要的现实意义。  相似文献   
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