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1.
讨论了如何选择适当的规则,如何建立简洁实用的规则库,如何应用规则库.提出了四种主要的光学邻近矫正规则,在实验结果中列举了规则库中的部分数据.利用规则矫正后的版图光刻得到的硅片图形有了明显的改善.规则库的自动建立部分 (OPCL)是基于规则的光学邻近矫正系统的重要组成部分.  相似文献   
2.
本文中,针对规则的VLSI设计模式(门阵列,标准单元等),我们提出一种新的非常简单有效的布局算法.该算法基于严格的数学分析,可以证明能够找到全局最优解.在实验中发现,对于很大规模的电路,我们的算法比现有的所有算法都快.此外,我们的算法还能够同时适应于线长优化和时延优化模式.  相似文献   
3.
提出了一种基于二次布局的结合MFFC结群和hMETIS划分的算法.实验表明:这种方法能得到很好的布局结果,但是运行消耗的时间比较长.为了缩短划分在二次布局中运行的时间,提出了一种改进的结群算法IMFFC,用它在二次布局中做划分.与前者相比较,这种方法虽然布局质量稍差,但速度更快.  相似文献   
4.
提出了一种有效的Data-Path布局算法DPP,该算法基于一个新的"不规则度"概念来评价电路单元之间连接关系的规则性信息,并根据这些规则性信息提取规则化的单元形成规则矩阵;然后算法把规则矩阵转化为二次布局的约束条件进行最终的布局.与Cadence公司布图工具SE的对比实验表明,DPP是一种有效地针对Data-Path子电路的布局算法,它在时延平衡方面可以得到非常满意的结果.  相似文献   
5.
本文提出了一个新的通孔最少化层分配的图模型.该模型克服了传统层分配算法对通孔度数和位置的限制,允许通孔自由地以任意度数和任何需要的位置出现.模型中还提出了通孔秩的概念,它比较能更精确地反映通孔的本质.在此基础上,本文将通孔最少化问题转化为图的最大割问题,并提出了一种启发式算法去求解图的最大割.算法已用C语言在SUN工作站上实现.实验结果表明,算法十分有效且稳定.  相似文献   
6.
多孔平面的快速边界元划分   总被引:2,自引:2,他引:0  
在 3D VL SI互连寄生电容的边界元素法计算中 ,多孔平面的边界元划分是十分困难的问题 .文中提出一种快速划分多孔平面边界元的方法 ,它可高效处理非正交几何边界形状 ,形成规则的梯形元 .与全局扫描线法相比 ,有较高的划分速度、计算速度与精度  相似文献   
7.
应用层次式Z缓冲区可视性算法的思想,实现了一种互连寄生电容器中屏蔽导体的快速判断算法,能准确地确定对电容值影响较小的导体,并加以消除,当用边界元法提取甚多环境导体对关键路径产生的寄生电容时,可在满足计算精度的条件下,显著地提高计算速度。  相似文献   
8.
FaSa: A fast and stable quadratic placement algorithm   总被引:4,自引:0,他引:4       下载免费PDF全文
Placement is a critical step in VLSI design because it dominates overall speed and quality of design flow.In this paper,a new fast and stable placement algorithm called FaSa is proposed.It uses quadratic programming model and Lagrange multiplier method to solve placement problems.And an incremental LU factorization method is used to solve equations for speeding up.The experimental results show that FaSa is very stable,much faster than previous algorithms and its total wire length is comparable with other algorithms.  相似文献   
9.
深亚微米时代芯片互连对芯片性能的影响加剧,对物理设计方法、工具与算法的集成提出了新的要求,在对XML技术进行分析的基础上,提出基于可扩展物理设计数据标记语言的集成方法.借助结构化和面向对象分析技术,对物理设计阶段的信息进行整理分析,设计了一种易于扩展的基于对象的结构化数据模型和物理设计数据可扩展标记语言PhyD—XML,并给出语言的实现结构和集成构架.  相似文献   
10.
本文对现有的总体布线方法及宏单元阵列总体布线问题进行了详细分析,提出了一种基于带权动态调整思想的适合于宏单元阵列一层半和双层版图模式的总体布线算法,其目标是合理地利用已确定的布线区域,使各线网均匀地分布在芯片上,获得尽可能高的布通率。  相似文献   
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