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1.
基于VxWorks数字化火炮显控系统的研究与实现   总被引:1,自引:0,他引:1  
分析了数字化火炮显控系统与VxWorks操作系统的特点,研究了基于VxWorks实现X-Window窗口图像显示的关键技术和多任务通信机制.应用结果表明该数字化火炮显控系统人机界面友好、可靠性高、实时性强,能够满足野战防空武器系统的基本要求.  相似文献
2.
本文针对拉深筋对板材后续成形影响的研究尚十分欠缺的现象.研制了无摩擦拉深筋模拟实验装置、开发了基于虚拟仪器软件LabVIEW的实验测试平台.对板材通过拉深筋的过程进行了实验研究,分析了板材经过常规拉深筋和无摩擦拉深筋条件下各力能参数的变化规律,利用无摩擦拉深筋实验装置研究了摩擦阻力在拉深筋中的作用,实验表明摩擦阻力占拉深筋总阻力的比例约为40%左右.同时分析了减薄量与拉深筋结构的关系,为拉深筋的设计和调整提供了理论依据.  相似文献
3.
设计了一种雷达环境模拟器高性价比双波段宽带快速跳频模块。采用DDS+倍频链技术,实现了输出射频信号在C、X波段的频率跳变。其频带较宽,跳频时间小于5μs,输出杂散抑制优于-50dBc,相位噪声优于-70 dBc/Hz@10 kHz,频率分辨率小于10 Hz,输出功率可控。该系统体积小、成本低,易于生产实现,可广泛应用于部队雷达的抗干扰训练和检测。  相似文献
4.
频率源是现代雷达电子系统的重要组成部分,是整个雷达的心脏。直接数字频率合成器(DDS)具有频率转换快、频率分辨率高、输出频率相对带宽较宽、产生波形灵活、相位连续及体积小等优点,缺点是工作频率有限,杂散较高。分析在理想条件下DDS输出信号的频谱,在此基础上,分析并仿真影响DDS杂散噪声的原因,提出几种有效地抑制DDS杂散的办法,对改进DDS电路的杂散有很大的促进作用。  相似文献
5.
为使雷达回波模拟系统能够逼真地模拟真实作战环境,有效地对雷达各分系统进行测试,提出了雷达状态参数采集电路的设计方案,并给出了其软硬件实现;该方案以FPGA为核心,解决了不同状态参数的实时性采集问题,并通过制定串行传输协议,避免了数据传输过程中的冲突,保证了各状态参数传输的准确性,输出接口采用LVDS标准接口,确保了各状态参数的高速长距离传输;实验结果表明,该系统工作稳定,能够准确、实时地采集并传输雷达状态参数,且便于与其他数字电路的集成,满足系统设计的要求。  相似文献
6.
针对雷达回波模拟系统的需要,选取具有数字接口、高度集成的DDS电路,实现了200MHz~250 MHz带宽内输出频率数控可变,系统跳频速度高于200 000跳/秒,频率分辨率小于3Hz,输出信号杂散优于70dBc,数据传输速率快,体积约50mm×80mm×30mm;给出了跳频源硬件电路和软件程序的具体设计方法,经过实际测试,验证了该电路便于数字控制,体积小、成本低,输出信号实现了低杂散、快跳变、误差小、频率分辨率高,系统整体性能优异。  相似文献
7.
首先介绍了嵌入式逻辑分析仪SignalTapⅡ的基本原理和操作流程,并结合实例详细说明了SignalTapⅡ在系统调试过程中的应用。使用SignalTapⅡ对系统进行调试,解决了器件管脚不够或不方便外挂测试工具等软硬件调试的困难,避开了电路板测试时连接器引起的信号完整性问题。实验结果表明,该方法大大减少了系统调试、验证时间,缩短了设计周期,提高了系统设计的灵活性。  相似文献
8.
提出了一种采用CycloneⅡ系列FPGA芯片及德州仪器公司的高速模数转换芯片ADS7852的反正切算法轴角编码器设计方案,并给出了其软硬件结构及其具体实现;方案解决了基于FPGA的A/D转换峰值采样控制、反正切求角计算的不连续性、FPGA内部资源的优化等问题,使基于反正切算法的轴角编码器可以以纯硬件的形式存在,便于实现与其它电路集成;该电路已成功应用于某型火控雷达轴角数据的采集和转换系统中,测试结果表明,系统具有工作稳定、轴角转换速率快,便于与其他数字电路集成等特点。  相似文献
9.
逆合成孔径雷达(Inverse syn thetic aperture radar, ISAR)使用距离多普勒算法成像时,当目标尺寸较大或转角过大 ,会发生越距离单元徙动(Migration through resolution cells, MTRC)现象,严重影 响 目标成像效果。基于双基地ISAR转台模型,针对成像的MTRC问题,对解线频调后的目标回波 进行研究,分析了机动目标MTRC的产生机理,并将匹配傅里叶变换(Match Fourier trans f orm, MFT)应用到MTRC的校正中,消除了快时间频率与慢时间的耦合项,有效解决了MTRC引 起的ISAR图像散焦问题。仿真结果表明,基于MFT的双基地ISAR MTRC校正算法能够有效校正 机动目标的距离徙动,提高ISAR成像质量。  相似文献
10.
提出了以CycloneⅡ系列FPGA芯片EP2C5T144为核心,基于低压差分信号(LVDS)接口技术的高速数据长线传输系统的设计方案,该方案利用FPGA实现数据的串/并、并/串转换以及LVDS信号的驱动和接收,解决了不同接口标准的电平转换、阻抗匹配以及信号长线传输过程中的衰减与恢复等问题,具有设计简单、抗干扰能力强、体积小、成本低、集成度高等优点。通过实验表明,该系统工作稳定,实现了串行数据在100 m非屏蔽双绞线上以50 Mb/s的速率传输,并且具有良好的传输效果,完全满足系统设计要求。  相似文献
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