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1.
通过研究密码系统的特点,提出一种面向对称密码领域的可重构阵列结构.该阵列普遍适用于分组密码和流密码系统,灵活性高.通过配置信息的更新,可以快速动态切换加密功能,切换时间小于20 ns.该结构包含几个16×16的比特阵列和8×8的字节阵列,AES算法实现分组密码的加密速率为640 Mb/s~2.56 Gb/s,DES算法为1.6 Gb/s~3.2 Gb/s,SMS4算法为318 Mb/s~1.6 Gb/s,流密码Geffe的加密速率为400 Mb/s.与文献[1]~[3]相比,SMS4算法的性能有接近2倍的提升.  相似文献   
2.
为了解决算法程序自动映射到可重构媒体处理器的问题,有效提高程序并行执行的效率,提出一种具有自动并行化的任务编译前端. 该任务编译前端通过展开核心循环可提高并行执行度,在数据依赖分析确保运算正确执行的基础上,对循环体内的数组访问进行标量替换,以优化数据传输开销. 实验结果表明,该任务编译前端能有效提高代码并行性和优化数据传输能力,与Garp C编译器的编译前端相比,该任务编译前端设计的性能可提升约2~4倍.  相似文献   
3.
针对SoC芯片设计中的系统划分问题,提出一种面向应用的系统结构自动划分方法--基于模板的系统划分方法,并开发了系统划分工具--TBPS.基于模板的系统划分方法通过提取应用描述中的相似结构,并使用相似结构划分系统,最终得到一个尽量复用的系统结构.系统的相似结构划分采用遗传算法实现最优覆盖的搜索,并使用贪婪算法实现资源配置和任务调度.与已有的在系统划分中事先设定目标结构方法不同,文中方法可以根据应用的特点自动生成划分的结构.采用该方法及TBPS实现了应用描述到系统结构的自动划分.实验结果表明了TBPS对数据处理为主的应用划分的有效性.  相似文献   
4.
为挖掘可重构处理器的内在并行性,需要编译器通过分析程序的并行性来决定可重构处理器硬件最好的执行模式。为此,提出一种基于可重构处理器的并行优化算法。将有向无环图的并行计算部分映射到可重构处理器上,对任务实现3个不同层次的并行性(指令级并行、循环级并行、线程级并行)。测试结果表明,该算法使得可重构处理器在处理任务时比未用并行优化算法的性能提升1.2倍左右。  相似文献   
5.
CABAC(Context-based Adaptive Binary Arithmetic coding)是H.264中所采用的一种高效熵编码,压缩率高,但结构复杂,硬件实现难度大。本文在P.Zhang 2008年的工作[1]基础上提出一种单周期CABAC解码引擎的优化实现方法,通过查表替换、分支预测、逻辑调整、反相器优化等关键路径优化方法和寄存器精简等面积优化方法进一步提高了解码性能。经过芯片验证,CABAC解码引擎性能提高到250Mbps,面积减少46%,峰值工作情形下功耗1.03mW,满足下一代视频编解码协议(QFHD)的需求。  相似文献   
6.
可重构计算处理器技术   总被引:1,自引:0,他引:1  
本文首先分别分析了基于指令流驱动和基于数据流驱动的传统计算技术所面临的问题,并介绍了可重构计算处理器的发展趋势;接着,讨论了可重构计算处理器的硬件架构和编译技术,重点分析了其在软硬件架构及系统应用上所面临的挑战;然后,介绍了所设计的REMUS(REconfigurable MUltimedia System)可重构计算媒体处理器及其相应的集成开发工具;最后,展望了面向通用计算的可重构技术的发展前景.  相似文献   
7.
李楠  刘雷波  龚文化  孔得力 《包装工程》2023,44(23):307-314
目的 针对复合材料结构包装箱进行轻量化设计,使其在内压及堆码工况下,结构强度能够满足使用要求。方法 针对局部非主承力位置进行改进,利用ABAQUS软件对包装箱的内压和堆码工况进行数值仿真分析,其中载荷工况安全系数均为1.5。结果 包装箱理论质量减少了64 kg,减少比例约为5.4%。最大载荷应力为344MPa,变形量为4.69mm,均满足使用要求。结论 包装箱结构轻量化后,在内压工况下各结构应力水平均有小幅上升,在堆码工况下各结构应力水平无明显变化,综上均处于安全范围,不会导致结构破坏。优化后的产品,实现了轻量化效果,理论证明结构改进安全可靠。可为国内类似复合材料包装箱轻量化结构改进提供数据支撑。  相似文献   
8.
基于循环映射的可重构处理器设计   总被引:2,自引:1,他引:1  
提出了一种适合循环任务执行的可重构处理器. 该处理器通过循环控制器实现循环的自动执行,并采用数据分发技术和不对称先进先出缓存(FIFO)技术,将可重构阵列内部数据传输效率提高8倍. 在现场可编程门阵列(FPGA)系统上验证了活动图像专家组 4的高等视频编码(H.264)中整数反离散余弦变换(IDCT)、运动估计及活动图像专家组 2(MPEG 2)中的IDCT等多种媒体核心算法. 相比于类似的结构,该可重构处理器在不增加阵列规模的情况下,性能平均提升35倍.  相似文献   
9.
新型智能存储SoC中NAND Flash控制器的软/硬件设计   总被引:1,自引:0,他引:1  
介绍了新一代智能存储片上系统SSC,详细讨论了SSC中NAND Flash子系统的软/硬件设计;采用基于模板的划分方法,实现NAND读写控制器的软/硬件划分.SSC已生产并通过工业测试.结果表明,采用软/硬件划分的方法,NAND控制器的面积比纯硬件的实现方法减小58%,性能仅下降16%;比单纯ARM软件实现,速度平均提高20倍,同时具有软件的高灵活性.  相似文献   
10.
在采用JPEG2000算法的图像压缩芯片结构研究中,我们发现编码(EBCOT)部分的计算结构是相当复杂的。其中率失真计算结构是否合理,直接关系到编码算法的效率。本文着重阐述了完成率失真浮点计算所必需的硬件结构;提出了新型的专用于率失真计算的除法算法及其结构;在保证计算精度和速度的前提下,最大限度地降低了计算结构的复杂度。本论文提出的计算结构已通过RTL级源代码和综合布线后门级仿真,并经过Xilinx FPGA测试线路板上运行验证。为确保JEPG2000图像编码芯片的最终成功流片解决了一个关键问题。  相似文献   
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