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或符合全展开式的分解转换算法 总被引:1,自引:0,他引:1
针对现有算法在处理多变量实际电路时间开销较大的问题,提出或符合全展开式的分解转换算法.cj最大项展开式和dj最大项展开式在相同极性下两者之间存在转换矩阵,而矩阵运算复杂度较高,把矩阵的运算简化成与和非的位运算,从而大量地节省了运算时间;在此基础上,将cj最大项展开式分解到不同的分组中,提出了分解算法,避免了矩阵的重复计算,再次缩短了计算时间.为了避免cj最大项展开式中过多最大项而造成转化时间开销增加,还提出了基于cj最小项的分解算法.实验结果表明,包含算法适用于处理小变量,但在处理多变量时时间开销增大,而采用了分解算法后,可极大减少转换时间开销. 相似文献
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针对可重构系统中的数据流驱动应用,提出支持动态可重构的软/硬件统一多线程编程模型SHUMDR及其层次化实现.通过硬件线程接口设计、操作系统内核扩展,便于设计人员以统一的线程视图描述应用的软硬件划分.以数据加密/解密为例进行测试的结果表明,统一线程抽象带来的时间开销和空间资源占用率较小,该模型在探索编程灵活性的同时,能够有效地兼顾硬件的效率. 相似文献
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当前SOC(System-On-Chip)设计中IP重用面临很多难题:可重用IP的表述及如何提高IP的可重用性等。针对上述的问题,给出一种基于XML描述的IP库设计和实现方法。分析了RTL级IP(Intellectual Property)和IP库的特点,提出了基于XML可配置IP库的层次结构,给出了基于XMLIP库的形式化描述。结合一个软处理器核(OpenRISC嵌入式处理器)给出了基于XMLIP库的框架及实例,总结了基于XML可配置IP库的特点,介绍了基于XMLIP库在实验室项目中的应用:一个基于CSCWD(计算机协同工作设计)的SOC开发设计平台。 相似文献
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面向SOPC的异构IP快速集成 总被引:1,自引:0,他引:1
设计并实现了一个片上可编程系统(SOPC)设计工具ESIGE,它通过开放式的结构对不同来源的异构软核IP进行封装,对SOPC设计人员屏蔽了IP的复杂性.不同实现方式和不同总线接口的IP可以混合使用.ESIGE通过层次化的集成和灵活的IP互连方式支持复杂的IP互连结构,利用虚拟设计和自动化的IP集成显著地降低了SOPC设计的工作量. 相似文献
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概要介绍NIOS Ⅱ处理器,详述NIOS Ⅱ处理器中定制指令的硬件实现和软件接口。并结合实例说明在进行SOPC设计时,可以把强实时软件算法或费时的软件计算作为定制指令,加入到NIOS Ⅱ处理器指令集中,提高系统性能。 相似文献
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概要介绍NIOS II处理器,详述NIOS II处理器中定制指令的硬件实现和软件接口.并结合实例说明在进行SOPC设计时,可以把强实时软件算法或费时的软件计算作为定制指令,加入到NIOS II处理器指令集中,提高系统性能. 相似文献