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1.
针对高速率OTDM(光时分复用)系统中的一些关键技术问题,如时钟提取、时分解复用和色散补偿等,提出了8×40Gbit/s的OTDM系统技术方案。结果表明,通过选择合适的时钟提取方式和基于对称性色散位移光纤的色散补偿技术,能够实现在一个时隙内对每个信道的40 Gbit/s归零码信号的解复用,且解复用后的信号质量较好。该系统实现了320Gbit/s OTDM通信。  相似文献   
2.
针对频率选择性衰落环境下结合正交频分复用技术的放大转发多中继协同通信系统,提出了基于导频时分复用的频域信道估计算法,包括最小二乘(LS)估计算法和低阶近似的线性最小均方误差(Lr-LMMSE)估计算法.理论分析和仿真结果表明,该算法不仅能成功分辨多中继协同通信系统的所有频域信道衰落系数,避免各中继节点转发的导频符号在目...  相似文献   
3.
随着新型电信业务网络的发展,电信网络的核心正在由TDM(时分复用)向IP转变,电信网呈现出扁平化、IP化、宽带化和移动化网络融合的发展方向。  相似文献   
4.
在160 Gb/s 100 km光时分复用(OTDM)通信系统中,色散是影响系统性能的主要因素。为减小由此带来的信号波形的失真,进行了理论分析与研究,并做了相应的实验加以验证。传输链路采用混合补偿方式,精确补偿色散与色散斜率,优化传输链路色散图谱及各点工作功率,有效抑制非线性效应,实现高精度色散管理,提升系统的整体性能。使用500 GHz高速示波器,调整传输链路光纤的长度精确到10 m,并准确观测各环节实验结果。系统既没有使用前向纠错技术,也没有进行偏振模色散(PMD)补偿,仅仅通过高精度色散管理实现了160 Gb/s光时分复用信号100.25 km稳定无误码(误码率小于10-12)传输。  相似文献   
5.
提出一种在光纤水听器时分复用系统中以3×3耦合器作为匹配干涉仪的光强补偿方案,光纤水听器仍为2×2耦合器结构。该方案以时分复用中的非干涉脉冲作参考光强,通过对3×3耦合器两路输出进行简单数学运算并结合数字反正切技术实现信号解调,光强波动和耦合器分光比变化导致的信号畸变得到有效抑制。算法不需要载波调制,可实现光纤水听器近似等臂干涉,有利于降低系统相位噪声。算法的运算量小且适用于一般的非对称3×3耦合器,解调动态范围大。利用该方案实现了8路光纤水听器时分复用实验系统,在光功率变化约10%时,光强补偿方法可将总谐波失真平均值降低30dB,系统噪声本底在信号频率为1kHz时小于30μrad/Hz1/2。  相似文献   
6.
在结构的振动主动控制中,采用自感知执行器能减小结构的质量和体积,真正实现同位控制。设计了一种基于时分复用解耦系统的压电自感知执行器,使压电元件在传感时隙内作为测量振动的传感器,在执行时隙内作为控制振动的执行器,在放电时隙内释放积累的驱动电荷。设计了开关时序脉冲用于控制3个时隙的切换。基于LabVIEW软件平台,采用正位置反馈控制算法,将时分复用结构的压电自感知执行器用于悬臂梁1阶模态的振动主动控制,实验结果表明达到了良好的控制效果。  相似文献   
7.
为实现对装药过程中实时温度的检测,设计了一套C8051F340单片机与时分复用技术进行数据采集和通信的多通道温度采集系统。实验验证了CPLD在进行分时控制时具有计时准确,门选电路设计方便,集成度高的优点,同时结合Silicon Laboratories公司提供的USBXpress开发工具使得单片机与计算机的USB通信实现变得极为简便。  相似文献   
8.
为了充分利用光信号的宽带宽资源和提高信道利用率,完成线速率为2.5 Gb/s的多路信号高速传输,在FPGA上设计并实现了一种时分复用通信系统,并对其功能和性能进行了测试与验证。为了克服普通FPGA传输速率低于1 Gb/s的性能缺陷,选用了Xilinx内嵌了支持3.75 Gb/s最高传输速率的吉比特收发器的高速FPGA。最终测试结果表明,在短距离有线传输条件下,该系统成功实现了线速率为2.5 Gb/s的无误码的时分复用通信。  相似文献   
9.
认为当采用低频段的射频资源时,色散导致的双边带功率衰落对正交频分复用无源光网络(OFDM-PON)的影响很小。基于时分复用(TDM)架构的OFDMPON,充分利用正交频分复用(OFDM)技术的优势与TDM架构的无色性,与现有的以太网无源光网络(EPON)、千兆比无源光网络(GPON)兼容性高,是解决上行无色性传输的最优方案。基于OFDM的时波分复用无源光网络(TWDM-PON)充分利用了OFDM调制优势,用来提升单载波容量,在不改变TWDM-PON系统结构情况下,实现100 Gbit/s的高速接入,是未来无源光网络的重要候选方案。  相似文献   
10.
提出了一种基于中频回放的跟踪通道设计方案.该方案采用两块单口RAM,对中频数据流进行乒乓操作,同时采用可测试性设计(Design For Test,DFT)中扫描逻辑技术,将跟踪通道的寄存器信息扫描存储至本地SRAM,以实现对卫星信号的连续跟踪,达到跟踪通道时分复用的效果.该方案以增加少量SRAM和提高跟踪通道工作时钟频率为代价,大大减少了跟踪通道逻辑资源.该方案在基于ARM+FPGA的硬件平台上验证通过,并在65nm的CMOS工艺下综合,电路规模约合23万逻辑门,相对于传统并行跟踪通道,电路规模减少约44%.  相似文献   
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