| 基于VHDL的有限状态机描述及综合 |
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| 引用本文： | 孔健,杨洪斌,吴悦,唐毅. 基于VHDL的有限状态机描述及综合[J]. 计算机工程, 2003, 29(15): 82-83,143 |
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| 作者姓名： | 孔健 杨洪斌 吴悦 唐毅 |
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| 作者单位： | 上海大学计算机学院,上海,200072;上海大学计算机学院,上海,200072;上海大学计算机学院,上海,200072;上海大学计算机学院,上海,200072 |
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| 基金项目： | 上海市教委基金项目（教委2001第66号01A05） |
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| 摘 要： | 介绍了使用VHDL描述有限状态机的方法,重点分析了综合过程中的难点并提供了解决方法。最后以乘法电路为例实现了可综合的FSM描述并通过门级仿真验证正确性。
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| 关 键 词： | VHDL 有限状态机 综合 乘法电路 |
| 文章编号： | 1000-3428(2003)15-0082-02 |
Description and Synthesis of Finite State Machine Based on VHDL |
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| KONG Jian,YANG Hongbin,WU Yue,TANG Yi. Description and Synthesis of Finite State Machine Based on VHDL[J]. Computer Engineering, 2003, 29(15): 82-83,143 |
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| Authors: | KONG Jian YANG Hongbin WU Yue TANG Yi |
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| Abstract: | The approach of description of finite state machine with VHDL is presented. This paper analyses the emphasises in the process of synthesis and provides the solutions. At last, it implements a synthetical multiplication circuit with VHDL and method presented, the function of it is proved correctly through logic simulation. |
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| Keywords: | VHDL FSM Synthesis Multiplication circuit |
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