| 基于Verilog语言的数字交叉连接矩阵设计 |
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| 引用本文： | 华熹曦,赵雷,许新新,王琳,李惠军. 基于Verilog语言的数字交叉连接矩阵设计[J]. 计算机工程与应用, 2007, 43(4): 82-84 |
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| 作者姓名： | 华熹曦 赵雷 许新新 王琳 李惠军 |
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| 作者单位： | 山东大学,孟堯微电子研发中心,济南,250100;山东大学,孟堯微电子研发中心,济南,250100;山东大学,孟堯微电子研发中心,济南,250100;山东大学,孟堯微电子研发中心,济南,250100;山东大学,孟堯微电子研发中心,济南,250100 |
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| 摘 要： | 本文通过改进传统数字交叉连接矩阵的单元结构，详细介绍了基于Verilog语言的SDXC矩阵设计的一种新方法。此矩阵可实现2条STM-1输入信号中任意等级支路之间的无阻塞时隙交换。文章着重阐述了交叉连接矩阵实时、自适应交换功能的原理及实现方法，并给出了系统的功能仿真波形图。
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| 关 键 词： | Verilog语言 数字交叉连接 同步数字体系 现场可编程门阵列 |
| 文章编号： | 1002-8331（2007）04-0082-03 |
| 收稿时间： | 2006-01-06 |
| 修稿时间： | 2006-05-01 |
Design and simulation of digital cross-connect matrix with verilog HDL |
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| HUA Xi-xi,ZHAO Lei,XU Xin-xin,WANG Lin,LI Hui-jun. Design and simulation of digital cross-connect matrix with verilog HDL[J]. Computer Engineering and Applications, 2007, 43(4): 82-84 |
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| Authors: | HUA Xi-xi ZHAO Lei XU Xin-xin WANG Lin LI Hui-jun |
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| Affiliation: | HUA Xi-xi,ZHAO Lei,XU Xin-xin,WANG Lin,LI Hui-jun,(Mengrao Mieroelectronics Research and Development Center of Shandong University,Ji＇nan 250100,China) |
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| Abstract: | The paper realizes the design of SDXC matrix with Verilog HDL based on a improved unit architecture.The SDXC matrix can implement non-blocking cross-connect of any grade STM-1 input signal.This paper emphasizes the principle and implementation of its real-time,adaptive function.At the end of the article,we can see the SDXC system simulation figures. |
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| Keywords: | Verilog HDL SDXC SDH FPGA |
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