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一种14位125MHz采样/保持电路的设计
引用本文:雷郎成.一种14位125MHz采样/保持电路的设计[J].微电子学,2011,41(4).
作者姓名:雷郎成
作者单位:中国电子科技集团公司第二十四研究所,重庆,400060
摘    要:设计了一种高性能采样/保持(S/H)电路,采用全差分电容翻转型的主体结构,有效减小了噪声和功耗.在电路设计中,采用栅压自举开关,极大地减小了非线性失真,同时,有效地抑制了输入信号的直流偏移.采样/保持放大器电路采用折叠共源共栅结构,由于深亚微米工艺中器件本征增益减小,S/H电路为达到更高增益,采用增益提升技术.设计的采样/保持电路采用0.18μm1P5M工艺实现,在1.8V电源电压、125 MHz采样速率下,输出差动摆幅达到2 V(VP-P),输入信号到奈奎斯特频率时仍能达到98 dB以上的无杂散动态范围(SFDR),其性能满足14位精度、125MHz转换速率的流水线ADC要求.

关 键 词:采样/保持电路  自举开关  增益提升

Design of a 14-Bit 125-MHz Sample/Hold Circuit
LEILangcheng.Design of a 14-Bit 125-MHz Sample/Hold Circuit[J].Microelectronics,2011,41(4).
Authors:LEILangcheng
Abstract:
Keywords:
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