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基于CPLD的高性能脉冲信号发生器的设计
引用本文:王文理,商志新.基于CPLD的高性能脉冲信号发生器的设计[J].国外电子元器件,2007(9):65-68.
作者姓名:王文理  商志新
作者单位:河北大学,电子信息工程学院,河北,保定,071002
摘    要:提出了基于复杂可编程逻辑器件(Complex Programmable Logic Device,CPLD)16位的全数字脉冲信号发生器的设计,可产生周期、占空比均可调的高稳定性脉冲.此设计方法可用于DDS函数信号发生器中脉冲信号的产生,采用单片机控制CPLD工作.

关 键 词:CPLD  MAX  PLUSⅡ  分辨率  脉宽
文章编号:1006-6977(2007)09-0065-03
收稿时间:2007-05-10
修稿时间:2007-05-10

Design of high performance pulse signal generator based on CPLD
WANG Wen-li,SHANG Zhi-xin.Design of high performance pulse signal generator based on CPLD[J].International Electronic Elements,2007(9):65-68.
Authors:WANG Wen-li  SHANG Zhi-xin
Affiliation:College of Electronic and Information Engineering,Hebei University,Baoding 071002,China
Abstract:The design of digital 16-bit pulse signal generator based on CPLD is presented,which produces period and duty factor all adjustable and high stability pulse.This method can be used as the creation of pulse in the DDS function signal generator.In the design the singlechip can control CPLD.
Keywords:
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