| 一种500 Mbps至4 Gbps连续速率的多模式CDR电路 |
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| 引用本文： | 李天一,许晓冬,尹 韬,辛福彬,李 威,杨海钢.一种500 Mbps至4 Gbps连续速率的多模式CDR电路[J].太赫兹科学与电子信息学报,2017,15(3):507-512. |
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| 作者姓名： | 李天一 许晓冬 尹 韬 辛福彬 李 威 杨海钢 |
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| 作者单位： | 1.System on Programmable Chip Research Department, Institute of Electronics，Chinese Academy of Sciences，Beijing 100190，China；2.The University of Chinese Academy of Sciences，Beijing 100190，China,System on Programmable Chip Research Department, Institute of Electronics，Chinese Academy of Sciences，Beijing 100190，China,System on Programmable Chip Research Department, Institute of Electronics，Chinese Academy of Sciences，Beijing 100190，China,1.System on Programmable Chip Research Department, Institute of Electronics，Chinese Academy of Sciences，Beijing 100190，China；2.The University of Chinese Academy of Sciences，Beijing 100190，China,System on Programmable Chip Research Department, Institute of Electronics，Chinese Academy of Sciences，Beijing 100190，China and System on Programmable Chip Research Department, Institute of Electronics，Chinese Academy of Sciences，Beijing 100190，China |
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| 基金项目： | 自然科学基金资助项目(No.61271149.61474120) |
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| 摘 要： | 提出了一种连续速率的时钟数据恢复(CDR)电路，可覆盖500 Mbps到4 Gbps数据率。该CDR电路在130 nm互补金属氧化物半导体(CMOS)工艺下实现，基于相位插值(PI)原理，采用数字投票电路和相位控制逻辑替代电荷泵和模拟滤波器以方便工艺移植。为缩小片上锁相环(PLL)输出时钟频率范围，同时避免PI电路处于非线性区，该CDR电路采用多种速率模式切换的方式将采样时钟频率限定在500 MHz~1 GHz之间。PI电路为7 bit精确度，线性度良好，4 Gbps数据率时，恢复时钟的峰峰值抖动约为25.6 ps。该CDR误码率在10-10以下，可跟踪最大±976.6 ppm的数据频偏，功耗约为13.28 mW/Gbps，测试芯片大小为5 mm2，其中CDR芯核部分为0.359 mm2。
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| 关 键 词： | 时钟数据恢复 相位插值 连续速率 多模式 互补金属氧化物半导体 |
| 收稿时间： | 2015/11/13 0:00:00 |
| 修稿时间： | 2016/2/6 0:00:00 |
A 500 M to 4 Gbps continuous-rate multimode PI-CDR implementation in 130 nm CMOS |
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| LI Tianyi,XU Xiaodong,YIN Tao,XIN Fubin,LI Wei and YANG Haigang.A 500 M to 4 Gbps continuous-rate multimode PI-CDR implementation in 130 nm CMOS[J].Journal of Terahertz Science and Electronic Information Technology,2017,15(3):507-512. |
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| Authors: | LI Tianyi XU Xiaodong YIN Tao XIN Fubin LI Wei and YANG Haigang |
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