| 全数字延时锁定环的研究进展 |
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| 引用本文： | 徐太龙,陈军宁,孟坚,徐超,柯导明.全数字延时锁定环的研究进展[J].小型微型计算机系统,2013,34(6). |
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| 作者姓名： | 徐太龙 陈军宁 孟坚 徐超 柯导明 |
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| 作者单位： | 安徽大学电子信息工程学院安徽省集成电路设计实验室,合肥,230601 |
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| 基金项目： | 安徽大学青年科学研究基金项目，安徽大学青年骨干教师培养项目，安徽省高校优秀青年人才基金项目，国家自然科学基金项目，国家科技重大专项项目 |
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| 摘 要： | 全数字延时锁定环在现代超大规模系统芯片中具有极其重要的作用,被广泛地用于解决系统时钟的产生和分布问题,因此详细分析其研究进展具有一定的理论意义和实际应用价值.首先在分析延时锁定环工作原理的基础上,阐明了全数字延时锁定环相对于全模拟和混合信号延时锁定环具有的优点.其次详细阐述了全数字延时锁定环的发展过程、研究现状和存在的问题,尤其在指出传统逐次逼近寄存器延时锁定环存在谐波锁定、锁定时间没有达到理论值和死锁三个问题的基础上,对各种改进型逐次逼近寄存器延时锁定环的性能进行了对比分析.最后对全数字延时锁定环的未来发展趋势进行了展望.
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| 关 键 词： | 时钟偏差 全数字延时锁定环 逐次逼近寄存器 锁定时间 |
Research Development of All Digital Delay-locked Loops |
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| XU Tai-long
,
CHEN Jun-ning
,
MENG Jian
,
XU Chao
,
KE Dao-ming.Research Development of All Digital Delay-locked Loops[J].Mini-micro Systems,2013,34(6). |
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| Authors: | XU Tai-long CHEN Jun-ning MENG Jian XU Chao KE Dao-ming |
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| Abstract: | |
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| Keywords: | clock skew au digital delay-locked loop successive approximation register lock time |
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