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片上二维网络互连性能分析
引用本文:王炜,乔林,杨广文,汤志忠.片上二维网络互连性能分析[J].计算机研究与发展,2009,46(10).
作者姓名:王炜  乔林  杨广文  汤志忠
作者单位:清华大学计算机科学与技术系,北京,100084
基金项目:国家自然科学基金项目(60573100,60573110,60673152,60773149);;国家“八六三”高技术研究发展计划基金项目(2006AA01A101,2008AA01Z108);;国家“九七三”重点基础研究发展计划基金项目(2007CB310900)~~
摘    要:片上互连网络已日益成为影响片上多处理器性能的重要因素之一.几乎所有的互连结构均是在二维网络的基础上演变发展而来的.首先分析了几种常见的内部结点度均为4的二维网络的静态特性,提出了一种新的二维片上网络互连路由结构和通信协议,基于全局均匀随机通信模型,通过改变网络规模和变换通信强度,分析了不同结构网络的动态特性,然后用链接数表示通信成本,提出了一种新的网络互连综合性能评估指标网络单位成本延迟负载能力,最后对二维网络片上互连的综合性能进行了对比分析,指出了其各自适用的场合.

关 键 词:片上多处理器  片上网络  拓扑  性能分析  单位成本延迟负载能力  

Performance Analysis of the 2-D Networks-on-Chip
Wang Wei,Qiao Lin,Yang Guangwen,Tang Zhizhong.Performance Analysis of the 2-D Networks-on-Chip[J].Journal of Computer Research and Development,2009,46(10).
Authors:Wang Wei  Qiao Lin  Yang Guangwen  Tang Zhizhong
Affiliation:Department of Computer Science and Technology;Tsinghua University;Beijing 100084
Abstract:The interconnection networks-on-chip becomes an important factor affecting the performance of chip-multiprocessor. Almost all interconnection structures evolve from the 2-D networks. After analyzing the static networks characteristics of some popular 2-D interconnection networks-on-chip whose inner-nodes degree is 4, the authors propose a kind of interconnection networks-on-chip router and the communication protocol. The router uses buffers just on the outside port rather than on both the inside and the out...
Keywords:chip multiprocessor  networks-on-chip  topology  performance analysis  load capacity per cost-delay product  
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