| 一种高效视频编码插值滤波VLSI架构设计 |
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| 引用本文： | 连晓聪,周巍,段哲民,李茸.一种高效视频编码插值滤波VLSI架构设计[J].计算机工程,2015(4). |
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| 作者姓名： | 连晓聪 周巍 段哲民 李茸 |
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| 作者单位： | 西北工业大学电子信息学院,西安,710072 |
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| 基金项目： | 国家自然科学基金资助项目，教育部新世纪优秀人才计划基金资助项目，西北工业大学研究生种子基金资助项目(Z2014126)。 |
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| 摘 要： | 最新视频编码标准高效视频编码( HEVC )将8抽头内插值滤波器应用于分数像素运动估计中。相比H.264/AVC标准中使用的6抽头内插值滤波器,虽然提高了精确度,但增大了超大规模集成电路( VLSI)实现的面积。为此,设计一个内插值滤波器VLSI架构。为便于VLSI实现,提出一种快速内插值滤波算法,并在此基础上,构造可重构配置和单元块复用的内插值滤波器VLSI架构,以降低硬件的实现面积。实验结果表明,与未优化的VLSI架构相比,该架构能降低实现面积和提高工作频率,节省大量的存储RAM,可支持4∶2∶0格式的3840×2160视频序列的实时处理。
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| 关 键 词： | 高效视频编码 运动估计 插值滤波 复用 架构设计 数据分割 |
An Efficient VLSI Architecture Design of High Efficiency Video Coding Interpolation Filtering |
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| LIAN Xiaocong,ZHOU Wei,DUAN Zhemin,LI Rong.An Efficient VLSI Architecture Design of High Efficiency Video Coding Interpolation Filtering[J].Computer Engineering,2015(4). |
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| Authors: | LIAN Xiaocong ZHOU Wei DUAN Zhemin LI Rong |
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| Abstract: | |
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| Keywords: | High Efficiency Video Coding ( HEVC ) Motion Estimation ( ME ) interpolation filtering multiplex architecture design data division |
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