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针对传统正交采样方法存在运算数据量大,镜频抑制比小及硬件实现资源消耗大等方面的不足,分析了一种基于多相滤波结构的数字正交采样方法.首先对多相滤波法实现数字正交变换的原理进行了分析,然后根据多速率信号处理理论推导并给出了基于多相滤波结构的子滤波器的实现方法,最后,通过仿真验证了该方法的有效性.实验结果表明该方法较之传统的低通滤波法有很大的优越性. 相似文献
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用FPGA实现数字下变频 总被引:8,自引:2,他引:6
在接收信号的数字化、软化的实现中,数字下变频起着重要的作用。本文首先介绍了数字下变频的组成结构,然后详细分析了数字下变频的工作原理,描述了在实现数字下变频时,设计方案所采用的高效滤波器——CIC滤波器和多相抽取滤波器的结构和原理。最后,用通过Simulink对数字下变频的性能进行了仿真。在仿真的基础上使用Insigllt公司的FPGA开发系统,用测试电路实测了数字下变频的性能。 相似文献
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介绍了一种基于频域数字信道化的高速数字正交变换器的设计方法和实现结构。这种结构利用数字正交变换的优化算法,通过合理的滤波器组设计,在满足应用要求的前提下,极大地拓宽了正交变换的有效处理带宽,同时大大地减少了计算量和硬件电路资源的消耗。这种正交变换器不需要高精度的正交数字本振(NCO)。此技术的实现在宽带接收机和实时信号处理等领域具有重要意义。 相似文献
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匹配滤波器的多相实现 总被引:1,自引:0,他引:1
本文介绍了匹配滤波器在直接序列扩频通信系统的同步捕获中的应用,研究了数字匹配滤波器的实现方法,提出了基于多相分解的实现结构。与传统的直接实现形式和折叠滤波器等改进形式相比,多相形式具有占用资源少的优点。 相似文献
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高速FIR滤波器的8路多相直接分解实现结构的工作频率是单路串行实现结构的1/8,计算复杂度是单路串行实现结构的8倍。针对高速FIR滤波器的8路多相直接分解实现结构计算复杂度大这一问题,对FIR滤波器的多相并行实现结构进行了详细推导,提出了FIR滤波器的8路多相27子滤波器实现结构,提出的FIR滤波器的8路多相27子滤波器实现结构的计算复杂度是单路串行实现结构的3.375倍。FPGA实验验证了提出的FIR滤波器的8路多相27子滤波器实现结构的优越性。 相似文献
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在软件无线电发射机系统中,数字上变频(DUC)是其核心技术之一。本文介绍了数字上变频的原理,给出了一种基于现场可编程逻辑器件(FPGA)的数字上变频系统的设计方案,并重点讨论了有限冲击响应(FIR)滤波器的设计、内插器的实时处理一多相滤波器结构以及滤波器的多级实现。最后通过QuartusⅡ软件对该算法进行了仿真验证。 相似文献
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本文介绍了匹配滤波器在直接序列扩频通信系统的同步捕获中的应用,研究了数字匹配滤波器的实现方法,提出了基于多相分解的实现结构.与传统的直接实现形式和折叠滤波器等改进形式相比,多相形式具有节省存储空间的优点. 相似文献
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为了实现对联合战术信息分发系统( JTIDS)信号的宽带接收,设计了一种基于多相滤波器的信道化接收方法。该方法通过对JTIDS的模拟信道和数字信道进行合理划分,将宽带接收转化为多个窄带接收,然后再结合多相滤波器进行跳频频点检测,以实现全概率的JTIDS信号宽带接收。给出了此信道化接收模型的现场可编程门阵列( FPGA)实现方案,并对仿真和硬件测试结果进行对比分析。仿真与FPGA测试结果表明,该接收模型可以精确实时地接收JTIDS宽带信号。 相似文献
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在宽带、超宽带应用中,单一信号带宽达几百兆赫兹;或者在不同中频同时调制多个信号产生的宽带信号也达数百兆赫兹,用常规的数字下变频方法很难实现。文章提出了一种基于DFT滤波器组的高效数字下变频结构,分析了该解调算法的特点和实现性能。对已知信号带宽和中频的宽带信号,对比了DFT滤波器组和多相分解算法的性能。对信号带宽和中频均在变化的信号,给出了实现思路。最后,给出了该DFT滤波器组的硬件实现方案。 相似文献
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FPGA在数字信道化接收机中的应用 总被引:2,自引:0,他引:2
介绍了电子侦察用数字信道化接收机的设计思想,提出了FPGA具体实现结构。重点论述了采用多相滤波器实现信道化的原理和使用FPGA实现的方法,并给出了仿真结果图。为了达到实时处理的效果,FIR的FPGA实现采用查表结构,FFT的FPGA采用流水线结构和并行结构。这两种实现方式都极大地提高了运算速度,使数字信道化接收机的实时处理成为可能。此外,文中还对频率估计、检测和判决逻辑部分进行了相应的介绍。 相似文献