总线协议中的CRC及其在SATA通信技术中的应用

分析了基于总线协议下的CRC校验关键技术的算法及实现原理。提出了一种适合总线协议生成多项式的CRC产生器与校验器的硬件电路实现方法。通过该方法,依照SATA国际I/O标准,编写的CRC产生器与校验器Verilog 代码,已通过VCS的仿真验证,并成功集成于SATA总线,实现了该总线的通信。该方案进行的CRC产生器和校验器设计,具有可靠性高,实用性广,便于提高工程开发效率等优点。     

Xmodem协议中CRC算法的FPAG实现

基于解决Xmodem协议中CRC校验的目的,以经典的LFSR硬件电路为基础,采用了按字节并行运算CRC校验码,以及多字节CRC算法的方法。在Quartus II环境下,通过以VHDL语言仿真试验,得出Xmodem协议中CRC校验,以多字节循环并行CRC算法能够满足高速实时性要求的结论。     

超高频RFID系统CRC电路设计

介绍了超高频射频身份识别(RFID)系统中循环冗余校验(CRC)电路的原理与特点,根据ISO/IEC18000-6C标准中CRC电路的要求,对串、并行CRC电路的优、缺点进行了综合评估,且在FPGA平台上实现并进行系统性能分析.利用递归公式法设计了一种算法简单、结构紧凑、运算速度快的并行CRC电路.     

CRC算法在以太网数据帧中的应用及其硬件实现

文章介绍了CRC校验算法的原理,在串行CRC实现的基础上,对电路结构提出了改进,提出了CRC的并行计算,并基于Verilog HDL语言以CRC8为例说明了硬件电路实现方法。CRC校验广泛应用于数据通信、数据存储领域,结合IEEE802．3标准,说明了CRC算法在以太网帧FCS字段中的应用,并给出了CRC32_D16仿真结果。     

新型超高频RFID编解码和CRC电路的设计与实现

提出了一种新的超高频射频识别(RFID)标签芯片的数据编解码与循环冗余校验(CRC)计算同步进行的电路结构。该电路采用ISO/IEC 18000.6C标准协议,在数据编解码过程中同步进行串行CRC计算来提高系统数据的处理速度。采用FPGA进行仿真分析。结果表明,该设计方法可实现CRC编解码与RFID数据的编解码同步,即不占用额外的时钟处理CRC计算,从而满足超高频RFID的快速通信要求。所提出的串行CRC电路在SIMC 0.18 μm标准CMOS工艺下进行综合,其面积比并行CRC电路节省31.4%,电路算法更简单。     

可变生成多项式与输入位宽的并行CRC

介绍了两种LFSR类型的CRC且比较了它们的特性,然后以II型LFSR为基础,分两步先后推导出任意m比特的直接并行计算以及如何进行连续m比特的计算,即得到可变生成多项式与输入位宽的并行CRC算法,最后举例给出基于CCITT-16协议的4比特输入位宽的VHDL程序实现代码并给出仿真验证结果。由此对于给定的生成多项式与输入位宽,通过提出的算法用C语言或者硬件电路描述语言可以实现快速简单的并行CRC计算。     

CRC5/16编码校验模块的FPGA一体化设计

在数字通信领域,为保证数据的正确传输,数据校验是必不可少的,而循环冗余校验(CyclicRedundancy Check,简称CRC)在其中得到广泛的应用。该文首先对CRC5/16校验的基本原理作了简要的介绍,然后对CRC5/16编码校验的具体电路及其实现步骤进行了详尽的阐述。在分析它们实现电路的基础上,提出了将CRC5/16的编码校验放在一个模块中实现的方法,这样不仅节省了硬件资源,而且系统的模块化设计也有利于模块的重复利用与移植。最后给出了在FPGA中的具体实现方法,并利用软件工具及硬件电路对该设计进行了较为全面的仿真验证。     

利用无损压缩降低循环冗余校验的错误漏检率及其电路实现

循环冗余校验(CRC)算法在很多领域都有广泛的应用。对于确定格式的CRC校验码生成多项式,其错误漏检率基本为确定值。因此待检数据的长度越大,出现错误而不会被检测到的机会也就越多。为了解决这方面存在的问题,该文利用无损压缩霍夫曼算法缩短待测数据的长度,从而降低了数据出错之后不能被检测到的概率。并设计出相应的可靠性校验电路。与单纯使用CRC校验的方法相比,该文提出的方法可以将出错的几率下降为原来的万分之一以下。设计得到的电路模块可以作为VLSI中的可靠性电路模块(IP)加以利用。     

CRC8校验算法及在飞机电气综合试验管理系统的应用

为了满足飞机电气综合试验管理系统高速网络通信中数据校验的要求,通过分析串行算法的不足之后采用并行算法实现CRC8校验。为了推导出CRC8校验的并行算法,首先通过描述除法电路结构和运算步骤,推导出串行算法及其实现电路,然后进一步通过演算实现其并行算法。这里首次给出了应用并行算法基于LabVIEW实现CRC8校验的方法,并将其应用于飞机电气综合试验管理系统。     

基于FPGA的循环冗余校验实验系统的实现

文章首先分析了循环冗余校验码的功能,在此基础上提出了基于FPGA的实现方法,详细阐述了CRC校验编解码的实现方法,并提出了基于现有的实验箱设备实现小型的CRC校验系统的总体设计框架和设计思路,完成了CRC校验实验系统的设计,充分提高了设备的使用效率.     

短波ARQ通信中的CRC校验算法研究

在对CRC码生成原理进行分析的基础上,针对短波通信中数据串行输出的特点,给出了短波ARQ通信中CRC码的快速校验算法及其编程实现方法。与常用校验算法比较的结果表明,该算法不仅能够充分满足对串行数据CRC校验实时处理的需要,而且思路简单,易于编程实现。     

循环冗余校验生成多项式的构造及其性能的理论分析

循环冗余校验CRC由于编码简单、检错能力强且误判概率低，是一种主要应用于二元码组的高效可靠的差错控制方法。首先分析了CRC的校验原理，进而构造了一个生成多项式，进行了性能的分析比较，最终提出了生成多项式的重要原则。     

循环冗余校验在数据采集系统中的应用

在激光光幕坐标靶的测试中,采用FPGA作为坐标数的数据采集和存储装置,为了克服其占用资源多、扩展性不强等特点,采用FPGA处理I/O数据,并通过并行算法的CRC校验与主控FPGA交换I/O信息的方法实现数据的存储。为了保证并行I/O数据传输的可靠性,用Verilog实现了并行算法CRC-32校验编码,给出了正确的仿真结果。在实际应用中,该校验器速度快,占用资源少,该方法实现了对数据的有效传输,具有I/O扩展的高度灵活性,为大面积坐标靶的实现提供可靠的理论基础。     

UHF RFID系统中并行CRC电路的设计

针对UHF RFID系统中的并行循环冗余校验电路进行了设计和详细的分析。首先对基于经典的线性反馈移位寄存器的串行CRC电路进行了介绍,然后在串行CRC电路的基础上采用迭代法推导出了8位并行CRC电路。UHF RFID系统中采用了CRC-16的校验方法,因此该文着重以CRC-16为例,用Verilog HDL硬件描述语言设计实现了8位并行CRC-16电路,利用ALTERA公司的仿真工具Modelsim对其进行了功能仿真,最后在Quartus II 11.0开发环境下烧录到FPGA芯片上进行了板级验证。结果符合设计的初衷:一次处理1个字节的数据,且满足UHF系统通信速率的要求。     

基于MODBUS自由协议的数据校验方法探究

本文针对于一种实际的MODBUS自由协议在AVR单片机平台上应用中出现的问题展开研究,分析问题出现的原因并提出一种可替代CRC校验的数据校验方法,通过实验验证该方法可以解决在不使用CRC校验的情况下实现较稳定可靠的MODBUS自由协议通信.本文首先介绍MSDBUS协议和自由协议;其次,具体分析一种在中低端单片机例如ATmega8作为MCU的平台上MOCBUS自由协议通信在应用中产生的问题;再次,针对上述问题提出一种数据校验方法和实现.最后,通过实验数据对提出的数据校验方法的效果进行验证.     

多级分块CRC的快速配置方法

分块循环冗余校验(CRC)方法能够满足高速通信链路要求.针对现在方法主要通过多项式公式推导和查表法实现,较难推广的问题,提出一种快速配置方法.首先,使用状态矩阵推导出CRC并行计算方法.通过矩阵变换,将余数计算和余数变换合并,简化计算步骤,实现多通道与并行位宽混合的多级分块CRC计算方法;对长度可变数据的计算,实现生成多项式、通道数、单通道并行处理位宽的任意配置.仿真结果表明该方法进一步提高了分块CRC校验速度,且增加通道数比并行位宽扩展更能提高运算性能.     

HDLC控制协议的FPGA设计与实现

设计了一种基于FPGA的HDLC协议控制系统,该系统可有效利用FPGA片内硬件资源,无需外围电路,高度集成且操作简单。重点对协议的CRC校验及“0”比特插入模块进行了介绍,给出了相应的VHDL代码及功能仿真波形图。     

模拟电路版图验证

本文全面讨论了同构检测的启发式算法的理论基础,结合具体电路,提出了一个全新的、实用的电网络同构检测方法,并在IBM PC/XT机上进行了模拟,结果良好。     

基于半字节CRC直驱表法的RS-485通信优化设计

针对某项目采用 RS-485总线传输数据出现误码的情况,在不改变硬件电路的前提下,提出了一种反馈纠错方法,在数据接收端使用CRC校验实现检错,并反馈数据正确或重传指令,发送端根据指令内容,发送新数或重传旧数。在收发端均使用Ping-Pong缓存,保证了总线的传输效率。经试验验证,在此应用背景下,该方法实现了数据的零误码传输,提高了系统的可靠性。     

基于连续校验和的模拟检错电路硬件开销的优化

基于连续校验和的模拟电路并发检错与纠错技术，可以用来设计具有容错能力的模拟电路，然而，检错电路的硬件开销在实际应用中是一个不能忽略的问题，本文对此进行了研究。