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许霁航杨靓娄冕张海金 《微电子学与计算机》2022,(12):86-92
为满足RISC-V架构生态中对RISC-V平台软件调试的需求,设计并实现了一种基于RISC-V调试协议的片上调试系统.该系统通过调试传输模块实现并隐藏调试模块内部寄存器访问逻辑,将其简化为JTAG串行信号实现与宿主机的交互,并通过调试模块实现了调试所必需的处理器全面监控与存储访问功能.在基本调试功能的基础上,进一步实现了总线直接访问、程序缓存和基于触发模块的触发功能,并在兼容RISC-V调试协议的情况下实现了事件序列触发功能.该片上调试系统依托于自研RISC-V处理器硬件平台,通过GDB与OpenOCD构成的宿主机软件环境进行功能测试.经过与其他RISC-V架构处理器对比和FPGA测试表明,该片上调试系统功能丰富,能够满足目前RISC-V平台调试的功能需求. 相似文献
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介绍了一种复用JTAG标准接口来实现处理器片上调试和性能分析的方法.以SuperV DSP处理器为研究对象,通过设计调试和性能分析模块以及相应指令,实现了运行控制,断点设置等调试功能以及统计执行周期数,Cache缺失率等性能分析数据的功能,极大地方便软件开发和应用程序优化,同时对处理器性能和功耗影响甚微. 相似文献
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介绍了一种基于IEEE1149.1标准的可重定向的调试方法,详细地分析了一种嵌入式调试模块的内部结构、工作原理、实现过程以及它给处理器核带来的代价,该模块在RTL级只需较少的修改即可集成在多种微处理器核上.完成片上调试的功能。 相似文献
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介绍了一种基于高性能定点数字信号处理器(DSP)TMS320C6416的红外图像处理系统。本系统以DSP为核心处理器,辅以单片机统一系统时序,完成红外视频采集、图像增强和视频输出的功能,具有适应性、实用性强和调试方便的特点,在红外热成像系统中有着广泛的应用前景。 相似文献
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本文介绍了自行研制的合成孔径雷达(Synthetic Aperture Radar,SAR)实时成像处理机中的矢量处理器,及其在实时成像处理中的应用.该矢量处理器在(I)FFT等信号处理方面具有优越的特性,非常适合完成CS成像算法中的(I)FFT和复乘运算.在实时成像处理时,本文运用两维(I)FFT运算,能够避免转角存储,降低处理时间开销,减少对处理器的控制步骤,从而充分发挥该处理器在处理性能、数据传输率和可编程性等方面的优点.文中还分析了该矢量处理器的处理精度,及其对实时成像处理的影响.并将该矢量处理器成功地应用到SAR实时处理机中,最后给出了实际成像结果. 相似文献
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针对现代电子设计低成本、高效率、高灵活性的特点,研究了一种新型的处理器:事件驱动多核心处理器。通过对这种处理器基本构架的研究,以及采用新型处理器与采用传统控制器设计差异的对比,分析出该处理器具有性能高、实时性强、易编程等优点。最后,提出了一种新的设计方法:硬件设计软件化,给众多电子系统设计提供新的思路和参考。 相似文献
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多模基带处理器芯片的设计已成为研究的热点。文章结合无线通信处理算法的特点.利用指令级加速技术,设计了一种基于无线通信中复数运算的16位嵌入式处理器核。利用它可以通过灵活的配置软件完成基带处理中绝大部分的复数相关运算和控制功能。经实际流片测试,该处理器核具有面积小、功耗低的特点.可用于多模无线通信基带处理器的设计。 相似文献
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基于PowerPC的雷达通用处理机设计 总被引:1,自引:1,他引:0
介绍了一种高性能雷达通用处理机,以4片PowerPC高性能通用处理器为核心,采用VPX总线标准,符合通用化、标准化、系列化的要求。处理机采用PowerPC通用处理器和RapidIO高速串行接口,具有较强的处理能力和数据交换能力,较好的通用性、可重构性和扩展性;采用VxWorks实时操作系统和VSIPL数学函数库,提高软件开发效率。最后通过合成孔径雷达(SAR)实时成像处理和性能评估,验证了通用处理器替代DSP作雷达通用处理的可行性。 相似文献
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多核处理器已经成为当前处理器设计的主流,其并行处理能力显著提高了处理器的性能,同时,多核处理器本身的高度集成度也使其功耗显著上升,从而在一定程度上限制了多核处理器的发展。本文描述了低功耗设计的基本理论、常用的低功耗设计技术和多核处理器中的功耗评估技术,并分析和总结了低功耗多核处理器研究的最新进展,可为多核处理器的设计提供有益的参考。 相似文献
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以ADI公司高性能浮点DSP芯片TS201为核心处理器,结合Xilinx公司VIRTEX-IIPRO系列FPGA芯片设计的2片DSP数据缓存板和4片DSP主处理板,设计了一种雷达信号处理机。该信号处理机中,DSP芯片仅用链路口完成相互间点对点的通信,各自的数据总线互补相连,存储器空间地址彼此独立。系统具有硬件结构体积小,程序易调试,整体可靠性高的优点。 相似文献
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Anderson D. DeWitt B.C. Eisele R.L. Gallup M.G. Ho Y.-W. McMahan S.C. Marquette D. Martin B. Scheuer K.C. Sood L.C. Spohrer T.S. 《Solid-State Circuits, IEEE Journal of》1990,25(5):1178-1189
A 32-b single-chip processor has been developed that is user object-code compatible with members of the 68000 processor family. The 14-4-mm×15.5-mm device contains over 1.2 million transistors and is fabricated with a double-layer-metal CMOS process. The processor integrates three major functional units: an integer processor: a floating-point processor; and a Harvard-style memory unit. Each major unit is described, and the implementation techniques that were employed and selected circuit issues that were confronted in the design are discussed 相似文献