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本文分析了在对高速数据存盘时,现有的数据采集处理系统存在的问题:进而提出了一种基于则S320C5410的主机接口(HPI-host port interface)的主从式高速数据采集处理系统。该系统实现了对高速数据的实时采集、处理和存盘,并具有电路简单、通用性强等优点。 相似文献
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AD9250是ADI公司的两路14位250MSPS数模转换器,采用JESD204B协议接口。文中分析了JESD204B协议,并基于Xilinx FPGA的GTX高速串口实现高速数据接口,将AD9250输出的串行数据转换为14位的并行采样数据。同时搭建了验证平台,对高速数据接口进行了数据传输测试验证,测试结果表明,该高速数据接口可正确接收速度高达5Gbps的采样数据。 相似文献
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陈丽 《单片机与嵌入式系统应用》2006,(10):27-29
HSDI是一种可配置的高速数据指挥通道。本文首先介绍两种高速数据接口HSDIA和HSDIB的硬件结构,随后介绍两种HSDI接口上信号的时序和功能操作,最后结合实例重点介绍如何采用FPGA实现HSDI接口的设计。 相似文献
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本文提出了一种硬件密码组件的设计及具体实现方法,其中包括硬件结构、固件设计方案、驱动以及其应用程序的实现.该系统采用ADSP数字信号处理器和EZ_USB CY7C68013设备接口芯片来实现系统与PC机之间的高速数据传榆,提出了一种使用软硬件技术开发符合USB2.0规范的硬件密码组件的方法. 相似文献
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针对无线电导航系统中多通道信号处理需求,设计了一种基于FPGA和USB接口的低成本、快速、和高可靠性的多通道数据采集系统;详细介绍了系统结构以及FPGA控制SRAM芯片实现数据缓存的关键技术,运用FPGA内部的硬件调试工具(SignalTapⅡ)验证了系统数据传输的可靠性能;系统可靠传输速度可达20Mbytes/s,可广泛用于多路、高速信号采集场合,已投入到实际应用。 相似文献
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介绍了一种在PC机上实现的高速16位并行数据采集接口。该接口由高速光电隔离电路,双端口FIFO存储缓冲器电路及由FPGA芯片构成的计算机接口逻辑与控制电路等组成。该接口电路将终端显示处理系统与前端数据处理系统通过光电耦合器隔离开来,避免了它们之间的相互干扰,较好地解决了16位并行数据高速传输中存在的电磁干扰问题和大数据量实时有效传输问题。采用现场可编码门阵列FPGA芯片,使硬件设计软件化,既实现了复杂逻辑功能设计,又减少了硬件电路规模,提高了系统的可靠性,在雷达、声纳等复杂系统中具有良好的应用价值。 相似文献
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为了解决高分辨率高帧频摄像头阵列的数据传输和存储问题,提出了一种xHC(USB可扩展主机控制器)通过PCI Express总线与FPGA实现直接通信的系统.利用PCIE点到点数据传输,图像数据无需经过主机内存,即可直接传入后续处理和存储单元,大大简化了数据传输的物理路径,降低了数据的传输延迟,避免了操作系统对数据传输的影响.利用FPGA的PCIE硬核,实现了xHC和PCI Express的通信接口,FPGA通过该接口对xHC和与之相连的多个USB摄像头进行控制和驱动,实现多路图像数据的采集和传输.最后通过专门设计的监测模块和Chipscope抓包工具,对该系统的性能进行了综合分析和验证,验证结果表明,该系统极大地提高了图像传输速度,并具备很高的扩展性能. 相似文献
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针对多通道γ射线工业计算机断层扫描(CT)的高速数据采集和远距离传输需求,应用点对点传输,设计了基于数据报协议(UDP)的现场可编程门阵列(FPGA)数据采集传输系统.系统增加FPGA计数单元,可扩展更多通道进行数据采集.主控以FPGA作为核心,将UDP用Verilog编程的方式在FPGA中实现,控制以太网接口芯片将数据传至上位机,上位机界面与底层传输电路的相互通信利用VC++6.0编程实现.实验结果表明:在100 Mb/s全双工模式下进行网络测试,其网络利用率稳定在93%,传输速度为93 Mb/s(即11.625 MB/s);上位机能正确地接收到底层电路所发送的数据;能够满足γ射线工业CT高速数据采集系统在速度和距离上的传输要求. 相似文献
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介绍了一种基于FPGA的高性能视频信号采集与显示系统的硬件设计与实现,模数转换系统采用高性能的A/D采集电路,通过高速的FPGA控制,将采集到的数据进行处理后,通过系统中的PCI接口传输给监控系统以供显示、监控等功能的实现。本模块已经投入运行,性能稳定。 相似文献
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随着通信技术不断发展,CPRI协议作为无线基站的接口规范逐步完善,可支持的数据速率不断提高。本课题基于“新一代宽带无线通信网”国家科技重大专项:TD-LTE基站基带与射频模块间接口(Ir接口)仿真与监测工具开发。本文为了测试基带设备对IQ数据的处理能力,基于FPGA实现对用户数据(IQ数据)的实时高速传输至上位机进行存储。通过比较现有高速数据传输技术,提出采用分层化,模块化的设计思想,利用FPGA实现UDP/IP协议栈,通过千兆以太网传输至上位机。通过测试验证,本模块可实现对IQ数据的实时高速传输,满足设计要求。 相似文献