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《固体电子学研究与进展》1989,(1)
<正> 据日本《JEE》杂心1983年3月号报道,松下、日立和东芝公司宣布制成16兆位DRAM样机,在一块芯片上可集成约3400万只晶体管。 松下公司采用线宽0.5μm技术及开型位线方法,形成1.5×2.2μm的存储单元,以位线和字线相交处形成的沟道环绕之。为了实现这一结构,该公司在每256条实字线处采用赝字线用以消除耦合噪音,为有较高的密度,在每两条位线上排列一个读出放大器。它采用包括水溶性聚合物和γ射线步进机的4层保护膜。松下公司宣布了16兆字×1位和4兆字×4位结构的器件,这两种芯片的尺寸为5.4×17.38mm,存取时间为65毫微秒。 相似文献
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三菱电机公司研制成功世界最小的1兆位DRAM(动态随机存取存储器)已投放市场。该存储器采用三菱电机公司独自的极小封装技术,体积仅为以前的1兆位DRAM的四分之一,堪称是面向办公室自动化设备和书本型个人计算机等市场的战略商品。这一称作“VSOP封装”的新产品由于采用了比以往产品高一级的0.9μm处理工艺,既达到超薄型的封 相似文献
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《电子工业专用设备》1993,(2)
<正> 日本富士通公司于今年(1993年)1月在日本电子情报通讯学会召开的“半导体材料、器件研究会”上宣布开发成功第一块256兆位DRAM。 这种新开发的256兆位DRAM芯片采用准分子激光光源的光学片子步进机与电子束直写系统混合曝光技术制成,最小线宽0.2微米,芯片面积为400平方毫米(16.1×24.9mm),单元面积0.67平方微米,存取时间为40纳秒。 相似文献
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实现一兆位DRAM需要解决的严重问题之一就是与数据线充、放电有关的功耗问题。为解决这一问题,本文提出了能使功耗减少大约1/4的三种方法:多路数据线结构、512刷新周期以及芯片电压限制电路。通过46平方毫米的实验性n-MOS1兆位DRAM芯片的设计和分析,证明这些方法是有效的。当周期时间为260毫微秒、快速存取时间为90毫微秒时,制作的1兆位DRAM芯片额定工作功耗是295毫瓦。还论述了进一步降低功耗的可能性。 相似文献
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日本的东芝公司于去年11月1日发表了新一代超大规模集成电路的文章,它采用1.2μm的微细加工技术及新的元件隔离技术(BOX),在一块芯片上集成了约220万个元件的1M位动态RAM。 存取时间70ns 此超LSI,在4.78×13.23平方毫米的硅芯片上集成的元件是目前已达到实用化的最先进的超LSI-256k位DRAM的4倍,并将这种器件封装在与256k位DRAM 相似文献
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据《电子材料》1995年第4期报道,目前,三菱电机公司业已开发出了一种适用于千兆位级DRAM的低电压、高速DRAM电路技术。以该电路技术为基础,采用0.4PmCMOS工艺试制了1.2V工作的16MDRAM,在电源电压为1.2V的低电压下实现了存取时间(tRAC)为49ns的高速工作。本开发课题的主要内容如下:(1)即使是在低电压下,也可实现高速读出工作(可能的Charge-TransferredWellSe-nsing方法),在电源电压Vcc=1.2V下,实现5ns(19)的高速化是可能的(估计了16MDRAM的模拟值)在本读出方法中,在读出开始的同时,由于可以作到使… 相似文献
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《电子工业专用设备》2010,(11):58-58
<正>三星电子(Samsung Electronics)2011年将致力于提升DRAM存储器半导体制程技术水平,再拉大与其它竞争业者间差距。三星半导体事业部专务赵南成表示,2010年采用30 nm级制程制造 相似文献