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相似文献
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1.
文章介绍一种新型、实用的短波频率合成器。该频率合成器将国外最新的直接数字频率合成器(DDS)技术和传统的锁相环(PLL)技术有机地结合起来,与多环频率合成器相比,具有线路简洁、设计合理、频率转换速度快、可靠性高等优点;而与普通的单环频率合成器相比,具有更高的频率分辨率和更低的相位噪声。文中分析了该频率合成器的工作原理和设计注意事项,提出了具体的实施方案。  相似文献   

2.
一种提高频率合成器分辨率的新方法   总被引:1,自引:0,他引:1  
本文结合一个实际的频率合成器,详细介绍利用相位合成技术提高单环数字式频率合成器频率分辨率的方法与原理.  相似文献   

3.
讨论了一种输出频带宽、跳频时间短、相位噪声低、杂波抑制高的频率合成器的设计方法;该方法采用STW81102频率合成芯片,是一个将PLL和VCO集成在一起的低成本单片多频带射频频率合成器芯片,并利用8515单片机软件模拟I2C总线通信对STW81102芯片进行置数控制输出频率;基于该方法实现了输出频率范围为3100~3400MHz,步进频率为20MHz的宽带跳频频率合成器,实验结果表明该频率合成器输出功率大于+5dBm,杂波抑制大于65dB,相位噪声优于-95dBc/Hz/10kHz。  相似文献   

4.
一种有效的DDS相位截断杂散抑制方法   总被引:1,自引:0,他引:1  
通过对直接数字频率合成器(DDS)相位截断噪声成因的理论分析,从而通过采用一组固定的频率控制字和变化的参考时钟,使得截断相位误差序列为0,并扰乱截断相位误差序列的周期性,从而达到抑制相位截断噪声,并最终在实践中验证该方法的正确性与可行性。  相似文献   

5.
根据现代通信系统的需要介绍了4.5-5.2GHz的频率合成器的设计。该频率合成器工作频带宽,步进小,尤其是具有较低的相位噪声。提出了实现小步进和低相噪的频率合成器的几种方法,最后采用小数分频和环内混频的方案。经过合理设计环路滤波器,选择合适的环路带宽,制作出高性能的频率合成器,并且对频率合成器的性能进行了分析。  相似文献   

6.
介绍一种小步进、低相位噪声的频率合成方法。采用直接数字合成(DDS)产生小步进信号,利用5 MHz整数步进锁相环与混频电路组合方式改善了合成器的杂散和相位噪声。  相似文献   

7.
现代通信系统对频率源频谱纯度、频率范围和相位噪声指标要求日益提高,本设计根据锁相环的基本原理,基于ADI公司频率合成芯片ADF4351,通过单片机ADu C7023程序控制,设计与实现一种高性能可调频率源,并且测试输出频率在935MHz,相位噪声-84.76d Bc@1k Hz,-91.30d Bc@10k Hz,杂散信号较低,测试结果表明该频率合成器输出信号稳定,噪声系数较低。  相似文献   

8.
李柏渝 《微处理机》2007,28(6):125-128
说明了锁相环频率合成器的工作原理,介绍了Si4133双波段射频合成芯片与一般的通用频率合成芯片各自的特点,并将二者在物理特性和使用复杂度等方面进行了对比。最后,文章给出了Si4133在一个接收机系统中应用的实例。以该芯片设计的本振电路运行稳定可靠,相位噪声低,证明了其在接收机前端设计中的有效性。  相似文献   

9.
采用DDS PLL技术实现的L波段频率合成器   总被引:2,自引:0,他引:2  
直接数字合成(DDS)是近年发展起来的一种新型合成技术,有频率分辨率高,转换时间短,相位噪声低等特点,与锁相合成技术(PLL)配合,可以设计出频带宽、分辨率高的频率合成器。本文介绍了一种DDS PLL的混合结构,实现了一个用于卫星数据采集系统中频发射单元载频源的频率合成器。  相似文献   

10.
直接式数字频率合成器及其在通信系统中的应用   总被引:1,自引:0,他引:1  
直接数字式频率合成器(DDS)是近年来发展非常迅速的一种器件,具有频率分辨率高、频率转换时间短、相位噪声低、体积小、成本低等特点,将其应用子通信系统中,必将大大简化系统,提高系统性能。论文主要介绍DDS的基本原理和性能,以及在通信系统中的应用。  相似文献   

11.
针对频率综合器在宽调谐范围下相位噪声变差的问题,设计了一款适用于频率综合器的宽调谐范围低相位噪声的压控振荡器;采用180nm BiCMOS工艺,运用可变电容阵列和开关电容阵列实现宽调谐范围;通过加入降噪模块,滤除压控振荡器产生的二次谐波和三次谐波,增大输出振幅,降低相位噪声;并在压控振荡器输出端加入输出缓冲器,降低频率综合器其他器件对压控振荡器的影响;通过Cadence软件对压控振荡器进行仿真,仿真结果表明:调谐电压为0.3~3V,压控振荡器的输出频率范围为2.3~3.5GHz;当压控振荡器的中心频率为3.31GHz时,在偏离中心频率10kHz、100kHz和1MHz处的相位噪声分别为-93.21dBc/Hz,-117.03dBc/Hz,-137.41dBc/Hz,功耗7.66mW;在较宽的频率范围内,取得良好的相位噪声抑制,提高压控振荡器的噪声性能,满足宽带低相噪频率综合器的应用需求。  相似文献   

12.
This paper presents a low power and low phase noise CMOS integer-N frequency synthesizer based on the charge-pump Phase Locked Loop (PLL) topology. The frequency synthesizer can be used for IEEE 802.16 unlicensed band of WiMAX (World Interoperability for Microwave Access). The operation frequency of the proposed design is ranged from 5.13 to 5.22 GHz. The proposed Voltage-Controlled Oscillator (VCO) achieves low power consumption and low phase noise. The high speed divider is implemented by an optimal extended true single phase clock (E-TSPC) prescaler. It can achieve higher operating frequency and lower power consumption. A new frequency divider is also proposed to eliminate the hardware overhead of the S counter in the conventional programmable divider. The proposed frequency synthesizer consists of a phase-frequency detector (PFD), a charge pump, a low-pass loop filter, a VCO, and a frequency divider. The simulated phase noise of the proposed VCO is −121.6 dBc/Hz at 1 MHz offset from the carrier frequency. The proposed frequency synthesizer consumes 13.1 mW. The chip with an area of 1.048 × 1.076 mm2 is fabricated in a TSMC 0.18 μm CMOS 1P6M technology process.  相似文献   

13.
文章分析了小数分频频率合成器中存在的相位杂散的问题,介绍了采用∑—△调制技术的小数频率合成器。详细介绍了∑—△调制频率合成器的原理和实现方法。这解决了频率分辨率和转换时间之间的矛盾,同时大大提高了噪声性能。  相似文献   

14.
频率合成源是射频发生和频谱分析中最重要的组成之一,评价合成源性能指标的是输出信号的相位噪声、杂散、频率分辨率和频率切换时间.本文通过分析传统锁相环原理,提出一种通用的超低相位噪声合成源设计方案(带宽100MHz以内).在锁相环基础上,通过引入直接数字合成(Direct digital synthesizer,DDS)混频鉴相技术,使得到的射频信号理论值达到0.1mHz的频率分辨率,同时将带内相位噪声指标优化17dB以上.新方案同时兼顾了杂散和频率切换时间指标,保障合成源的输出信号稳定可靠,使其在自动测试领域拥有广阔的应用前景.  相似文献   

15.
文章分析了小数分频频率合成器中存在的相位杂散的问题,介绍了采用∑-A调制技术的小数频率合成器。详细介绍了∑-△调制频率合成器的原理和实现方法。这解决了频率分辨率和转换时间之间的矛盾,同时大大提高了噪声性能。  相似文献   

16.
本文分析锁相环(PLL)频率合成器的基本原理,并简单地介绍了ADI公司的集成锁相环芯片ADF4108的结构和性能。然后基于ADF4108芯片设计出一种频率合成器的方案,在该方案中,包含了环路滤波器的设计。通过ADIsimPLL3.1软件仿真,结果显示其相位噪声到达-99.27dBc@10kHz,并且系统工作稳定。  相似文献   

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