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TMS320C25数字信号处理器是一种高性能的单片信号处理器。它不仅广泛应用于各种信号处理系统,也广泛应用于各种控制系统。由于TMS320C25信号处理器各方面的优越性,故采用它作为中央处理单元(CPU)构成的系统越来越多。在用TMS320C25构成的系统中,为了使此高速CPU能够与低速外围器件接口,系统中必须设置等待电路。等待电路是以TMS320C25为CPU所构成的系统的基本配置。本文提出了一种有别于TMS320C25用户手册的等待电路的设计,并在实际中得到了应用。 相似文献
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卷积交织去交织快速算法的实现 总被引:1,自引:0,他引:1
本文介绍了用TMS320C25芯片实现卷积交织/去交织的快速算法。TMS320C25芯片是高性能数字信号处理器,具备高速控制的灵活性和阵列处理器的数值运算能力。由于移动卫星通信信道的多径衰落和遮蔽效应,接收机容易出现突发差错,所以移动卫星通信信道设备常采用卷积交织/去交织编解码方法,改善通信质量。本文根据卷积交织/去交织的原理,提出了一个快速算法,并用TMS320C25的汇编语言实现了快速算法。利 相似文献
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这篇文章着重讨论了C语言程序在以TMS320C25为基础的处理系统中的开发和应用。详细介绍了从C源程序到适用于C25格式的程序的开发过程,同时讨论了在开发过程中可能遇到的问题及其解决办法。同时,文章对两种编程语言在TMS320C25系统中的应用前景作了简单的比较和预测。 相似文献
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文章介绍了一个由计算机和高速信号处理芯片TMS320C25构成的主从式系统,设计了一种486微机EISA总线结构与TMS320C25共享数据存储器,通过此存储器它们彼此可达到高速通信的目的。同时,也探讨了主从机的接口及公共RAM的管理权分配问题。 相似文献
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TMS320C203是TI公司TMS320C2XX系列产品之一。本文介绍了TMS320C203的内部构成,外围部件,汇编指信令,开发工具;并结合作者的科研成果,给出TMS320C203信号处理器的应用举例。 相似文献
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本文介绍了TMS320C50的特点,并结合作者的使用心得从TMS320C50中断的使用流水线的保护等五个方面探讨了TMS320C50的使用技巧。 相似文献
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本文介绍了一种利用数字信号处理器TMS320C25用作雷达数据实时处理,利用图形处理器TMS34010用作雷达视频图象处理,完成雷达视频图象彩色显示的雷达终端。 相似文献
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本文介绍了一种基于Q4401声码器和单片TMS320C25,用于数字语音VSAT系统的基带信号处理器的设计与实现。 相似文献
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Wang Dusheng Zhang Jiankang Fan Changxin 《电子科学学刊(英文版)》1997,14(1):59-62
This paper presents the design of a full-duplex multi-rate vocoder which implements an LPC-10, CELPC and VSELPC algorithms in real time. A single commercially available digital signal processor IC, the TMS320C25, is used to perform the digital processing. The channel interfaces are configured with the design of ASIC, and including timing and control logic circuits. 相似文献
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以目前世界上最新、处理能力最强的定点数字信号处理器(DSP)——德州仪器公司的TMS320C6455为例,介绍了DSP程序的FLASH加载模式,分析了FLASH加载过程,将TMS320C6455与AMD公司的AM29LV033C相结合,给出了系统的硬件连接和完整的烧写程序,并研究了自举引导的实现方法以及DSP程序的二次引导方法,证明了该引导方法的可行性和有效性。 相似文献
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介绍了一种新型铁电存储器FM25CL64,分析了TMS320VC5402 DSP的SPI引导装载模式,给出了一种基于铁电存储器FM25CL64的DSP脱机独立运行系统的设计方案,该方案已成功地应用到一种语音门锁系统中。 相似文献
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阐述了基于TMS320C62xxDSP的C语言和汇编语言混合编程应遵循的接口规范,介绍了如何编写并行汇编代码,最后给出了一个数据采集的混合编程实例。 相似文献
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BruunFFT在TMS320C30上的实现 总被引:1,自引:0,他引:1
本文研究了BruunFFT在TMS32C30上的实现。文章从蝶形运算、循环控制和数字据存取等方面提出了有效的实现方法和技术,产生的程序运算速度快于基2、基4等其它FFT。 相似文献
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As DSP (Digital Signal Processing) applications become more complex, there is also a growing need for new architectures supporting efficient high-level language compilers. We try to synthesize a new DSP processor architecture by adding several DSP processor specific features to a RISC core that has a compiler friendly structure, such as many general-purpose registers and orthogonal instructions. The synthesized digital signal processor supports single-cycle MAC (Multiply-and-ACcumulate), direct memory access, automatic address generation, and hardware looping capabilities in addition to ordinary RISC instructions. The compiler for the new architecture is quickly implemented by developing a code-converter that modifies the assembly codes that are generated by the RISC compiler. The performance effects of adding each of these as well as all the combined features are evaluated using seven DSP-kernel benchmarks, a QCELP vocoder, and an MPEG video decoder. The effects of CPU clock frequency change due to the addition of these features are also considered. Finally, we also compare the performances with several existing DSP processors, such as TMS320C3x, TMS320C54x, and TMS320C5x. 相似文献