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在航空航天电子测试中,直流信号源精度对测试结果具有重要影响,为提高直流信号源精度,提出了一种基于FPGA和AD768的精密可程控直流信号源实现方案;该方案通过USB2.0接口芯片接收计算机发送的信号源控制命令,以FPGA逻辑控制DAC的方式实现信号源的可程控设计,重点介绍了AD768的硬件电路设计,并从电路板设计和软件修正两个方面进一步讨论了提高信号源精度的关键技术;实际应用表明,该信号源具有高精度、可程控和稳定性好等优点,具有很高的参考价值。 相似文献
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一种基于DSP和FPGA的多轴运动控制卡的设计 总被引:3,自引:0,他引:3
介绍一种基于DSP和FPGA的运动控制卡的设计方案,包括各组成部分及其功能,具有高集成度、高运算速度、高处理能力等特点,是一种较好的数控系统平台。 相似文献
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本文基于XILINX可编程逻辑器件XC4VLX25 FPGA开发了一个中频信号接收系统,利用一个可配置的硬件平台实现了模拟信号数字处理的设计,为软件无线电技术的研究提供了一个先进的实验平台. 相似文献
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设计了以CPLD为核心处理芯片的高速高精度数据采集系统,根据输入信号范围,采用浮点放大器放大适当的倍数,保证了数据采集系统的动态测量范围,提高了数据采集精度;双端口RAM作为A/D转换与CPU之间的桥梁,为高速数据吞吐提供了有力的硬件支持. 相似文献
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介绍一种基于FPGA的随机脉冲信号快速捕捉系统的系统结构、工作原理和实现方法;该系统完全摆脱了传统数据采集系统在采集深度和采样效率方面的制约因素,能够在整个时域范围内对外部信号进行连续的高速采样;系统工作过程中不需要外部控制器的干涉,完全由FPGA内部的硬件逻辑电路实现对随机脉冲信号的快速、精确捕捉,可靠性高;抗干扰能力强,同时具有很高的采样效率. 相似文献
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本文提出了一种基于CPLD与MCU的多路高速数据采集系统的新方法.该系统利用AD7656和AD7864可以实现多通道同步采样或多通道异步采样,其中CPLD完成对AID转换的逻辑控制,使用MCU对AID转换数据进行处理.通过实际测试结果表明,所设计的基于CPLD与MCU的多通道数据采集系统,能够准确有效地进行AID数据采集. 相似文献
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在一些数据采集领域,需要对信号进行高速率采样,但是单芯片难于满足要求。本设计采用三路AD C 交叉采样
方式,结合采样时钟等相位差设计、采样误差校正、高速数据处理措施。 相似文献
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基于FPGA的高精度PWM发生器设计与实现 总被引:1,自引:0,他引:1
本文介绍了基于FPGA的高精度PWM发生器的设计方法和流程.本课题采用了自行设计的高速时序比较器,并对RTL级电路进行逻辑层优化和布局指导优化,最终实现了200MHz的时序收敛.整体设计通过了布局布线后仿真验证.本设计成功的应用到了一个电机控制器内部,实践表明本课题所提出的高精度PWM发生器设计方案是合理、有效的. 相似文献
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为了满足硬件工程师对高精度和高带宽测频仪器的需求,设计一种基于FPGA的高精度频率计。频率计包括外围的电压跟随电路和串口通信电路以及FPGA上的分频器模块、频率计量模块和串口通信模块,并使用Altera公司的Cyclone Ⅳ芯片作为控制核心。首先待测信号经过电压跟随器的稳压和隔离,然后将稳压信号接入分频器模块,分频器模块会把频率信号以1 kHz为界限分为低频和高频信号,并对低频信号和高频信号分别采用周期测频法和脉冲计数法测频。测量的频率数据可实时通过串口上传至上位机。经过测试,频率计能够实现1 Hz的精度、200 MHz的测频带宽以及多通道检测。 相似文献
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高精度时钟是通信网时间同步的基础,介绍了接收卫星导航定位系统的定时信号,校正本地晶振的输出,实现高精度时钟的设计方法。从高精度时钟的总体设计、硬件设计,针对硬件实现的关键技术展开阐述,按照ITU-T G.811标准的表征频率精确度和稳定度进行了测试,测试结果分析完全满足标准要求的指标。 相似文献
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由于科学研究的需要,目前空间探测器的设计越来越复杂.短时间内需要采集的信号多达数百路、甚至上千路,普通的数据采集系统无法适应此任务.本文为中法合作研制的太阳爆发小卫星(SMall Explorer for Solar Eruptions,简称 SMESE)设计了以FPGA为核心的4路数据采集系统.测试结果表明,该系统完全适应太阳爆发小卫星的科学任务.系统中采用了Xilinx公司的FPGA芯片Spartan3 XC3S400作为核心控制部件:峰值保持芯片采用AMPTEK公司推出的专为空间应用设计的高速低功耗、极低衰减率的峰值保持芯片PH300;A/D变换芯片采用Analogy Devices公司的16位高速A/D转换芯片AD976A(速率200ksps);CYPRESS公司的双端口RAM芯片CYTC136-15NC作为FPGA和后端MCU的数据交换接口. 相似文献
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介绍了精密时钟同步协议(PTP)的原理。本文精简了该协议,设计并实现了一种低成本、高精度的时钟同步系统方案。该方案中,本地时钟单元、时钟协议模块、发送缓冲、接收缓冲以及系统打时标等功能都在FPGA中实现。经过测试,该方案能够实现ns级同步精度。该方案成本低,并且易于扩展,非常适合局域网络时钟同步的应用领域。 相似文献
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提出间接实现高精度A/D转换电路的设计方案,给出以FPGA为核心,采用等精度测频原理,辅以高精度,低温漂的模拟、数字器件的具体电路设计,并进行了实际测试。测试表明该方案可以实现16位高精度、低线性误差的A/D转器。 相似文献