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介绍了一种在PC机上实现的高速16位并行数据采集接口。该接口由高速光电隔离电路,双端口FIFO存储缓冲器电路及由FPGA芯片构成的计算机接口逻辑与控制电路等组成。该接口电路将终端显示处理系统与前端数据处理系统通过光电耦合器隔离开来,避免了它们之间的相互干扰,较好地解决了16位并行数据高速传输中存在的电磁干扰问题和大数据量实时有效传输问题。采用现场可编码门阵列FPGA芯片,使硬件设计软件化,既实现了复杂逻辑功能设计,又减少了硬件电路规模,提高了系统的可靠性,在雷达、声纳等复杂系统中具有良好的应用价值。 相似文献
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王瑞峰 《计算机工程与设计》2008,29(3):662-663,668
高速数据采集系统的构成,既需要采用高速的A/D转换器、存储器等,又需要采用能够宵现对采集数据进行高速传送和存储的控制方式.通过对现有的一些数据采集系统的特点进行分析,在对ADSP2106X的结构和功能、特别是其外部口DMA通道的工作方式和应用特点进行深入分析的基础上,详细讨论了使用外部口DMA通道的外部握手方式构成高速数据采集系统的方法,实验表明,用该方法构成的数据采集系统具有高速采集数据的能力,设计的电路工作正确可靠. 相似文献
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采用提升结构的二维9/7离散小波逆变换模块是高清图像解码显示和实时处理的关键支撑技术。为实现电路模块的整体优化,在提升结构二维9/7离散小波逆变换标准算法的研究基础上,通过分析图像数据的输入输出顺序,结合器件模型提出一种翻转结构的优化算法。进一步地,给出了所提算法的一种多核并行VLSI结构:通过流水线技术将关键路径降为一级乘法器延迟;通过重组织数据流,处理N×N大小的图像仅需4N的中间缓存,从而在提升该模块速率的同时降低了中间缓存。基于Sparten6-xc6slx150t FPGA进行综合验证,结果表明该模块可稳定运行于166.34 MHz时钟速率。 相似文献
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KD10A10位高速数据采集卡 总被引:4,自引:0,他引:4
讨论了一种商品化的高速、10位分辨率的数据采集卡的设计要点,它包括模拟输入、A/D转换、数据缓存、重复采集控制,计算机接口等电位的设计,可广泛应用于雷达、声纳等各类周期或非周期信号的采集与处理领域。该采集卡可直接插在各类计算机的扩展槽中,构成一功能完善的高速、高精度、大存贮量、可重复采集的数据采集系统。 相似文献
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唐思超 《单片机与嵌入式系统应用》2014,(12):8-10
介绍了高速数字电路器件的通用互连时序模型,基于模型给出了时序公式。对常用高速接口MII、RMII、RGMII和SPI给出了基于公式和理论的实例分析,通过分析得出电路板设计布线长度关系。介绍的时序模型和分析方法,为电路设计人员提供了有效的分析方法,避免进入高速电路走线一定要等长这种认识误区,有助于在工程实践中,提升布线设计成功率、找出故障原因并加速电路设计进程。 相似文献
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一款基于S3C44B0X的高速ADC的电路设计及研究 总被引:2,自引:3,他引:2
本文详细阐述了一款基于三星ARM芯片S3C44B0X的高速AD转换器的电路设计,并介绍了该电路的特点和简单分析了实验结果。该电路系统扩展的外部存储器容量高达12Mbyte,人机交互接口丰富,调试简单。实验结果通过MATLAB仿真,并通过理论推导计算,证明AD转换速率可以达到1.5Mbps左右。 相似文献
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基于 实验室的某 同步数据采集卡 项目 要求, 需要设计一个数据共享存储器 。
对此项目进行研究分析后, 在 可编程逻辑器件 FPGA 的基础上 设计 了 基于 Avalon
总线 的 单时钟真双端口 模式 的双口 RAM 共享存储器 。 设计该存储器的目的是实现
数据在 FPGA 和上位机之间的双向传输, 为了避免 数据在高速 交换时信息丢包的
现象 的出现 采用奇偶 交换 页的 关键 思想完成 该项目 数字量和时标信息 的 交换。
最后对 所设计的 基于 Avalon 总线的 单时钟真双端口 模式的 RAM 进行 功能方面的
验证测试, 对结果进行了分析发现 所设计的双口 RAM 实现了 数字量和时标信息 在
FPGA 与 计算机 之间 高速有效且不丢包的实时传输。 该设计充分利用了 FPCA 现有
的存储资源,减少了电路设计的复杂性 ,同时达到数据 的 高效率 传输。 相似文献
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基于DSP/FPGA的光纤捷联航姿系统设计 总被引:1,自引:0,他引:1
为适应现在航空设备向小型化、低功耗方向发展,设计了一种基于DSP+FPGA的高速、多通道的捷联航姿系统;主要描述了系统的硬件电路设计,采用FPGA完成各传感器的数据采集及控制;采用了高性能的浮点型DSP为内核,用于航姿解算数据高速处理;将FPGA映射到DSP EMIF的一段地址上进行数据交互;FPGA设计采用VHDL语言描述,DSP程序采用了C语言程序和汇编程序编制,设计可重构性强,升级容易,移植性好;跑车试验证明系统高速可行,俯仰角和横滚角误差在0.05°以内,航向角误差为小于0.5°,精度达到了设计的要求。 相似文献
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针对高速实时图像处理系统数据量大、算法复杂度高等特点,从系统的处理性能、缓存容量、传输带宽三个要点考虑,设计了一种基于FPGA+4DSP架构的实时图像并行处理系统,使用SRIO互连技术取代传统EMIF方式实现DSP间、DSP与FPGA中间的数据传输。实验结果表明,系统传输带宽峰值为312.5 MB/s,这种新的嵌入式实时图像处理平台能够实时采集传输处理1k?1k@100 f/s高分辨率图像数据,并且具有可靠性高、通用性强、灵活性好的优点。 相似文献
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基于PCI总线的高速大容量数据采集卡 总被引:6,自引:0,他引:6
介绍了一种基于PCI总线的高速大容量数据采集卡的设计原理与实现。该采集卡由预处理电路、A/D转换器、同步动态随机存储器(SDRAM)、高频时钟发生器、集成于FPGA芯片的PCI接口控制器和SDRAM控制器组成。它通过PCI总线接口与计算机连接,可完成400MHz/s实时数据采集、512MB实时数据存储。 相似文献
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在高速电路系统设计中,差分串行通信方式正在取代并行总线方式,以满足系统对高带宽数据通信的需求。RocketIO是Virtex-2 Pro以上系列FPGA中集成的专用高速串行数据收发模块,可用于实现吉比特的数据传输,适用于多种高速数据传输协议。依据实际工程应用需求,提出了基于RoeketIO的高速串行数据传输系统解决方案,实现了每通道2.5Gb/s的传输速度。最后介绍了RocketIO在Aurora和PCI Express协议实现中的应用,并总结了高速通信系统的共性特征。 相似文献
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随着攻击的日益增多和高速网络的普及,对IDS的性能要求也日益提高,Kruegel将ID3决策树引入到入侵检测系统中,有效地提高了入侵检测的速度,但该方法在增加规则时需要完全重建决策树,而且占用内存过大,对于要求实时性的应用场合并不适合。引入基于增量学习的ID5R决策树算法,并对规则属性处理方式进行优化,在保证检测速度的同时解决了实时增加规则和占用内存过大的问题。 相似文献