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通过对部件相位噪声性能的分析,进行结构指数最大化设计,得到最简总体结构设计。利用混频互调分量分析,避开各级混频组合干扰,得到系统各级结构的频率方案设计。利用DDS器件的结构优势对频率合成器结构进行优化,进一步简化设计结构。根据相位噪声性能的分析结果,进行环路滤波器设计,消除参数设计中的随意性,保证设计过程中系统的相位噪声性能。 相似文献
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为了满足航天测控信道的要求,提出了一种高性能L频段频率合成器设计的改进方案,采用PLL+DDS+PLL结构实现了小步进、低杂散、低相噪的信号输出。分析了方案的可行性,设计了样品,并进行了测试,结果显示其相位噪声优于-100 dBc/Hz@10 kHz,杂散优于-75 dBc,但附加的杂散信号导致了系统同频干扰。通过分析找出引起同频干扰的机理,并提出了相应的改进措施。所提方案对测控通信、电子对抗等领域中频率合成器的研发具有一定的参考价值。 相似文献
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利用DDS/PLL实现微波频率合成器 总被引:1,自引:0,他引:1
阐述了新一代频率合成技术--直接数字频率合成技术(DDS)的原理,并讨论了与锁相环混合构成频率合成器的两种方案,设计了一个微波频率合成器。 相似文献
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从工程设计的角度出发,论述了DDS插入PLL组合方案的设计原则,并给出了一种DDS播入PLL方案的实例。 相似文献
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文章主要介绍了一种微波宽带数字频率合成器设计,该频率合成器采用FPGA控制的直接数字频率合成器(DDS)驱动锁相环(PLL)技术来实现低噪声、低杂散、高分辨率、快捷变频的性能,在宽频段接收机中有着广泛的应用。 相似文献
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本文介绍了采用DDS激励PLL的方案构成微波锁相源,分析设计DDS-PLL频率合成器应注意的问题。以及对杂散抑制技术和PLL的结构进行了总结。 相似文献
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提出了一种直接数字频率合成(DDS)与锁相环(PLL)相结合的全相参频率合成方案。运用HMC704控制压控振荡器(VCO)设计高性能锁相本振源,将AD9910在基带产生的线性调频(LFM)脉冲调制信号经二次变频搬移到C波段,改善了输出信号的相噪和杂散,降低了系统的复杂性。实现了低相噪,低杂散,窄步进的C波段全相参雷达频综。结果表明,该频综在C波段输出LFM信号的幅度大于10dBm,频率步进为1kHz,相位噪声优于-103dBc/Hz@1kHz,各项指标均满足实际工程要求。 相似文献
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采用Σ-Δ调制小数分频器设计的频率合成器与传统的PLL(锁相环)频率合成器相比具有明显的优越性,它可以提供宽的频率范围、极高的频率分辨率、低的单边带相位噪声以及良好的杂散性能.介绍了利用该技术实现的小数分频频率合成器的原理和设计,并给出了设计结果. 相似文献
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通过采用直接数字合成与间接数字合成相结合的混合合成技术,实现了2~8 GHz宽带,1 kHz小步进输出.并做到杂散优于-65 dBc,相噪优于-95 dBc/Hz偏离载频1 kHz处的技术要求. 相似文献
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