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FPGA(Field Programmable Gate Arrays)作为现场可编程门阵列,其丰富的内部资源和强大的功能越来越受到应用者的青睐.随着FPGA规模的增大,其可靠性问题日益受到重视.因此,如何保证FPGA可靠性成为了FPGA生产厂商和应用人员需要共同面对的问题.从FPGA的可靠性这一重要性出发,针对Virtex系列XCV300芯片的故障测试,根据互联资源的特点,创新性地提出了针对IR和CLB资源的IR-CLB资源联合测试方法.实现了IR和CLB资源的同时测试,并且利用FPGA底层布线工具得到了实际测试配置图形. 相似文献
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研究了新型的FDP FPGA电路结构及其设计实现.新颖的基于3输入查找表的可编程单元结构,与传统的基于4输入查找表相比,可以提高约11%的逻辑利用率;独特的层次化的分段可编程互联结构以及高效的开关盒设计,使得不同的互联资源可以快速直接相连,大大提高了可编程布线资源效率.FDP芯片包括1600个可编程逻辑单元、160个可用IO、内嵌16k双开块RAM,采用SMIC 0.18μm CMOS工艺全定制方法设计并流片,其裸芯片面积为6.104mm×6.620mm.最终芯片软硬件测试结果表明:芯片各种可编程资源可以高效地配合其软件正确实现用户电路功能. 相似文献
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FDP FPGA芯片的设计实现 总被引:2,自引:2,他引:0
研究了新型的FDP FPGA电路结构及其设计实现.新颖的基于3输入查找表的可编程单元结构,与传统的基于4输入查找表相比,可以提高约11%的逻辑利用率;独特的层次化的分段可编程互联结构以及高效的开关盒设计,使得不同的互联资源可以快速直接相连,大大提高了可编程布线资源效率.FDP芯片包括1600个可编程逻辑单元、160个可用IO、内嵌16k双开块RAM,采用SMIC 0.18μm CMOS工艺全定制方法设计并流片,其裸芯片面积为6.104mm×6.620mm.最终芯片软硬件测试结果表明:芯片各种可编程资源可以高效地配合其软件正确实现用户电路功能. 相似文献
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为了提高现场可编程门阵列(FPGA)的资源利用率,在介绍FPGA重构技术的原理和分类的基础上,讨论了Virtex-4系列FPGA的配置原理和动态重构的方法,并设计出数字信号处理器(DSP)配置FPGA的硬件方案来实现可重构系统。FPGA采用SelectMAP配置方式,实现配置逻辑的快速重构和局部动态重构,最后根据Virtex-4的配置流程和时序关系,给出了可重构系统配置的软件流程。经实验测试,该系统稳定可靠,可在1 s内完成5 Mbyte配置程序的动态重构。 相似文献
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针对电子设备中现场可编程门阵列(FPGA)大量使用所带来的FPGA配置数据更新的需求,提出了一种基于嵌入式的多片FPGA配置数据更新技术.通过在FPGA内嵌入NIOS Ⅱ软核处理器来识别外部发送的配置数据,读写本地EPCS存储器,实现配置数据的更新.详细论述了使用Quartus Ⅱ SOPC Builder与Nios Ⅱ 9.0 IDE进行软硬件设计的过程,并与传统的FPGA配置方法进行了对比测试.测试结果表明这种技术应用更加灵活,效率高,易于在工程实际中实现. 相似文献
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介绍了一种基于现场可编程门阵列(FPGA,field programmable gate array)的高性能数模转换器(DAC,digital to analog converter)性能参数的回路测试方法。以FPGA、DAC和模数转换器(ADC,analog to digital converter)等元器件为硬件测试平台,将待测数字信号转换成模拟信号再转换成数字信号,经过Matlab计算和分析后得到DAC芯片的静态特性参数和动态特性参数。其中失调误差为0.036%,增益误差为3.63%,信号噪声比为58 dB,信号噪声及失真比为57.75 dB,无杂散动态范围为62.84 dB,有效位数为9.3。测试结果表明:测试方法通用性好,精确度高,成本低。 相似文献
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从传统的现场可编程门阵列(FPGA)配置方法入手,重点介绍了通过复杂可编程逻辑器件设备(CPLD)和片外Flash实现FPGA配置的方法,并给出了系统设计方案、硬件框图和软件流程图。 相似文献
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随着FPGA规模的不断增大和结构的日益复杂,FPGA的测试也变得越来越困难.由此提出了一种可配置的FPGA芯核扫描链设计,并讨论了基于扫描链的可编程逻辑模块(Configuration Logic Blocks CLB)测试.提出的扫描设计可以通过配置调整扫描链的构成,从而能够处理多个寄存器故障,且在有寄存器故障发生时,重新配置后能继续用于芯片的测试.基于扫描链的CLB测试,以扫描链中的寄存器作为CLB测试的可控制点和可观测点,降低了对连线资源的需求,可以对所有的CLB并行测试,在故障测试的过程中实现故障CLB的定位,与其它方法相比,所需配置次数减少50%以上. 相似文献
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针对Virtex-4型FPGA中可编程逻辑块故障检测的需求,提出了一种基于JTAG的内建自测试方法,并基于DEV++平台自行开发了基于并口的专用边界扫描测试软件.该方法可以比较可靠的检测FPGA中存在故障的可编程逻辑块,并能比较高的分辨率实现故障的定位.与传统的单故障检测方法相比,提出的改进型测试方法可以检测和定位多个故障CLB,并可以对故障类型进行诊断.实验结果表明:提出的测试方法可以精确的检测和定位存在故障的多个CLB,对具有类似结构的SRAM型FPGA具有普遍适用性. 相似文献
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