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针对合成孔径雷达实时成像处理中数据量大、数据吞吐率高、成像算法实现复杂等特点,设计了适合于无人机载SAR实时信号处理系统的硬件平台和实时信号处理算法流程。该信号处理系统包括一块带有AD采集功能的接口板和两块以TS201为核心处理器的信号处理板。考虑到实时性要求和无人机平台的不稳定性,设计了一种结合惯导和回波数据进行运动补偿的改进型RD成像算法。在无人机平台上成功稳定地实现大面积连续实时成像,证明信号处理系统稳定可靠,实时信号处理算法可行。 相似文献
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应用嵌入式信号处理技术,可使红外成像探测系统具备更高性能、更低功耗和更小体积.描述了以Xilinx公司VirtexⅡPro FPGA芯片为核心的红外成像跟踪嵌入式实时信号处理平台,采用了融微处理器、可编程硬件、信号处理算法和软硬件协同设计于一体的设计方法,为红外成像系统的更新发展打下一定的技术基础. 相似文献
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大视场红外成像探测系统实时信号处理技术研究 总被引:1,自引:1,他引:0
探讨了一种红外成像探测系统实时信号处理算法、硬件结构等关键技术.针对大视场红外探测系统,提出了适用于360°全方位红外目标搜索的实时处理算法原理和流程,并以高性能的数字信号处理器和FPGA芯片以及CPC I总线技术为核心设计了处理能力强、高速数据传输、接口可靠稳定的实时信号处理系统.实验测试表明,该系统工作稳定、可靠,满足总体性能要求. 相似文献
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主要对相对导航这一新型战术导航技术的工程实现进行了研究。为满足系统对相对导航处理器的要求,设计中对信号处理算法做了进一步改进,在硬件上采用TMS320CSO来实现电路。最后,在模拟器上对其性能进行了实时测试,实验结果表明:该处理器达到了设计要求。 相似文献
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针对GPS抗干扰问题,常用手段是在信号处理系统中采用自适应调零算法来实现抗干扰。结合该算法文中给出了一种信号处理系统的硬件实现方案。首先概述GPS自适应调零天线的系统结构,然后给出信号处理系统的硬件设计思路及其功能模块的实现,最后通过实测数据验证硬件模块可以满足自适应调零算法的要求。 相似文献
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本文首先建立了信道化发射机的数学模型,结合多速率信号处理技术对该模型进行了算法优化,推证和仿真了基于多相滤波结构的信道化发射机。在此基础上用Xilinx公司的Virtex-4系列FPGA实现了该发射信号产生模块的设计。设计中充分有效地利用了FPGA中的硬件资源,与传统的方法相比,结果表明该方法能以较低的运算复杂度更好地实现信号的实时处理。 相似文献
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介绍一种机载雷达信号处理系统的设计与实现,给出基于ADI公司TS101芯片的信号处理硬件整体结构和各个硬件模块间的接口设计,分析整个系统的软件架构,并对一些基本算法和处理方法作以描述. 相似文献
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针对当前系统设计中软硬件设计者分别采用不同的设计语言存在的问题,采用基于Python的软硬件协同设计方法,以信号处理和图像处理中常用的平方根算法为例,在FPGA上实现了定点平方根算法。实验结果表明Python可以有效地将软件算法快速地转换为硬件设计,并能大幅度提高系统设计,仿真和校验的效率,使得这种方法设计的产品能更快地进入市场。 相似文献
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针对目前PC算法无法实现图像实时处理以及固定硬件平台很难实现算法修改或者升级的问题,设计一种基于SOPC可重构的图像采集与处理系统,实现了图像数据的片上实时处理以及在不改变硬件电路结构而完成算法修改或者升级的功能。此系统围绕两块Xilinx FPGA芯片进行设计,通过FPGA以及其Microblaze 32 bit软核处理器和相关接口模块实现硬件电路设计,结合FPGA开发环境ISE工具和EDK工具协作完成软件设计。由于采用SOPC技术和可重构技术,此设计具有设计灵活、处理速度快和算法可灵活升级等特点。 相似文献
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Lashkarian N. Hemphill E. Tarn H. Parekh H. Dick C. 《IEEE transactions on circuits and systems. I, Regular papers》2007,54(8):1666-1677
A versatile digital front-end architecture is designed and implemented on field-programmable gate array (FPGA) technology. The architecture includes the digital up-conversion, and peak-to-average power ratio (PAPR) reduction blocks that are applicable to down-link data paths in multi-band wireless base stations such as WCDMA or Wimax systems. Transmitter linearity requirements are addressed and tradeoff analysis for design and optimization of the PAPR reduction algorithm within the context of the error vector magnitude and adjacent channel leakage ratio quality metrics are studied. Statistical characteristics of the clipping noise are analyzed and a novel method for clipping the multi-band signal under the phase invariant constraint is proposed. Our study also includes mapping of the signal processing algorithms onto Xilinx Virtex-4trade FPGA device and addresses the resource utilization and efficient hardware implementation of the above signal processing blocks. Performance assessments and hardware validation of the proposed architecture are also addressed. 相似文献
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基于并行FIR滤波器结构的数字下变频 总被引:1,自引:0,他引:1
对宽带信号进行并行处理,可同时满足低功耗和实时性的要求,已成为目前宽带信号处理的研究热点。本文提出了一种可在FPGA中实现的并行快速FIR滤波器设计方法。该方法通过应用并行多相处理技术中的一种新型分布式处理算法,在滤波器结构上实现了多级级联的形式,增强了中频处理的灵活性和通用性,节省了硬件开销。仿真结果表明,该算法很好的解决了原始低通滤波器速度跟不上A/D采样率的问题,把采样率提高到了320MHz以上。同时该方法应用软件实现并行信号处理,避免了使用DDC专用芯片,具有较强的通用性,可以很好的移植到其他CPLD中。 相似文献