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Σ-ΔADC近年来得到了广泛的应用.文中分析了Σ-ΔADC的结构组成,从过采样、噪声整型、数字滤波和抽取等方面,阐述其工作原理,并简要介绍了Σ-ΔADC在实际工程中的应用. 相似文献
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文章提出了一种新型的D类放大器的结构。D类放大器具有效率高的优点,因此在很多功耗低功耗设备中得到应用。但传统的D类放大器是开关型放大器,又是开环系统,所以不可避免的在输出信号中表现出较大的非线性,也无法抑制由于电源波动在输出级引入的噪声。在传统开环放大器的基础上同时引入Σ-Δ调制技术以及闭环系统的概念,可有效抑制了传统开环放大器的非线性,并减小由于电源波动在输出级引入的噪声。文章先以1阶Σ-Δ调制为例,理论分析Σ-Δ调制在闭环系统中对D类放大器非线性和噪声的抑制作用,然后以7阶Σ-Δ调制为例,用Simulink对系统进行建模和仿真,从而验证系统的正确性和有效性。 相似文献
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小数分频技术解决了锁相环频率合成器中鉴相频率和输出频率分辨率的矛盾。但一般的小数分频技术引入了严重的小数杂散问题。因为Δ-Σ调制技术对噪声具有整形的作用,把Σ-Δ调制技术应用在小数分频频率合成器中,与传统的PLL(锁相环)频率合成器相比具有明显的优越性,他可以提供很宽的频率范围、极高的频率分辨率、较低的单边带相位噪声以及良好的杂散性能。 相似文献
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Σ-Δ调制小数分频器合成器是在数字锁相小数分频频率合成技术的基础上,运用现代数字技术对小数分频频率合成而引入的相位杂散进行有效的处理,克服了用传统方法处理而带来的结构复杂、调试困难及成本较高等诸多难点,从而在军用和民用上都得到了广泛的应用.Σ-Δ调制小数分频器是Σ-Δ调制小数分频合成器的关键电路,文中给出了Σ-Δ调制小数分频器详细的数字电路结构,对其工作原理、系统结构及系统工作模式作了详尽的分析,最后采用ASIC实现了Σ-Δ调制小数分频器. 相似文献
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Δ-Σ调制技术是当前设计高性能模数转换器中被广泛使用的一种方法。其原理是利用噪声成型技术把带内的大部分量化噪声能量转移到所需的频带之外,从而提高了带内信噪比。它简单的结构和低廉的成本使其在许多领域都得到了广泛的应用。着重介绍了单比特Δ-Σ调制器的原理以及这种调制器的Matlab仿真。 相似文献
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本文简要介绍了脉冲阶梯调制器(Pulse-Step Modulator,PSM)在短波发射机上的作用,及其输出信号的在时域和频域的基本特点。Δ-Σ是delta-Sigma的简写形式,在数字信号处理领域,利用上采样滤波和Δ-Σ调制技术,能够使一个低动态范围的量化器输出高动态范围的信号。PSM调制器实际上也是一个低动态范围的大功率数模转换器。本文讨论了Δ-Σ调制技术用于PSM调制器控制中的线性模型和性能特点。 相似文献
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对Σ-ΔADc工作原理,过采样对PCM型、Σ-ΔADc的影响进行了讨论和分析,并进行了一些对比仿真。在此基础上,探讨了Σ-Δ调制在通信、雷达信号一体化接收机中的应用。 相似文献
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AD6140是AD公司生产的采用Σ -Δ调制的ADC中频集成电路芯片 ,适用于需要高动态范围和多个滤波器带宽的接收机。该器件被设计在Motorola的ReFLEX系统中 ,可用于FLEXRe FLEX接收机和多模式接收机中。文中介绍了AD607的原理、特点、性能参数和典型应用电路。 相似文献
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本文以30MHz带宽VDSL线路驱动器为设计目标,对1阶异步Σ-Δ调制(asynchronous sigma-delta modulation,ASDM)的D类线路驱动器进行了系统级设计,并在TSMC 0.25μm 3.3V CMOS工艺下完成了电路设计.对版图参数提取后仿真结果显示,在最慢工艺角(即ss工艺角)、125℃时,极限环频率可达到70MHz,在27MHz带宽内,输出信号幅值0.7V时的无杂散动态范围(SFDR)可达到63dBc. 相似文献
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介绍了一种适用于语音信号处理的16位24 kHzΣ-Δ调制器。该电路采用单环三阶单比特量化形式,利用Matlab优化调制器系数。电路采用SIMC 0.18μm CMOS工艺实现,通过Cadence/Spectre仿真器进行仿真。仿真结果显示,调制器在128倍过采样率时,带内信噪比达到107 dB,满足设计要求。 相似文献
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本文介绍了一个采用多比特量化的高性能音频Σ-Δ数模转换器。相对于单比特量化的Σ-Δ DAC来说,多比特量化具有调制器环路设计简单、时钟频率低、杂波小等优点;而由多比特量化引入的失配误差,可以采用DWA误差整形算法,将其转换为高频段噪声外推到信号带外,使带内的噪底降低到单比特量化的水平。为减弱数模串扰,进行了对每个模拟元件都加上保护环的创新尝试。采用上述技术在0.18μm混合信号CMOS工艺上实现了一个18位DAC,芯片面积1.86 mm2。测试结果表明,数模转换器的信噪失真比(SNDR)和动态范围(DR)分别达到88dB和96dB。 相似文献
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一种低电压工作的高速开关电流Σ-Δ调制器 总被引:1,自引:0,他引:1
基于作者先前提出的时钟馈通补偿方式的开关电流存储单元及全差分总体结构,本文设计了一种二阶开关电流Σ-Δ调制器.工作中采用TSMC 0.35μm CMOS数字电路工艺平台,在低电压工作下进行电路参数优化.实验表明,调制器在3.3V工作电压、10MHz采样频率、64倍过采样率下实现10-bit精度.与已有类似研究相比,本工作在相当的精度条件下,实现了低电压、视频速率的工作. 相似文献