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《固体电子学研究与进展》2014,(5)
分析了锁相源的相位噪声构成,并在此基础上建立了两路相关锁相源混频相位噪声的近似数学模型,推导了相应的相位噪声的计算式。通过实验及对实验数据的分析表明,该数学模型与实际实验结果一致,大幅度减小了相位噪声估计的偏差。该数学模型能有效的指导复杂频率源的设计及相位噪声的估算。 相似文献
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提出一种单路单载波卫星通信地球站终端设备中各锁相源相位噪声的分配方法,并联系地球站终端设备的研制任务给出一个实例。 相似文献
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文章较详细地介绍了用切泛音晶体制作的卫星通信地面站中微波频率合成器作标准源用的110MHz锁相标频源的优化设计。阐述了设计思想,关键部件的设计考虑及其具体的电路设计等问题,给出了关键部件晶体压控振荡器电路图及锁相标频源的实测结果及数据,该电路性能指标满足要求。 相似文献
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针对高的相位噪声指标要求,对取样锁相介质振荡器进行了研究.通过相位噪声分析,明晰了采用介质振荡器与取样锁相技术降低相位噪声的机理,并分别对介质振荡器与锁相环路进行了设计.设计中,应用HFSS与ADS对介质振荡器进行了联合仿真,体现了计算机辅助设计的优势.最终研制出17 GHz锁相介质振荡器,测试结果为:输出功率13.1 dBm;杂波抑制>70 dB;谐波抑制>25 dB; 相位噪声为-105 dBc/Hz@1 kHz,-106 dBc/Hz@10 kHz,-111 dBc/Hz@100 kHz,-129 dBc/Hz@1 MHz. 相似文献
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低相位噪声信号的谱线宽度 总被引:1,自引:0,他引:1
提出了由相位噪声计算信号谱线宽度的计算公式,从而计算出脉冲多普勒雷达频综器输出的激励信号的谱线宽度,并且发现低相位噪声信号的谱线宽度是通用仪表所不能精确测量的. 相似文献
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A low phase noise quadrature oscillator using the new injection locked technique is proposed.The incident signal is directly injected into the common-source connection of the sub-harmonic oscillator.In principle,the phase noise performance of the quadrature output is better than the sub-harmonic oscillator itself.The quadrature oscillator is implemented in a 0.25μm CMOS process.Measurements show the proposed oscillator could achieve a phase noise of -130dBc/Hz at 1MHz offset from 1.13GHz carrier while only drawing an 8.0mA current from the 2.5V power supply. 相似文献
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X. D. Jia G. F. Niu R. M. M. Chen 《Analog Integrated Circuits and Signal Processing》2000,23(1):65-76
Circuit designs of sinusoidal switched-current oscillators (SIOs) both single phase and multiphase are presented. First, a novel SIO is proposed. This SIO features simpler configuration and hence fewer transistors and connections, and faster building up of stable oscillation amplitude than those proposed in earlier works. Then, new design schemes of multiple-phase sinusoidal SIOs are introduced. Both even and odd phase SIOs can be implemented using the schemes described. Finally, cascode techniques, S
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I memory cell, dummy switches and balanced structure are applied to our SIOs to get high precision SIOs. The circuit operations of all SIO proposed have been validated by transistor level SPICE simulations. 相似文献
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针对一种应用于跟踪雷达的基准信号模块低相噪设计的关键因素,进行了设计、分析与计算,给出了分析思路以及实物测试结果.经测试,模块输出信号4.2 GHz的相位噪声为-128.6 dBc/Hz@1 kHz,12.9 GHz的相位噪声为-121.6 dBc/Hz@1 kHz,目前,该模块已在跟踪雷达中得到了良好的应用. 相似文献