DDS的频谱研究

直接数字合成技术自出现以来得到了广泛的应用。从理论上分析了直接数字合成频谱杂散的来源,运用信号处理理论推导出其频谱分布的特点。     

DDS的频谱分析及一种新的ROM压缩方法

首先介绍了直接数字频率合成(DDS)技术的基本结构和理想情况下DDS的输出信号频谱特性,然后分析了实际应用中DDS杂散信号的主要来源,总结出杂散分布规律,尤其对相位截断时杂散信号的频谱特性进行详细的研究,并利用MATLAB进行仿真验证,给出了仿真结果,最后对一种新的数据压缩方法进行了分析和研究,从而改善了杂散频谱质量.     

DDS合成信号的频谱杂散性分析

直接数字式频率合成技术作为一种全数字系统,在硬件方面具有许多优点。但是受奈奎斯特定理、自身的结构缺陷以及目前数字器件工作速度的限制,DDS输出频率较低、杂散性能不够理想,在应用上受到了一定程度的限制。对DDS进行误差分析对于提高系统性能具有重要意义。介绍直接数字频率合成技术的原理,针对相位截断误差,对DDS合成信号的频谱杂散性进行了详细的理论分析,得到采样点数N与截断部分分母M与信噪比的关系曲线,给出了定量分析结果。并结合应用实践,讨论了不同因素对信噪比的影响,提出提高信噪比的方法和思路。     

一种降低DDS相位截断误差的方法

分析了直接数字频率合成技术(Direct Digital Synthesizer,DDS)的工作原理及其频谱特点,在此基础上介绍一种可降低相位截断误差引起的杂散的DDS新结构,并给出MATLAB对设计方法进行仿真的结果。     

一种捷变DDS频率合成器的设计

介绍了一种基于DDS(直接数字合成)技术的频率合成器。该频率合成器能够根据外部的参数设置完成任意频率(频率范围0．023Hz--35MHz)、多种模式(调频、调相及调幅等)的正弦波以及方波等波形输出。实验结果表明，该频率合成器输出的信号幅度稳定，具有频谱纯度较高、频率分辨率高以及频率捷变时间短等优点。     

DDS频谱分析及一种新型的改善方法

从理论上分析了DDS频谱杂散的来源和特点,在此基础上讨论了一种新的DDS结构,采用扰码技术来抑制DDS相位舍位杂散,并且用计算机模拟表明这种新结构大大的消除了DDS的相位舍位杂散。     

DDS相位舍位杂散信号的频谱分析

杂散特性限制着直接数字频率合成（DDS）技术的应用和发展,其中相位舍位、幅度量化和DAC的非理想特性等是影响DDS输出频谱质量的主要杂散源。文中主要研究相位舍位对DDS输出频谱的影响,首先通过离散傅里叶变换将任意的频率控制字转化为频率控制字为1来对DDS的输出信号进行频谱分析,然后由DDS的输出序列入手深入研究了相位舍位时DDS输出频谱的特性,得到的DDS输出频谱的数学模型精确、简单。     

DDS自动测试技术研究

重点研究了如何快速又精确地输出DDS的测试值并使测试值符合测试规范.基于NI卡板、信号分析仪、示波器和信号发生器,对DDS的特性参数进行测试研究.信号发生器提供时钟信号与比较器输入;信号分析仪对频域和调制域信号进行测试;示波器对时域信号进行测试;通过IabViEW编程得到DAC数字正弦波和输入数字码并实现测试自动化;最后将结果返回计算机,测试结果符合规范.实验证明,在实际应用中该方法快速精确并具有很好的通用性,可拓展到其他芯片的测试.     

基于DDS的低相噪频率综合源设计

分析了相位累加器截断、波形ROM有限字长、DAC等对直接数字频率合成器(DDS)相位噪声的影响，得出了DDS芯片本身对输出信号相位噪声影响很小的结论。给出了采用AD9854芯片构成的低相噪频率综合源的硬件组成以及系统实测的相位噪声、杂散技术指标。     

DDS幅度量化杂散信号的频谱研究

杂散特性是影响DDS应用和发展的主要因素之一。文中对两类DDS幅度量化杂散信号的特性进行了分析和对比，在此基础上着重对无相位截断杂散时的幅度量化杂散信号进行了DFT分析和波形分析，得到几个关于其频谱特征和功率水平的重要结论，并通过计算机仿真考查了各种DDS参数对信杂比的影响。     

DDS谱质分析及其杂散抑制研究综述

简介了ＤＤＳ工作原理,总结了关于ＤＤＳ杂散噪声来源的分析及其相关的研究结论,概述了近年来ＤＤＳ杂散抑制研究的有关方法,介绍了ＤＤＳ一些新的结构改进设计和应用。     

利用DDS实现CDMA/FH扩频

本文阐述了跳频扩频的基本原理，进而提出了一种利用直接数字频率合成（ＤＤＳ）实现ＣＤＭＡ／ＦＨ的方法，最后给出了实验电路及测试结果     

DDS的输出杂散及抑制技术

文章列举了造成DDS输出杂散的主要来源,针对累加器相位截断造成的DDS输出信号误差进行分析,并应用适当的随机序列累加到DDS的相位序列中,从而将周期性误差序列造成的幅度较大的杂散变成均匀分布的宽带噪声,在一定程度上改善了DDS的输出频谱。     

CPLD实现DDS信号源的设计

利用CPLD在高速数据处理方面的特点设计出以VHDL硬件描述语言为设计输入,以ALTERA公司的EPM7256芯片为设计载体,基于DDS技术的任意波形信号发生器。该信号发生器能同时输出两路信号,输出信号的频率和两路输出信号之间的相位差可以步进调整。通过Max Plus开发软件的时序分析表明,该设计具有高精度的频率和相位调节能力,相位调整的分辨率为12位,频率调整的分辨率为32位。实测结果表明,所讨论的方法和研制的系统是可行的、有效的。     

基于FPGA的DDS信号发生器设计

介绍基于DDS的信号发生器工作原理和设计过程,并对关键模块及外围电路进行了仿真和误差分析.经功能验证和分析测试,达到了预定的各项技术指标.旨在建立一种以FPGA为核心,功能可裁剪、波形任意调整的高性能信号发生器设计方法.采用该设计法将有效地降低开发成本,提高设计效率,并具有一定的工程指导意义和实用价值.     

基于FPGA的单片移相信号发生器的设计

介绍了以FPGA为核心器件,采用Verilog HDL作为硬件描述语言的移相信号发生器的设计。该移相信号发生器以DDS模型作为基本原理,利用FPGA的嵌入式存储器块作为波形数据的存储单元,最终通过D/A转换单元可输出正弦波、三角波、方波等任意波形的同频率原始参考信号和移相信号两路波形,除D/A转换器及相关电路外,所有功能电路模块均集中在一片FPGA中实现。与传统移相信号发生器相比,该设计的频率分辨度高、信号频谱良好、易于实现且成本低廉。     

利用DDS镜像频率的宽带信号源设计

提出了一种新方法,利用DDS(直接数字频率合成)器件的镜像输出频率分量,实现了常规DDS合成器方案所无法实现的超越奈奎斯特频率限制的信号频率输出,且易于实现高精度的载波频率控制和数字调制功能;实验原型电路采用了ALC(自动电平控制)技术补偿镜像和基频分量的衰减.实现了10 Hz～500 MHz的宽带信号输出,带内波动小于1 dB.     

基于DDS的信号发生器的设计与实现

介绍了DDS(直接数字频率合成器)芯片AD7008的结构、功能和利用89C51单片机控制AD7008和输出电路CD4052及作为与用户交互的信号发生器的设计,讨论了频率和相位控制字的计算方法以及标准正弦信号、调幅和调频信号产生方法,给出了硬件电路和软件流程.