共查询到18条相似文献,搜索用时 93 毫秒
1.
2.
3.
基于MATLAB与FPGA的FIR滤波器设计与仿真 总被引:1,自引:0,他引:1
数字滤波器是数字信号处理领域内的重要组成部分。FIR滤波器又以其严格的线性相位及稳定性高等特性被广泛应用。本文结合MATLAB工具软件介绍了FIR数字滤波器的设计方法,并在Xilinx的FPGA器件上完成设计实现。最后,使用MATLAB和ModelSim软件对数据进行了分析,证实了设计实现的正确性与可行性。 相似文献
4.
FPGA在数字信号处理中的应用 总被引:2,自引:0,他引:2
数字信号处理在许多领域内具有广泛的用途,现场可编程逻辑门阵列(FPGA)器件为数字信号处理提供了另外一种解决方案,FPGA和DSP技术相结合,能够在集成度、速度和系统功能方面满足数字信号处理的需要。本文讨论了快速加法器、快速乘法器和FIR滤波器在FPGA中的设计方法。 相似文献
5.
6.
现场可编程门阵列(FPGA)器件广泛用于数字信号处理领域,而使用VHDL或VerilogHDL语言进行设计比较复杂。提出一种采用FDATOOL工具和DSP Builder实现FIR滤波器的设计方案,按照MATLAB/Simulink/DSP Builder/QuartusII设计流程,使用FDATOOL工具可以实时调整滤波器的参数,采用DSP Builder设计了一个16阶FIR低通滤波器模型,并完成了仿真与验证,将模型转换生成VHDL代码,实现了基于FPGA的数字滤波器的设计。结果表明,该方法简单易行,易修改与移植,可满足设计要求,它验证了采用DSP Builder实现数字滤波器设计的独特优势。 相似文献
7.
基于FPGA的FIR滤波器的设计与实现 总被引:3,自引:1,他引:2
提出了一种基于FPGA的FIR滤波器设计方案.介绍了基于FPGA的FIR滤波器的数字信号处理的算法设计,采用直接型的基本结构来设计,通过1位乘以8位的乘法,然后再移位相加的方法即可得到结果,其运算效率明显提高,并结合先进的EDA软件进行高效的设计和实现,并给出了用Max+PlusⅡ运行的仿真结果.该设计对FPGA硬件资源的利用高效合理,用VHDL编程,在FPGA中实现了高采样率的FIR滤波器. 相似文献
8.
9.
分布式算法在FIR数字滤波器实现中的应用 总被引:2,自引:1,他引:1
文章提出了一种利用FPGA实现FIR数字滤波器的设计方案,在设计过程中应用了分布式算法(DA).FPGA有着规整的内部逻辑阵列和丰富的连线资源,特别适合于数字信号处理任务.分布式算法(DA)是一项重要的FPGA技术,它使得在FPGA中实现FIR滤波器的关键运算--乘加运算,转化为了查找表,大大提高了FIR滤波器的速度.文中给出了VHDL语言编写的程序和仿真波形. 相似文献
10.
一种FIR滤波器的FPGA实现 总被引:4,自引:0,他引:4
数字滤波是语音与图像处理和模式识别等应用中的一种基本的数字信号处理部件。文中提出了一种采用FPGA器件并利用窗函数实现线性FIR数字滤波器的方案,使用Xilinx公司的XCS10FPGS器件设计了一个8阶8位FIR滤波器,阶数和位数以及滤波器特性均可方便地更改。 相似文献
11.
12.
13.
根据SDH数字微波通信系统高阶QAM解调器的设计要求,针对数字化基带滤波的信号处理特点,提出一套高速匹配滤波器的FPGA实现方案。首先基于窗函数设计法,完成了滤波器的软件设计和仿真;然后基于QuartusⅡ6.0开发平台,采用并行流水结构和Verilog HDL语言参数化设计法实现滤波器FPGA设计;最后结合QuartusⅡ和Matlab,从时域和频域验证滤波器性能。实践表明此方法设计的滤波器效率高、方便调试,具有较好的重用性和可移植性。 相似文献
14.
15.
基于CSD算法的高阶FIR滤波器优化设计 总被引:1,自引:0,他引:1
在通信或雷达领域的高速实时信号处理中,通常包含大量的高速高阶FIR滤波器的设计。例如在雷达信号处理中,要进行数字正交采样和脉冲压缩器的设计,要求滤波器速率高,阶数大,运算量非常大。若使用DSP芯片则需多片处理完成,使得系统的工作延迟长、成本高、功耗大、调试困难。该文根据CSD(Canonic Signed—Digital)算法的思想,实现了高阶高速FIR滤波器的优化设计。该算法可显著降低算法的运算量,可用可编程逻辑器件迅速快捷地完成系统的硬件设计。文中举例用Altera公司的FPGA来实现数字正交采样和脉冲压缩滤波器算法优化,进行了实验验证,最后给出了结果比较和分析,证明这对基于FPGA的高阶FIR滤波器的设计有实际意义。 相似文献
16.
在CDMA2000系统中,信道是经过QPSK四相扩频正交调制传输的,数字中频与模拟中频相比能产生严格的幅相平衡正交信号,处理时能保证有严格的线性相位,为此介绍了CDMA2000系统数字中频调制解调实现的方案,对其中抗混叠滤波器,数字频率合成器的设计方法进行了详细的讨论,最后给出了用基于高密度逻辑门电路可编程集成片编辑器(FPGA Compiler)实现的结果。 相似文献
17.
The polyphase filter approach to quadrature demodulation is shown to be well suited for the implementation of purpose-designed wide bandwidth digital quadrature demodulators. The duplicated polyphase filter approach is introduced, as a way to increase the maximum allowable input signal bandwidth for a given implementation technology. Other algorithmic and architectural considerations specifically applicable to the realization of digital filters in low-cost Field-Programmable Gate Array (FPGA) technology are discussed. A design example suitable for processing input signals centered on an intermediate frequency of 160 MHz with a bandwidth of 45 MHz is presented. This design occupies 83% of the Configurable Logic Blocks (CLBs) in a low-cost Xilinx X4010E-3 FPGA. Additional techniques for further performance optimization are presented. 相似文献
18.
本文提出了一种高速实时信号多相位分解滤波方法,讨论了多相位分解滤波的基本原理、设计及FPGA实现,给出了多相位分解滤波算法的实现方案。在现有FPGA器件上实现了多相位分解滤波算法,可满足信号实时处理需求。 相似文献