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为满足市场需求,提高读写器读写效率,降低成本,提出了一种基于ISO/IEC 18000-6C的射频身份识别(RFID)读写器方案.该读写器适用于超高频段,支持跳频,发送通路来用射频发送芯片,接收回路采用相关解调,用分离元件搭建,成本较低,结构简单,易于实现.采用随机槽时隙陈计数器算法进行防碰撞设计,在多标签环境下能够识别标签,并与其成功通信.相对于采用传统随机碰撞算法的读写器,此读写器能够在多标签环境下顺利读取标签,防碰撞性能具有一定提高. 相似文献
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设计出一种超高射频识别系统(UHF RFID)读写器设计的新方案。该读写器采用了Intel R2000收发器芯片、AT91SAM7S256微控器,方案符合ISO 18000-6C和EPC global Gen2标准,工作频率为840~960MHz,标签识别距离可达10m。重点给出了读写器硬件系统组成和软件工作流程,同时介绍了相关射频电路。 相似文献
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提出了一款应用于超高频段(Ultra High Frequency,UHF)(912 ~935 MHz)的射频识别(RFID)读写器圆极化单层结构微带天线,基板采用FR4 板材达到价格低廉、辐射贴片采用开槽的结构实现小型化、接地板采用开槽结构提高天线的增益,该天线实现了小型化设计,满足了天线的设计要求。利用三维电磁仿真软件对天线模型进行了分析,仿真与测试结果吻合良好。天线测试结果表明:回波损耗小于-10 dB 的阻抗带宽为25 Hz(910 ~ 935 MHz),轴比(AR)小于3 dB的带宽为21 MHz(914 ~935 MHz);在UHF 频段内,读写器天线的最大增益为-1.2 dB,所以本天线能满足我国射频识别读写器的应用要求,具有良好的应用前景。 相似文献
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为了解决超高频射频识别读写器在碰撞时隙标签无法识别的问题,本文遵循ISO18000-6C协议标准设计了一款高性能的超高频读写器系统,并对读写器的主要性能指标进行了仿真与测试,最后验证了设计的可行性.本系统采用模块化设计,系统工作频率为860-960 MHz,输出功率可达+30 dBm.通过引入新型防碰撞算法,使得读写器在碰撞时隙也可以一一识别标签,相比于现有读写器,标签的识别时间降低了约29%,标签识别率提高了约25%. 相似文献
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超高频RFID读写器基带处理器的设计 总被引:1,自引:0,他引:1
为实现单芯片的超高频读写器,提出了一种读写器基带处理器的设计方案.设计采用了微处理器IP核在AFS600上搭建一个读写器数字基带,在原本不支持调试模式的微处理器上扩展了片上调试功能,为集成开发环境Keil开发出动态链接库实现了对数字基带的在线调试.为实现ISO/IEC 18000-6C协议,用硬件实现了收发通路原型,并在AFS600平台上完成了FPGA验证.设计采用TSMC 0.25 μm Embedded Flash工艺完成了芯片的版图设计.该基带处理器实现了读写器基带和标签的正常通信,为最终实现单芯片读写器创造了条件. 相似文献
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随着RFID系统在自动识别领域的广泛应用,各种安全问题逐渐显露,对于低成本RFID系统,尽可能降低硬件电路开销是降低成本的关键.选择XTEA算法作为安全验证过程中的加密算法,并将其嵌入ISO18000-6C协议.在设计过程中,考虑了4种不同的方案,针对时间、面积和功耗进行了优化,最终实现的加密电路等效规模约2 600门,在时钟频率为250 kHz时,使用5鹏即可完成安全机制中的认证操作.用Primepower对电路进行功耗分析,功耗约为16.3 μW. 相似文献
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在分析ISO18000-6C标准内容的基础上,提出了一种基带处理器的结构,设计了一款符合ISO18000-6C标准的UHF RFID标签芯片的基带处理器。该基带处理器可支持协议规定的所有强制命令。设计通过降低工作电压、降低工作频率、使用门控时钟、增加功耗管理模块等一系列低功耗设计以降低处理器的功率消耗。在Xillinx的Virtex-4FPGA上验证满足协议功能要求,并在工作电压为1V,时钟为1.92MHz时,功耗仿真结果为9.9μW,很好的完成了低功耗电子标签的基带处理器设计。 相似文献
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设计了一种基于AS3992的手持式超高频RFID阅读器。阅读器的射频收发电路由AS3992内部集成的射频模拟前端和协议处理系统构成,基带控制由S3C2440建立的最小系统实现。对AS3992射频模块电路进行了介绍,针对天线设计了阻抗匹配电路,对S3C2440外围电路进行了设计,同时设计了Linux系统下各硬件的驱动程序以及应用程序,最后对设计的阅读器进行了测试分析。结果表明,阅读器能支持ISO/IEC 18000-6C协议,并且具备了可手持、发射频率可调、功能易扩展等特点,满足智能物联网市场的需求,有非常好的应用前景。 相似文献