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数字闭环方案可以减小模拟伺服方案中A/D转换环节所引入的精度损失,而量化误差是影响数字闭环石英挠性加速度计系统精度的重要因素之一。介绍了数字闭环石英挠性加速度计检测系统的工作原理,讨论了AD,DA位数的选择依据,基于现有硬件检测电路,软件上采取AD,DA降位使用的方法分析量化误差对闭环系统精度的影响。搭建数字闭环实验系统,实验结果表明:在一定范围内,随着AD,DA位数的降低,量化误差影响增大,闭环系统精度降低,与理论分析相吻合,为数字闭环加速度计的精度改善提供必要的理论指导和实验基础。 相似文献
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数字闭环加速度计可以解决传统模拟加速度计在输出电流到数字量(I/D)转换中带来的精度损失问题,而为实现数字闭环需将加速度计表头进行离散化.针对这一问题提出了一种表头离散化方法,将石英摆片、采样开关与零阶保持器整体离散化.建立数字闭环系统离散域数学模型,基于此模型进行仿真研究,仿真表明:此离散化方法可行,系统阶跃响应超调在10%左右,闭环带宽达到300 Hz以上.将其应用在数字闭环加速度计的实验系统,验证了仿真结果,为数字闭环加速度计的深入研究提供必要的理论指导和实验基础. 相似文献
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为了进一步抑制加速度计信号带宽范围内的噪声,提出并设计了一种基于∑-△M的五阶多反馈谐振式(MFLR)微机械加速度计闭环控制系统,该系统通过增加额外的内部负反馈对量化噪声进行再一次整形.微机械加速度计结构为一种全差分式结构,在结构层厚度为60 μm、基底层厚度为400μm的SOI硅片上,经过光刻、溅射、深度反应离子刻蚀等工艺步骤加工而成.整个闭环控制系统的Matlab/Simulink模型首先被建立,然后采用“单位圆分析法”进行系统参数的设定,系统仿真显示:当输入幅值1gn、频率128Hz的加速度信号时,加速度计的噪声为-136.2 dB,与传统五阶MF结构的∑-△M闭环控制系统相比,在0 ~500 Hz信号带宽范围内的噪声降低了7.9dB.最后整个系统在四层PCB电路板上进行了功能性验证和测试. 相似文献