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确定非正常触发主从JK触发器次态的一种简单方法 总被引:1,自引:0,他引:1
通过对非正常触发时主从JK触发器可能出现的工作波形的详细分析,归纳出了非正常触发时确定主从JK触发器次态的简单方法。 相似文献
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对主从型 D触发器的功能及时序进行分析 ,证明了该类型触发器无效功耗的存在 ;文章建立了无效功耗的数学模型 ,并通过对典型应用电路的理论推导和计算机模拟 ,验证了这一结论的正确性。分析无效功耗的目的是为了采取措施消除其影响 ,文中提出的数学模型对低功耗 VL SI设计有着重要的价值。 相似文献
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Ron Patrick 《电子设计技术》2000,(1)
我们在教科书中看到的经典的施密特触发电路具有一定的抗噪声的能力,例如在位置传感电路(图1(a))中用作磁性敏感头前端的施密特触发电路。我们可以用R_1和R_2,或者用R_2,和 相似文献
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提出了一种低功耗的绝热JK触发器电路。在绝热AERL(Approved Energy Recovery Logic)反相器电路的基础上,提出了AERL反相器级联及AERL JK触发器的实现方法。在0.5微米PTM工艺下用Spice工具对提出的电路进行了模拟仿真。结果显示与传统的CMOS JK触发器和ECRL JK触发器相比,AERL JK触发器具有更低的功耗。 相似文献
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同步JK触发器是“数字电路与逻辑设计”课程中重要的一种触发器单元。但目前教材给出的同步JK触发器的翻转状态是值得商榷的。关于同步JK触发器的仿真方面,网上的一些资料较为混乱,很多资料上对于JK触发器直接采用教科书上的结论进行行为级建模,虽然避免了初始状态的影响,但并不能真正反应JK触发器的真正功能。也有人采用与非门例化的方法对其进行门级建模,但仿真输出一直为一个不确定的状态。本文通过加入复位信号,使得触发器的当前状态为一个确定状态,从而能正确仿真。仿真和分析表明,翻转状态是值得商榷的,教科书也应据此进行更改。 相似文献
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根据JK触发器在每个时钟脉冲作用时间内,其状态只变化一次,而且不同引脚都可以使触发器状态发生改变的特性,给出了用JK触发器来设计抢答器的设计方法及仿真,同时给出了用74LS112JK触发器设计抢答器的最优设计方法及思路。 相似文献
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提出了一种具有在输出的三值维持阻塞JK触发器电路,描述了该触发器电路的设计,对由TTL门电路组成的试验电路进行了计算机模拟和测试,结果表明,该触发器能实现预定的功能。 相似文献
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具有抗差分能量攻击性能的JK触发器设计 总被引:2,自引:0,他引:2
通过对传统触发器结构和旁道攻击密码系统原理的研究,提出一种具有抗差分能量攻击性能的JK触发器设计方案。首先,根据双轨预充逻辑电路交替处于预充阶段与求值阶段的特点,结合触发器的特征方程,推导出具有抗差分能量攻击性能的JK触发器的状态方程;然后,根据场效应管宽长比对数据传输速率的影响,采用灵敏放大型逻辑,得到相应的触发器电路结构。HSPICE模拟验证表明,所设计电路具有正确的逻辑功能。与传统JK触发器比较,该结构具有显著的抗差分能量攻击性能。 相似文献
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触发器是数字电路的基本逻辑单元之一,也是构成各种时序电路的最基本逻辑单元。文中给出了基于JK触发器来设计十二归一计数器的设计和实现方法,并通过EWB软件进行了仿真。 相似文献
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TTL JK边沿触发器在CP脉冲边沿会出现输出状态异变现象.本文分析了异变的原因,提出了对CP脉冲上升时间和下降时间的要求条件. 相似文献
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Tom Bruhns 《电子设计技术》2008,15(11):116-116
图1中的新颖电路表示出当代典型的功率MOSFET有极低的栅极泄漏电流。你会发现,在适当干燥的环境中,这些器件可以保持自身状态数天之久。工作中,如果MOSFET Q1关断,负载(也许是一个灯或蜂鸣器)将Q1漏极拉到接近12VDC电源电压。R2将C1充至接近相同电压。 相似文献
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周润文 《电气电子教学学报》1991,(4)
分析时序电路在写出状态方程组之后,过去采用代入法列出状态表,对于有m个状态量的电路,有m×2~m个方程式待代入计算,而且“0”与“1”两个数码重复出现是枯燥的,易出现疲劳错漏,且难以校核.另外,所列的状态表往往按二进制排列,翻译成状态图或时序图查阅亦费力. 相似文献