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随着集成电路技术的快速发展。处理器的速度越来越快,存储器的性能越来越好,单芯片上集成的功能部件越来越多.但是处理器跟存储器之间以及存储器跟外设之间的瓶颈却越来越严重。直接存储器存取(Direct Memory Access,DMA)方式是大多数处理器中普遍采用的提高数据传输速率的方法之一。在分析了多种高性能处理器中DMA控制器工作原理的基础上.采用系统级设计语言SystemC,设计并实现了一个多功能的可配置多通道DMA控制器。 相似文献
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设计了一种基于PXI接口、双通道12位、采样速率250 Msps的高速数字化仪模块,给出该系统的工作原理、设计思想和实现方案,系统采用双通道A/D转换器进行采样,使用高性能FPGA器件进行通道控制、数据处理和接口设计,具有功能强大的前端调理电路,可以选择匹配阻抗和耦合方式、具有增益自动调整功能,满足大范围信号的测量要求.从硬件和软件两个方面对高速数据采集、传输和存储的关键问题进行了深入探讨.该数字化仪模块可方便的与其他PXI仪器组成测试系统,实现对信号的高速采样和长时间记录. 相似文献
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本文根据光点扫描测量技术,提出一种新型的激光数字化光学探头,它是利用小型半导体激光器和高分辨率光电探测器件CCD设计而成的。它可对自由模具表面进行快速的、非接触的、精密的测量,提取三维NC(numerical control)数据。其光学系统设计使用了针对特殊光路编写的光学CAD软件。 相似文献
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针对DMA数据传输中读写操作互斥及互锁问题,本文提出了一种基于AHB总线的流水化DMA控制器设计方案.通过内嵌两个AHB主机和数据缓冲区,实现了数据读写操作并行;通过多通道设计,避免了读写访问不能同时结束时的额外传输等待时间,使读写操作更独立.该设计与现有的DMA控制器相比,缩短了数据传输延迟,提高了数据传输效率,实现了全双工流水传输. 相似文献
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介绍了一种基于LXI总线数字化仪模块的总体设计方案。该数字化仪模块以FPGA和DSP作为采集控制和信号处理核心单元,兼容两种标准频率中频信号的采集与数据处理,采用基于IEEE1588精密时钟协议提供的时间基准进行精确定时触发。软件系统在WindowsNT平台上实现,开发了基于Lab Windows/CVI的虚拟仪器软面板,保证了模块运行的稳定性和人机界面的友好。本数字化仪模块的特点在于该模块在高性能FPGA的控制下实现两种中频信号采集,最高采样频率可达130MHz,可靠性、稳定性好,具有较好的实用价值。 相似文献
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提出了利用MC143150 Neuron芯片和Burr-Brown公司生产的12位串行模数转换器ADS7844实现多通道A/D转换控制模块的设计与实现方法。介绍了MC143150 Neuron芯片和12位串行模数转换器ADS7844的硬件结构与工作原理,以及运用Neuron C语言开发多通道A/D转换控制模块,对数据转... 相似文献
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多通道数字可调光衰减器模块的设计与实现 总被引:1,自引:0,他引:1
设计了一种基于电控可调光衰减器(EVOA)的多通道数字可调光衰减器模块,该模块集成多达32通道的光衰减器,可根据需要灵活进行配置,并采用了通用的I2C通信接口,非常方便和简单地应用于系统设备中.该模块克服了EVOA电压衰减非线性的缺点,衰减精度高,而且保留了EVOA的光学特性. 相似文献
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Byung Lee Chong Un Hyeong Lee Byoung Shin Hwang Lee 《Communications, IEEE Transactions on》1983,31(6):775-783
In this paper, implementation of a compact and efficient multirate speech digitizer with variable transmission rates of 2.4, 4.8, 9.6, and 14.96 kbits/s is presented. The multirate algorithm has been made based on the residual-excited linear prediction (RELP) vocoder with a transmission rate of 9.6 kbits/s. The residual encoder employed in the RELP vocoder uses hybrid companding delta modulation (HCDM). This HCDM is also used as a 14.96 kbit/s coder. If the residual in the RELP system is down-sampled before encoding, a 4.8 kbit/s coder can be realized. If the residual encoder is not used, a 2.4 kbit/s linear predictive coder (LPC) can be realized by incorporating a pitch extractor. In the 4.8 and 9.6 kbit/s coders the pitch-implanted residual excitation method has been used to generate the excitation signal to the synthesis filter. The multirate speech digitizer algorithm has been implemented using 2900 series bit-slice microprocessors. The external memory is composed of 2K RAM's and 2K ROM's. The system design is a two-bus structure with a 204 ns cycle time. With efficient hardware and software design, the multirate speech digitizer requires almost the same hardware complexity as compared with the conventional 2.4 kblt/s LPC vocoder. 相似文献
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基于混合微波集成电路技术(Hybrid Microwave Integrated Circuit, HMIC)设计了一款Ka 波段多通道
收发组件。该收发组件由四路接收链路、两路发射链路、衰减控制模块、锁相介质振荡器(Phase-locked Dielectric Resonator
Oscillator, PLDRO)和电源模块组成。测试表明,该组件发射功率可达36 dBm,接收增益最大可达70 dB,接
收链路可以实现0~62 dB 的增益调控,发射链路可以实现0~31 dB 的增益调控,通道间隔离度可以达到80 dBc,实
现了大功率、高增益、大动态增益范围的技术要求,具有较高的工程应用价值。 相似文献
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