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MOSD晶体管自1962年发明以来,在短短十年中,经历过MOS晶体管、MOS集成电路、MOS大规模集成电路这样三个阶段。实际上由于MOS集成电路工艺与MOS晶体管相同,所以可以说MOS集成 相似文献
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电过应力是造成MOS集成电路损伤的主要原因,本文结合静电放电的三种模型,详细分析了MOS集成电路电过应力的损伤模式和机理。 相似文献
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互补金属——氧化物——半导体集成电路(Camplementary Mos Integrated Circuits),它是把P型沟道及N型沟道MOS晶体管制作在同一片子上来构成的电路。单沟道(P型或N型沟道)MOS集成电路多半是使用MOS晶体管作为负载电 相似文献
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智能化功率集成电路是当令国际上正在迅速发展的一个微电子技术和电力电子技术相结合的重要技术领域,由于微电子技术和功率MOS器件的迅速发展为智能型功率集成电路提供了可能性.集成电路的电隔离技术允许在同一芯片上集成功率DMOS和低压控制的双极型 相似文献
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介绍一种薄栅氮化的工艺方法,可用于0.8-1.0μm级别的MOS集成电路及抗辐射MOS集成电路的工艺生产中. 相似文献
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MOS晶体管失配模型研究及应用 总被引:2,自引:1,他引:1
采用0.18μm CMOS工艺,研究在模拟集成电路中MOS管的失配.通过分析MOS管在饱和区失配因素,优化MOS管失配模型,提出用最小二乘曲线拟合法进行相关模型参数提取.并根据这些参数对基本电路的失配进行预测和分析,给出改善MOS管匹配性的方法.这为相应的集成电路设计中存在的失配提供了理论依据. 相似文献
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一般的金属-氧化物-半导体集成电路(MOSIC),都是由P沟MOS晶体管构成的,但是P沟MOS集成电路有下述缺点: (1)传导载流子是空穴,所以迁移率低,开关速度慢; (2)由于电源电压是负的,所以不易与双极集成电路混用。与此相反,所用的器件都用N沟MOS晶体管构成的N沟MOS集成电路时有下 相似文献
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最近,美帝宇宙航行局经研究认为 MOS 集成电路的20%~40%的缺陷是由过量电压和氧化物中存在缺陷而引起的,其结果导致栅极的短路和漏电流的增加。由栅导体电击穿引起的栅短路,使 MOS 晶体管及集成电路的成品率和可靠性都存在问题。在防止过量电压的 MOS 器件的栅极保护方面,过去广泛使用的是 J·莱兰特·赛里的方法,把 PN 结与栅极并列放置,向 PN 结施加反向偏压而使晶体管工作。 相似文献
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我们用10keV X射线对MOS晶体管、MOS集成电路进行了辐照,观察了用不同工艺条件制造出的MOS晶体管,MOS集成电路在X射线辐照下阈值电压的漂移和特性变化。本文给出了实验结果并进行了初步的讨论。 相似文献
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一、概述通常讲的MOS集成电路,它是由金属—氧化物—半导体场效应晶体管组成。其作用与五极电子管特性相似;另一方面它又有一般晶体管的许多优点,除此之外,还具有一系列更突出的优点,即集成变高,制作工艺简单,功耗低,输入阻抗高(达10~(12)以上),而CMOS集成电路还具有供电范围宽,工作频率高f(?)3M以上,所以被广泛应用于数字控制电路及模拟开关电路等方面。二、MOS集成电路中主要问题的分析 1.栅击穿电压在MOS晶件管中,栅极与沟道之间隔着一层氧化膜,这种结构与电容器的结构一样。当栅源电压或栅漏电压超过一定限度,就会引起氧化膜的击穿,使栅极与氧化膜下面的硅发生短路现象。P—N结加上反向电 相似文献
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引言近来,出现了一种制造自对准金属—氧化物—半导体(MOS)集成电路的新工艺,该工艺只需要三次掩蔽,应用离子注入工艺来获得自对准栅结构。采用氮化硅膜来消除接触掩蔽以及降低场氧化物顶部至接触区和栅区的高度。这种工艺能制造N沟或P沟MOS集成电路。在N沟MOS集成电路中,应用低阻率P型衬底材料或用离子注入提高场表面浓度能避免场反型的问题。为简单起见,本文叙述制造工艺步骤和P沟MOS集成电路的器件特性。 相似文献
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前几年的发展基本上解决了制备互补MOS晶体管特性化单片电路的难题;现在已能大量生产既可靠又经济的COS/MOS集成电路。本文阐述了COS/MOS集成电路的基本设计及工艺及生产这些电路的最新工艺的进展,它们将给固体电路的应用开辟新的途径。 相似文献
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1972年美国半导体工业产值达到16.5亿美元,比1971年增长13%;其中MOS集成电路发展最快,只是数字双极集成电路稍有下降,线性电路也提高25%,光电器件增加40%,分立元件也有所增加。一、MOS MOS现已成为TTL新的竞争者(70年产值为2百万美元),MOS已很快成为标准产品工业的竞争者。今年将是从常规产品转为标准产品的一年。这一方面意味着MOS工艺日臻完善,另一方面表明将大幅度降价,约在1975年标准产品可占MOS总 相似文献