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在多层印刷电路板(PCB)设计时,经常需要信号通过过孔跨接到其他层走线,这种走线方式会导致返回路径不连续(RPD),引发信号完整性问题,文中应用电磁场全波仿真工具SIwave构建信号跨层走线模型,从电源分配网络(PDN)阻抗的角度分析了跨层走线对信号传输的影响,同时使用添加电容的方法优化信号传输路径,并对电容的选取及其位置的确定进行了研究,为PCB设计提供参考。 相似文献
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借助矢量网络分析仪研究了高速印制电路板信号层差分阻抗过孔焊环与相邻层反焊环尺寸对差分过孔阻抗、高速信号插入损耗及回波损耗的影响情况。结果表明,当焊环尺寸从2mil逐渐增大至 12mil时,过孔阻抗从84Ω 逐渐减小至75.8Ω,差分链路上的回波损耗及插入损耗则随阻抗匹配度减小而劣化,当相邻层反焊环尺寸从 8mil逐渐增大至20mil时, 过孔阻抗从79Ω逐渐增大至 84.6Ω,差分链路上的回波损耗及插入损耗则随阻抗匹配度增加而减小。 相似文献
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在高速数字电路设计中,过孔的寄生电容、电感的影响不能忽略,过孔在传输路径上表现为阻抗不连续的断点,会产生信号的反射、延时、衰减等信号完整性问题。文章采用矢量网络分析仪研究了过孔长度、过孔孔径、焊盘/反焊盘直径对过孔阻抗的影响。通过在信号孔旁增加接地孔,为过孔电流提供回路方法,提高过孔阻抗的连续性,并有效降低过孔损耗。此外,文章还探讨了过孔多余短柱对过孔阻抗及损耗的影响。本研究可为高速数字电路过孔设计和优化提供依据。 相似文献
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针对差分过孔引起的阻抗不连续以及过孔残桩引起的信号反射问题,通过过孔反焊盘补偿设计及端接过孔残桩减小了差分过孔及残桩引起的反射,改善了接收信号的质量。通过对比差分过孔优化设计前后的频域传输参数和时域信号眼图,说明了本方法的有效性及实用性。 相似文献
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高速PCB中的过孔设计研究 总被引:2,自引:1,他引:1
传输线的不连续问题已成为当今高速数字设计研究的重点,尤其是高速多层板中的过孔结构。随着频率的增长和信号上升沿的变陡,过孔带来的阻抗不连续会引起信号的反射,严重影响系统的性能和信号完整性。文章运用全波电磁仿真软件HFSS,对多种过孔结构进行了全面的研究。通过建立三维物理模型,分析了过孔直径、过孔长度和多余的过孔短柱几种关键设计参数对高速电路的信号完整性的影响。 相似文献
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使用FR4敷铜板PCBA上各个器件之间的电气连接是通过其各层敷着的铜箔走线和过孔来实现的。由于不同产品、不同模块电流大小不同,为实现各个功能,设计人员需要知道所设计的走线和过孔能否承载相应的电流,以实现产品的功能,防止过流时产品烧毁。文中介绍设计和测试FR4敷铜板上走线和过孔的电流承载能力的方案和测试结果,其测试结果可以为设计人员在今后的设计中提供一定的借鉴,使PCB设计更合理、更符合电流要求。 相似文献
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阻抗设计是高速PCB设计的一个重要组成部分。文章在简要介绍了传输线的阻抗计算原理的基础上,针对相邻层都有走线的情况,通过阻抗计算软件得出了叠层设计对阻抗影响的趋势规律。并在此基础上,设计了阻抗测试板,针对阻抗测试结果得出了相邻层的走线要符合阻抗匹配的设计规则。依据这些结论,就能够保证相邻层的走线阻抗符合设计值,因此对相邻层走线的阻抗设计有很好的指导性。 相似文献
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传输线连续性问题已成为当今高速数字电路设计的重点,尤其是多层PCB中大量使用的过孔结构。随频率的增加和上升时间的缩短,过孔阻抗不连续以及寄生电容、电感会引起信号反射和衰减,并进一步导致信号完整性(SI)问题。综述了高速电路中单端和差分过孔的孔径、孔长度等设计参数对阻抗连续性和S参数的影响,并介绍了三种提高过孔信号传输质量的方法,包括避免多余短柱、非穿导技术以及为过孔信号提供返回路径。本文能够为高速数字电路设计者进行过孔信号完整性判定提供参考。 相似文献
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利用内层导电两次背钻工艺对同一设计的36层高速PCB的差分过孔背钻后预留不同长度的Stub,然后基于频域法 并借助矢量网络分析仪对上述差分过孔及其所在90Ω的差分阻抗线的信号完整性进行了研究。结果表明,内层导电两次背钻工艺可以大幅减小Stub长度,从而提升高速信号在PCB中传输完整性,当Stub长度从60mil降至6mil时,对应的过孔因容性突变效应减弱,阻抗由69.2Ω上升至94.8Ω,过孔阻抗一致性提升使得PCB的回波损耗及插入损耗均呈现出降低趋势,当Stub长度为6mil时?PCB的回波损耗在较宽的信号频率范围内均小于-15dB,表现出良好的信号完整性。 相似文献
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给出了一款双向4路并行14Gb/s光收发器的物理设计。分析了链路上的信号完整性设计,考虑了各个物理结构中不连续点,如差分过孔、AC耦合电容、金丝绑线、可插拔I/O接口,对传输特性的影响。从理论上分析了S参数谐振现象,找出导致谐振的原因,给出了用于分析此类问题的理论公式。通过对多种不连续结构进行电磁仿真和结果对比,提出具体的性能改进方案。通过整个链路的阻抗控制,插入损耗在10~15GHz内提高了1dB,S参数的谐振得到明显改善。最后,从时域的TDR和眼图测试角度对优化结构进行了验证。 相似文献
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