Si离子注入对SIMOX SOI材料抗总剂量辐照性能的影响

为了提高SIMOX SOI材料抗总剂量辐照的能力,采用硅注入绝缘埋层后退火得到改性的SIMOX SOI材料.辐照前后,用pseudo-MOSFET方法测试样品的ID-VG特性曲线.结果表明,合适的硅离子注入工艺能有效提高材料抗总剂量辐照的能力.     

Si离子注入对SIMOX SOI材料抗总剂量辐照性能的影响

为了提高SIMOX SOI材料抗总剂量辐照的能力,采用硅注入绝缘埋层后退火得到改性的SIMOX SOI材料．辐照前后,用pseudo-MOSFET方法测试样品的ID-VG特性曲线．结果表明,合适的硅离子注入工艺能有效提高材料抗总剂量辐照的能力．     

用于辐照加固器件的ELO SOI技术

本文讨论了制作绝缘体上硅(SOI)结构的外延横向过生长技术(ELO),并通过在SOI结构上制作的nMOS晶体管验证ELO SOI材料质量和器件总剂量加固性能。在SOI结构上制作的nMOS晶体管显示出了好的辐射特性,例如,发现剂量为10~5戈瑞(硅)的辐射诱发变化为,阈值电压漂移=-0.25V,跨导衰减=18％。     

0．8μm SOI CMOS技术及电路研制

SOI CMOS技术在一些特殊应用领域中有着体硅无法比拟的优势文中叙述采用SIMOX材料和0.8μm SOI CMOS工艺加固技术成功研制出抗辐射性能较好的器件和电路,并且给出了SOI CMOS器件的特性随辐照总剂量的变化关系,试验电路通过了总剂量500 Krad(Si)钴60γ射线辐照实验。     

抗总剂量辐射0.8μm SOI CMOS器件与专用集成电路

介绍了采用全剂量SIMOX SOI材料制备的0.8μm SOI CMOS器件的抗总剂量辐射特性,该特性用器件的阈值电压、漏电流和专用集成电路的静态电流与高达500krad(Si)的总剂量的关系来表征.实验结果表明pMOS器件在关态下1Mrad(Si)辐射后最大阈值电压漂移小于320mV,nMOS器件在开态下1Mrad(Si)辐射后最大阈值电压漂移小于120mV,器件在总剂量1Mrad(Si)辐射后没有观察到明显漏电,在总剂量500krad(Si)辐射下专用集成电路的静态电流小于5μA.     

抗总剂量辐射0.8μm SOI CMOS器件与专用集成电路

介绍了采用全剂量SIMOX SOI材料制备的0.8μm SOI CMOS器件的抗总剂量辐射特性,该特性用器件的阈值电压、漏电流和专用集成电路的静态电流与高达500krad(Si)的总剂量的关系来表征.实验结果表明pMOS器件在关态下1Mrad(Si)辐射后最大阈值电压漂移小于320mV,nMOS器件在开态下1Mrad(Si)辐射后最大阈值电压漂移小于120mV,器件在总剂量1Mrad(Si)辐射后没有观察到明显漏电,在总剂量500krad(Si)辐射下专用集成电路的静态电流小于5μA.     

部分耗尽型注氟SIMOX器件的电离辐射效应

采用在SIMOX圆片埋氧层中注入氟(F)离子的方法改善SIMOX的抗总剂量辐射能力,通过比较未注F样品和注F样品辐照前后SIMOX器件Ids-Vgs特性和阈值电压,发现F具有抑制辐射感生pMOSFET和nMOSFET阈值电压漂移的能力,并且可以减小nMOSFET中由辐照所产生的漏电流.说明在SOI材料中前后Si/SiO2界面处的F可以减少空穴陷阱密度,有助于提高SIMOX的抗总剂量辐射能力.     

抗辐射SOI器件栅氧可靠性研究

对抗辐射SOI器件栅氧可靠性进行研究,比较了体硅器件、SOI器件、抗总剂量加固SOI器件的栅氧可靠性,发现SOI材料片的制备与抗总剂量加固过程中的离子注入工艺都会对顶层硅膜造成影响,进而影响栅氧可靠性。最后通过恒压应力法表征栅氧介质随时间击穿(TDDB)的可靠性,结果显示抗总剂量辐射加固工艺的12.5 nm栅氧在125℃高温5.5 V工作电压下TDDB寿命达到14.65年,满足SOI抗总剂量辐射加固工艺对栅氧可靠性的需求。     

部分耗尽型注氟SIMOX器件的电离辐射效应

研究了采用向SIMOX圆片埋氧层中注入F离子的方法来改善SIMOX的抗总剂量辐射能力，通过比较未注F样品和注F样品的辐照前后SIMOX器件Ids-Vgs特性和阈值电压，发现F具有抑制辐射感生PMOSFET和NMOSFET阈值电压漂移的能力，并且可以减小NMOSFET中由辐照所产生的漏电流。说明在SOI材料中前后Si/Si02界面处的F可以减少空穴陷阱浓度，有助于提高SIMOX的抗总剂量辐射能力。     

Total Dose Radiation-Hard 0.8μm SOI CMOS Transistors and ASIC

介绍了采用全剂量SIMOX SOI材料制备的0．8μm SOI CMOS器件的抗总剂量辐射特性，该特性用器件的阈值电压、漏电流和专用集成电路的静态电流与高达500krad（Si）的总剂量的关系来表征．实验结果表明pMOS器件在关态下1Mrad（Si）辐射后最大阈值电压漂移小于320mV，nMOS器件在开态下1Mrad（Si）辐射后最大阈值电压漂移小于120mV，器件在总剂量1Mrad（Si）辐射后没有观察到明显漏电，在总剂量500krad（Si）辐射下专用集成电路的静态电流小于5pA．     

SOI/bulk hybrid technology on SIMOX wafers for high performancecircuits with good ESD immunity

A new SOI/bulk hybrid technology with devices on both the thin film and the bottom substrate of SIMOX wafers has been studied. By fabricating ESD protection circuits on the substrate of SIMOX wafers, ESD reliability of high performance CMOS SOI circuits can be significantly improved. Despite the higher surface defect density and micro-roughness on the bottom substrate of SIMOX wafers compared to ordinary bulk wafers, similar electron mobility, intrinsic thermal oxide properties and hot-carrier degradation are observed among MOSFET's fabricated on the different substrates. Thus, the hybrid technology is capable of combining the advantages both of SOI and bulk technology in fabricating high performance circuits     

SIMOX技术及CMOS／SIMOX器件的研究与发展

SIMOX技术是最具有发展前途的SOI技术之一。在发展薄硅层、深亚微米OMOS/SOI集成电路中,SIMOX技术占有极其重要的地位。本文综述了SIMOX基片的形成、高质量SIMOX基片的制备方法。阐述了薄硅层OMOS/SIMOX器件的工艺特点以及器件的性能特点。本文也就SIMOX技术及GMOS/SIMOX器件的研究现状及发展趋势进行了讨论。     

N+多晶硅栅薄膜全耗尽SOI CMOS器件与电路的研究

选用SIMOX(Separation by Implantation of Oxygen)衬底材料,对全耗尽SOI CMOS工艺进行了研究,开发出了N 多晶硅栅全耗尽SOI CMOS器件及电路工艺,获得了性能良好的器件和电路。nMOS和pMOS的驱动电流都比较大,且泄漏电流很小,在工作电压为3V时,1．2μm101级环振的单级延迟仅为50．5ps。     

Substrate crosstalk reduction using SOI technology

This work analyzes both by simulations and measurements the substrate crosstalk performances of various Silicon-On-Insulator (SOI) technologies, and compares them to those of normal bulk CMOS process. The influence of various parameters, such as substrate resistivity, buried oxide thickness and distance between devices, is investigated. The use of capacitive guard rings is proposed, and their effectiveness is demonstrated. A simple RC model has been developed to allow a deep understanding of these phenomena as well as to simplify future studies of more complex systems. The superiority of high-resistivity SIMOX substrates over standard SOI and bulk is finally demonstrated     

超高速CMOS/SOI51级环振电路的研制

利用CMOS/SOI工艺在4英寸SIMOX材料上成功制备出沟道长度为1μm、器件性能良好的CMOS/SOI部分耗尽器件和电路,从单管的开关电流比看,电路可以实现较高速度性能的同时又可以有效抑制泄漏电流.所研制的51级CMOS/SOI环振电路表现出优越的高速度性能,5V电源电压下单门延迟时间达到92ps,同时可工作的电源电压范围较宽,说明CMOS/SOI技术在器件尺寸降低后将表现出比体硅更具吸引力的应用前景.     

全耗尽SOI MOSFET及CMOS／SOI电路的研究

采用ＳＩＭＯＸ材料，研制了一种全耗尽ＣＭＯＳ／ＳＯＩ模拟开关电路，研究了全耗尽ＳＯＩ ＭＯＳ场效应晶体管的阈值电压与背栅偏置的依赖关系，对漏源击穿的Ｓｎａｐｂａｃｋ特性进行分析，介绍了薄层ＣＭＯＳ／ＳＩＭＯＸ制作工艺，给出了全耗尽ＣＭＯＳ／ＳＯＩ电路的测试结果。     

注F~+加固CMOS/SOI材料的抗辐射研究

向SIMOX材料的SiO2埋层或Si/SiO2界面注入170 keV F+,进而制成CMOS/SOI材料,采用60Co g 辐射器辐照并测量材料的I-V特性。结果表明:向CMOS/SOI材料埋层注入F+离子,能提高CMOS/SOI材料的抗电离辐照性能。而且,注入F+的剂量为11015cm2时,材料的抗辐照能力较强。这对制作应用于电离辐射环境的COMS/SOI器件极其有益。     

Merged CMOS/bipolar technologies utilizing zone-melting-recrystallized SOI films

Two merged CMOS/bipolar technologies utilizing SOI structures have been demonstrated. In each case a single sequence of processing steps was used to fabricate fully isolated CMOS devices and vertical bipolar transistors on the same Si wafer. The CMOS devices were fabricated in zone-melting-recrystallized SOI film, while the bipolar devices were fabricated either in the SOI film or in epitaxial Si layers grown selectively on the Si substrate. Good electrical characteristics were obtained for the CMOS devices and for both SOI and epitaxial bipolar devices.     

双多晶硅栅SOI MOS器件的研究

采用多晶硅栅全耗尽ＣＭＯＳ／ＳＩＭＯＸ工艺成功研制出多晶硅栅器件,其中Ｎ＋栅ＮＭＯＳ管的阈值电压为０．４５Ｖ,Ｐ＋栅ＰＭＯＳ管的阈值电压为－０．２２Ｖ,在１Ｖ和５Ｖ电源电压下多晶硅栅环振电路的单级门延迟时间分别为１．７ｎｓ和３５０ｐｓ,双多晶硅栅ＳＯＩ技术将是低压集成电路的一种较好选择。     

CMOS on local SOI using SIMOX technology

CMOS on local SOI, in which n-MOS/bulk and p-MOS/SOI can be selectively implemented on the same chip, has been developed. SOI regions are formed by SIMOX technology, while bulk regions are prepared by etching of the buried SiO2. A CMOS inverter fabricated on local SOI shows good transfer characteristics.