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1.
薄膜SOI RESURF结构击穿电压分析 总被引:4,自引:2,他引:2
提出了基于二维Poisson方程的薄膜SOI降低表面电场(RESURF结构解析物理模型.并在该模型基础上,给出了一种分析薄膜SOIRESURF结构击穿电压的方法.利用这一方法计算了漂移区长度较长的薄膜SOIRESURF结构击穿电压与漂移区掺杂浓度的关系,并定量分析了场SiO2界面电荷密度对击穿电压和漂移区临界掺杂浓度的影响.首次提出了临界场SiO2界面电荷密度的概念,并研究了其与漂移区掺杂浓度的关系.而且计算结果与MEDICI模拟结果符合得很好.这些为漂移区长度较长的薄膜SOIRESURF结构击穿电压的优 相似文献
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RESURF原理应用于SOI LDMOS晶体管 总被引:5,自引:0,他引:5
本文首次采用解析方法及二维计算机模拟讨论了RESURF原理应用于SOILDMOS晶体管.研究表明:击穿电压随埋层SiO2厚度增加而增加;击穿电压随Si层厚度变化呈现U型曲线;当埋层SiO2和Si层厚度一定时,Si层的杂质浓度存在一个临界值,在此浓度之下,可获得高的击穿电压.这个结论也适用于介质隔离的各种横向器件的击穿特性分析. 相似文献
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提出了采用对LDMOS漂移区表面进行分段离子注入,对表面电场进行了整形的一种新结构高压RESURFLDMOST。利用二维数值模拟对这种器件结构的分析表明,这种新结构显著降低了表面电场峰值,降低了采用RESURF技术导致的耐压对工艺参数变化的敏感性,并在耐压不降低的情况下缩短器件漂移区长度,得到低的比导通电阻Ron.A。 相似文献
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为了实现50~500V的击穿电压范围,本文详细讨论了6H-SiC和3C-SiC肖特基整流器和功率MOSFET的漂移区性质。利用这些数据计算了器件的输出特性,并与Si器件做了比较,结果表明,由于其漂移区电阻非常低,故5000VSiC肖特基整流器和功率MOSFET在室温下能够处理100A/cm^2的导通电流密度,正向压降仅分别为3.85和2.95V。这些数值甚至优于Sipin整流器和门可关断晶闸管。这 相似文献
6.
高压RESURF LDMOSFET的实现 总被引:6,自引:0,他引:6
利用RESURF技术,使用常规低压集成电路工艺,实现了适用于HVIC、耐压达1000V的LDMOSFET。本文介绍了该高压LEMOSFET的设计方法、器件结构、制造工艺测试结果,此外,本文还从实验和分析的角度探讨了覆盖在漂移区上面的金属栅-金属栅场板长度LF对RESURF器件耐压的影响。 相似文献
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介绍了SOIMOSFET 二维数值模拟器的设计过程。耦合和非耦合相结合的迭代方法提高了收敛稳定性和计算效率。考虑了两种载流子的连续性方程及产生复合作用,精度较高。给出了利用该设计方法获得的SOIMOSFET二维体电势分布以及载流子浓度分布的三维输出图形。 相似文献
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《微纳电子技术》1995,(5)
为了实现50~500V的击穿电压范围,本文详细讨论了6H-SiC和3C-SiC肖特基整流器和功率MOSFET的漂移区性质。利用这些数值计算了器件的输出特性,并与Si器件做了比较,结果表明,由于其漂移区电阻非常低,故5000VSiC肖特基整流器和功率MOSFET在室温下能够处理100Alcm ̄2的导通电流密度,正向压降仅分别为3.85和2.95V。这些数值甚至优于Sipin整流器和门可关断晶闸管。这种SiC器件由于没有少于结,故可期望有优良的开关特性和坚固耐用性。此外,还基于峰值结温极限是由封装考虑来确定的观点,报道了热学分析结果。应用这种分析发现,5000V的6H-SiC和3C-SiCMOSFET和肖特基整流器将比相应的Si器件大约小20和18倍。对SiC的热学分析表明,这些器件能在比常规Si器件高的温度和击穿电压下工作。还有,在管芯尺寸上也期望有明显的减少,这将会补偿其材料成本较高的不足。本文报告的分析结果对SiC功率器件的制造将会起到强大的推动作用。 相似文献
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介绍了采用有限差分法求解特殊边界条件下二维静态电场问题,并将电磁场数值方法的思想体现在处理过程中。对场域中的电势、电位进行了具体的分析和计算,给出了用C语言进行编程计算得到场量数据的流程图,最后利用MATLAB强大的绘图功能对结果进行可视化。由文章研究问题所得图形结果可以清晰的看出静电场中的电势线及电场线的分布,同时也验证了电场线与等电位线相互垂直,以及电势在媒质分界面连续的经典理论。 相似文献
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以往对SOI器件的建模基本上基于漂移区全耗尽的假设,且大多未考虑场板对表面势场分布的影响。通过分区求解二维泊松方程,建立了场板SOI RESURF LDMOS表面电势和表面电场分布解析模型。该模型同时考虑了栅场板和漏场板的作用,既适用于漂移区全耗尽的情况,也适用于漂移区不全耗尽的情况。利用此模型和半导体器件仿真工具Silvaco,详细探讨了器件在不同偏压下栅场板和漏场板对漂移区表面电势和电场分布的影响。解析模型结果与数值仿真结果吻合良好,验证了模型的准确性。 相似文献
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推导出二维Laplace方程的有限差分公式,用Matlab语言编写程序,实例分析并绘制了屏蔽单微带线、屏蔽耦合微带线的等位线和电场强度分布图。实例计算结果表明:Matlab在解决实际的工程和数学问题中,具有使用更为简便、语句功能更强的特点,能直观地演示屏蔽微带线的电势分布图和场强立体分布图。 相似文献
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提出复合介质埋层SOI(compound dielectric buried layer SOI,CDL SOI)高压器件新结构,建立其电场和电势分布的二维解析模型,给出CDL SOI和均匀介质埋层SOI器件的RESURF条件统一判据.CDL SOI结构利用漏端低k(介电常数)介质增强埋层纵向电场,具有不同k值的复合介质埋层调制漂移区电场,二者均使耐压提高.借助解析模型和二维数值仿真对其电场和电势进行分析,二者吻合较好.结果表明,对低k值为2的CDL SOILDMOS,其埋层电场和器件耐压分别比常规SOI结构提高了82%和58%. 相似文献
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本文引用了附加有浮动电位保护环和场板的VDMOS结构击穿电压的解析表达式,描述了浮动电位保护环和场板效应和穿通击穿电压的改进,经比较理论结果与测量数据有效好的一致性。 相似文献
17.
研究了在外加电场作用下无限深GaAs半导体量子阱中束缚磁极化子的性质,采用线性组合算符及幺正变换方法导出了量子阱中弱耦合束缚磁极化子的基态能量与阱宽、电场强度、磁感应强度、库仑束缚势的变化关系,同时讨论了振动频率和库仑束缚势、外场之间的变化关系.数值计算结果表明:基态能量的绝对值将随电场强度和库仑束缚势的增加而增加,随磁感应强度和阱宽的增加而减小.当阱宽较小时,量子尺寸效应较为明显. 相似文献
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研究了在外加电场作用下无限深GaAs半导体量子阱中束缚磁极化子的性质,采用线性组合算符及幺正变换方法导出了量子阱中弱耦合束缚磁极化子的基态能量与阱宽、电场强度、磁感应强度、库仑束缚势的变化关系,同时讨论了振动频率和库仑束缚势、外场之间的变化关系.数值计算结果表明:基态能量的绝对值将随电场强度和库仑束缚势的增加而增加,随磁感应强度和阱宽的增加而减小.当阱宽较小时,量子尺寸效应较为明显. 相似文献