400MHz吞脉冲程序分频器的研制

本文介绍了程序分频器的组成、逻辑设计。及提高速度的措施,该分频器配合双模前置分频器,可使吞脉冲程序分频器频率达420MHz。     

高速程序分频器

介绍一种高速吞脉冲程序分频器.该分频器速度高达550MHz,工作可靠,分频比为100～999,适用于数字频率合成器.     

分频器的选择与使用

<正> 众所周知,扬声器系统由扬声器单元、音箱体和分频器三大部分组成,其中分频器对高、中、低音的重放、音质等都起着举足轻重的作用。本文简单介绍分频器的选择与使用。 一、分频器原理 大家知道,人耳可听到频率范围在20Hz～20kHz的声音。由于频带宽阔,只用单个扬声器是不能重放整个音频频谱的,因此可把声音分为低、中、高音频段,由多个扬声器来进行重放。大多数扬声器系统都是二分频或三分频的系统。二分频系统由高音和低音单元组成,三分频系统由高、中、低音单元组成,这样基本上可获得宽阔的重放频带。另     

超高速低功耗ECL予置分频器研究

本文介绍一个÷5/6低功耗ECL予置分频器的设计,从降低电源电压,减小内部逻辑摆幅和寄生电容等几方面讨论了提高电路高速低功耗特性的途径。该电路采用串联电源电压结构,内部电路在-2.5V～-2.7V电源电压下工作。电路功耗仅为具有相同功能的普通ECL电路的1/6。采用3μm设计规则的氧化物隔离等平面S型双极工艺。发射极条实际尺寸2μm×9μm,晶体管f_i为3.2GHz。室温下典型功耗75mW,最高M作频率大于900MHz。     

超低功耗硅双模预置ECL高速分频器的研究

本文介绍了超低功耗硅双模预置ECL高速分频器的设计和工艺技术。采用0.6μm设计规则和多晶硅发射极-基极自对准双极技术,设计制作的双模(÷64/65,÷128/129)预置分频器,在3mW(电源电压为3V)的极低功耗下,工作频率在1000MHz以上。     

一位小数分频器

近年来,在频率合成技术上广泛使用了小数分频器小数分频是基于分频比平均的原理上,它可以解决高参考频率和高分辨率之间的矛盾。换言之,它可使压控振荡器输出频率的分辨率(频率间隔)远小于参考频率。因为参考频率选得较高,环路通带宽,所以具有良好的杂散抑制能力,转换速度亦快。     

一种500MHz高速程序分频器

文章介绍的高速程序分频器,电路方案独特,设计简洁新颖。在充分发挥各单元电路逻辑功能的基础上,通过巧妙地连接和组合,使其具有工作频率高(可高达500MHz)、功耗低、分频比预置直观、工作稳定可靠的显著特点,是一种性能优越,颇具特色的高速程序分频器。     

2千兆赫GaAs分频器设计

本文介绍了我国自行研制成功的GaAs 2千兆赫二分频分频器的设计。其试验电路测试结果表明该设计方法的可行性。     

高速低功耗多模分频器的设计

基于相位转换技术的多模分频器由于其在工作频率和功耗中能更好地折中而得到广泛的应用.为了进一步降低功耗,利用两级反相器对其相位信号进行整形,使工作频率最高的前两级÷2分频器能降低输出幅度的要求,从而大大降低功耗.这两级反相器还可以调整相位信号占空比为25%,甚至更小,从而增大相位控制信号的延时余量,实现无毛刺的加计数相位转换.基于相位转换4模分频器的基本原理,设计了一个2.55 GHz的多模分频器.仿真结果表明,采用0.35μm BiCMOS工艺,在3.3 V电源电压下,分频值为128～255,最大功耗不到14 mW.     

动态分频器技术

本文介绍了动态分频器的基本原理；详细叙述了动态分频器电路及其主要工艺技术；综述了国外动态分频器的发展动态。     

应用于26 GHz-41 GHz频率综合器的高速可编程分频器的设计

毫米波频率综合器中的重要模块之一高速可编程多模分频器,它主要用于对VCO的输出信号进行分频从而获得稳定的本振信号,它的性能影响整个毫米波频率综合器性能。本文设计的一种高速、低功耗、分频比可变的分频器具有非常重要的意义[1]。根据26 GHz-41 GHz硅基锁相环频率综合器的系统指标,本文基于TSMC 45nm CMOS工艺,设计实现了一种高速可编程分频器。本文采用注入锁定结构分频结构实现高速预分频,该结构可以实现在0 d Bm的输入功率下实现25 GHz-48 GHz的分频范围、最低功耗为:2.6 m W。基于脉冲吞咽计数器的可编程分频器由8/9双模分频器和可编程脉冲吞咽计数器组成。其中8/9双模分频器由同步4/5分频器和异步二分频构成,工作频率范围10 GHz-27 GHz,最低输入幅度为:300 m V,最低功耗为:1.6 m V。可编程吞咽计数器采用改进型带置数功能的TSPC D触发器,该可编程分频器的最大工作范围:25 GHz;最小功耗为:363μW。本文设计的高速可编程多模分频器,可以实现32-2 062的分频比;当工作于28 GHz时,相位噪声小于-159 dBc/Hz。动态功耗为5.2 m W。     

频率合成器在卫星电视接收机中的应用

本文介绍了频率合成器的基本原理，并以ＭＣ１４５１５５为例，详述了其在卫星电视接收机中的具体应用，给出了应用电路图。     

MC12022低功耗双模预置分频器

ＭＣ１２０２２低功耗双模预置分频器有６４／６５／１２８／１２９四种分频功能，最高工作频率可达１６００ＭＨＺ，是移动通信中ＰＬＬ的关键电路，本文介绍了其工作原理、主要性能特点、电路参数、管脚排列及电路的典型应用。     

20～60MHz频率合成器(上)

目前在频率分割的多路通信中,都采用频率合成器来改变发射机载波频率和接收机本级振荡频率去实现通信功能。MC145157是功能比较齐全的新CMOS、LSI锁相频率合成器产品。通过改变加到参考分频器和程序分频器的分频数据获得不同的参考频率(分辨率)和诸多的输出频率。本文(上)介绍的用硬件实现的控制方法及(下)介绍的单片机实现的控制方法在现代通信系统中应用十分广泛。     

一种ECL高速可编程分频器

本文介绍了一种ＥＣＬ高速可编程分频器的逻辑设计、电路设计、温度补偿设计、版图设计及研制结果。采用４μｍｐｎ结双埋层对通隔离ＥＣＬ工艺技术制作的可编程分频器，其最高工作频率达１００ＭＨｚ以上，工作温度范围为－５５～＋１２５℃，分频模数在１～６４之间任意自然数连续可变。     

低成本数字分频器设计

本文介绍了利用硬件语言VeriolgHDL实现任意分频,特别是小数分频的设计方法,并在QuartusII编程环境下,进行了仿真和调试。     

可编程分频器的实现

在研制电力线载波数字复接器时,为了能确保系统稳定工作,必须要有性能可靠的时钟电路,因此利用同步MODEM本身产生的时钟,便是最佳的选择方案,但MODEM在外部14.4kHZ时钟训练结束后,随着连接速率的不同,而产生28.8k、24k、19.2k、14.4kHZ四种不同的时钟。电力线载波数字复接器的功能是同时复用3路话音和4路数据,它的复用速率为9.6kHZ,如何利用以上4种时钟产生稳定的9.6k时钟,就需要一个可编程分频器,尽管器件手册上推荐了诸如74HC292、74HC294等类型的可编程芯片,但由于均是冷门芯片,市场上很难买到,因此利用最常见的74Hc161带异步清除的计数器设计了性能完善的可编程计数器。 我们知道28.8k、24k、19.2k、14.4k这四种时钟和9.6k的关系很难确定,难以产生9.6k时钟,因此要先对这些时钟进行倍频处理,倍频电路的核心是CD4046锁相环芯片,加上用74HC393生成的4分频电路构成,之所以采用4分频,是考虑到在分频后要得到的是对称方波,要是用奇数分频则得到的是不对称方波。具体电路图如下所示: MODEM产生的时钟信号从上图的IN端子进入,经过